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基于FPGA的移位寄存器流水線結(jié)構(gòu)FFT處理器設(shè)計(jì)與實(shí)現(xiàn)

  • 0引言快速傅里葉變換(FFT)在雷達(dá)、通信和電子對(duì)抗等領(lǐng)域有廣泛應(yīng)用。近年來(lái)現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)...
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基于FPGA的攝像機(jī)傳感器接口實(shí)現(xiàn)

  • 圖像傳感器，是組成數(shù)字?jǐn)z像頭的重要組成部分。如果沒(méi)有傳感器，就沒(méi)有圖像信號(hào)可進(jìn)行處理。眾所周知傳感器是非標(biāo)準(zhǔn)化的。在采用的方案中，它們有以下的不同之處：　　轉(zhuǎn)換可見(jiàn)光或紅外光為電信號(hào)的方式；尤其
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基于動(dòng)態(tài)可重構(gòu)FPGA的容錯(cuò)技術(shù)研究

  • 摘要：針對(duì)重構(gòu)文件的大小、動(dòng)態(tài)容錯(cuò)時(shí)隙的長(zhǎng)短、實(shí)現(xiàn)的復(fù)雜性、模塊間通信方式、冗余資源的比例與布局等關(guān)鍵問(wèn)題進(jìn)行了分析。并對(duì)一些突出問(wèn)題，提出了基于算法和資源多級(jí)分塊的解決方法，闡述了新方法的性能，及其
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基于FPGA的IEEE 1394b高速數(shù)據(jù)傳輸系統(tǒng)

  • 摘要：介紹了IEEE 1394h串行總線的特點(diǎn)，并以FPGA嵌入式處理器Nios II為控制核心，設(shè)計(jì)實(shí)現(xiàn)了一種1394b高速數(shù)據(jù)傳輸系統(tǒng)。闡述了該系統(tǒng)的硬件設(shè)計(jì)和軟件工作流程。實(shí)驗(yàn)表明，該系統(tǒng)可靠性高、實(shí)時(shí)性好、具有廣泛的應(yīng)
  • 關(guān)鍵字： 1394b  FPGA  IEEE  高速數(shù)據(jù)    

基于FPGA和LabView的遙測(cè)信號(hào)模擬源設(shè)計(jì)

  • 摘要：基于FPGA和LabView設(shè)計(jì)了用于某遙測(cè)組件測(cè)試的專(zhuān)用設(shè)備。運(yùn)用DDS技術(shù)實(shí)現(xiàn)傳輸速率可變的LNDS信號(hào)，并使用LabView圖形編程工具，實(shí)現(xiàn)了數(shù)字信號(hào)源的交互界面，可以產(chǎn)生由上住機(jī)程控信號(hào)傳輸速率和數(shù)據(jù)內(nèi)容可變的
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基于DSP與FPGA的藍(lán)牙數(shù)據(jù)采集系統(tǒng)

  • 數(shù)據(jù)采集系統(tǒng)廣泛地應(yīng)用于工業(yè)、國(guó)防、圖像處理、信號(hào)檢測(cè)等領(lǐng)域。DSP處理器是一種高速的數(shù)字信號(hào)處理...
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基于FPGA的圖像增強(qiáng)視頻處理系統(tǒng)

  • 圖像增強(qiáng)處理有很強(qiáng)的針對(duì)性，沒(méi)有統(tǒng)一的評(píng)價(jià)標(biāo)準(zhǔn)，從一般的圖片、視頻欣賞角度來(lái)說(shuō)，濾除噪聲、擴(kuò)展對(duì)比度、銳化...
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用LatticeXP FPGA 橋接吉比特媒體獨(dú)立接口

  • 吉比特媒體獨(dú)立接口是一種以太網(wǎng)接口，簡(jiǎn)稱(chēng)GMII（Gigabit Media Independent Interface）。簡(jiǎn)化的吉比特媒體獨(dú)立接口稱(chēng)為RGMII（Reduced Gigabit Media Independent Interface）。采用RGMII的目的是降低電路成本，使
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基于FPGA的智能小車(chē)設(shè)計(jì)

  • 摘要：介紹基于FPGA的智能小豐設(shè)計(jì)，小車(chē)包括在FPGA上構(gòu)建以NiosⅡ嵌入式系統(tǒng)為核心的控制電路、傳感器電路、動(dòng)力及轉(zhuǎn)向電路、LCM電路、溫度和濕度測(cè)量電路、無(wú)線數(shù)據(jù)收發(fā)電路。在NiosⅡ集成開(kāi)發(fā)環(huán)境(IDE)縞寫(xiě)C語(yǔ)言程
  • 關(guān)鍵字： 設(shè)計(jì)  小車(chē)  智能  FPGA  基于  

基于FPGA高速并行采樣技術(shù)的研究

  • 摘要：介紹一種基于四通道ADC的高速交錯(cuò)采樣設(shè)計(jì)方法以及在FPGA平臺(tái)上的實(shí)現(xiàn)。著重闡述四通道高速采樣時(shí)鐘的設(shè)計(jì)與實(shí)現(xiàn)、高速數(shù)據(jù)的同步接收以及采樣數(shù)據(jù)的校正算法。實(shí)驗(yàn)及仿真結(jié)果表明，同步數(shù)據(jù)采集的結(jié)構(gòu)設(shè)計(jì)和預(yù)
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基于FPGA的三模冗余容錯(cuò)技術(shù)研究

  • 摘要：基于SRAM的FPGA對(duì)于空間粒子輻射非常敏感，很容易產(chǎn)生軟故障，所以對(duì)基于FPGA的電子系統(tǒng)采取容錯(cuò)措施以防止此類(lèi)故障的出現(xiàn)是非常重要的。三模冗余(TMR)方法以其實(shí)現(xiàn)的簡(jiǎn)單性和效果的可靠性而被廣泛用于對(duì)單粒子
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萊迪思和HELION TECHNOLOGY發(fā)布了適用于LatticeECP3 FPGA系列的壓縮和加密IP核

  • 　　萊迪思半導(dǎo)體公司和Helion Technology今日宣布一系列適用于LatticeECP3 FPGA系列的壓縮和加密的IP核現(xiàn)已上市。該系列具有有效載荷壓縮系統(tǒng)核，提高了有限信道帶寬的利用率，因此非常適合微波回程應(yīng)用、寬帶無(wú)線接入適用于802.16e（WiMAX）以及潛在的其他多鏈路多輸入-多輸出（MIMO）應(yīng)用中的使用。在LatticeECP3器件中，IP核可以從500Mbps無(wú)縫擴(kuò)展至超過(guò)3Gbps，并可用于典型的網(wǎng)絡(luò)應(yīng)用中的第2層或第3層。IP核采用了非常強(qiáng)大和成熟的LZRW無(wú)損壓縮算法，它
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Altera、Apical和AltaSens聯(lián)合發(fā)布HD寬動(dòng)態(tài)范圍視頻監(jiān)控芯片組

  • 　　延續(xù)其在高清晰(HD)寬動(dòng)態(tài)范圍(WDR)監(jiān)控?cái)z像機(jī)解決方案上的領(lǐng)先優(yōu)勢(shì)，Altera公司、Apical有限公司(UK)以及AltaSens有限公司今天宣布，開(kāi)始提供業(yè)界第一款HD WDR視頻監(jiān)控芯片組。這一獨(dú)特的芯片組結(jié)合了Altera Cyclone® IV E FPGA和安全芯片，支持Apical的HD WDR全圖像信號(hào)處理(ISP)流水線IP和AltaSens的1080p60 A3372E3-4T圖像傳感器。這一獨(dú)特的解決方案能夠方便的使用Apical IP，降低了用戶(hù)在全傳感器處理解
  • 關(guān)鍵字： Altera  視頻監(jiān)控  FPGA  

基于FPGA的DES、3DES硬件加密技術(shù)

  • 基于FPGA的DES、3DES硬件加密技術(shù),傳統(tǒng)的加密工作是通過(guò)在主機(jī)上運(yùn)行加密軟件實(shí)現(xiàn)的。這種方法除占用主機(jī)資源外，運(yùn)算速度較慢，安全性也較差。而硬件加密是通過(guò)專(zhuān)用加密芯片、FPGA芯片或獨(dú)立的處理芯片等實(shí)現(xiàn)密碼運(yùn)算。相對(duì)于軟件加密，硬件加密具有
  • 關(guān)鍵字： 加密  技術(shù)  硬件  3DES  FPGA  DES  基于  

一種密鑰可配置的DES加密算法的FPGA

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