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EEPW首頁 >> 主題列表 >> fpga-pwm

在FPGA中植入嵌入式系統(tǒng)

  • 在FPGA中植入嵌入式系統(tǒng),如今，由于可編程器件(如FPGA)容量大、性能高、成本相對較低的特性，這種平衡又在發(fā)生變化，以前硬件設(shè)計元素(如處理器及其外圍器件和邏輯塊)也可以轉(zhuǎn)移到軟領(lǐng)域(圖1)。因此，在整個開發(fā)周期內(nèi)，靈活性可能更大，更改
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單片機(jī)控制的PWM斬波式交流凈化穩(wěn)壓電源

  • 摘 要: 介紹了傳統(tǒng)的正弦能量分配交流凈化穩(wěn)壓電源的基本原理及如何用高頻斬波和單片機(jī)技術(shù)對其進(jìn)行改造。 關(guān)鍵詞: 高頻 斬波 交流穩(wěn)壓器 AVR 目前,在各種交流穩(wěn)壓電源中,采用正弦能量分配技術(shù)的交流凈
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基于FPGA和TFT彩屏液晶的便攜示波器設(shè)計

  • 摘要：設(shè)計了以FPGA為核心采集模塊，以單片機(jī)為顯示控制核心，以TFT彩屏液晶為顯示器件的便攜數(shù)字存儲示波器。通過異步FIFO實現(xiàn)了FPGA中高速數(shù)據(jù)流與單片機(jī)處理速度之間的速率匹配。以三總線結(jié)構(gòu)以及控制信號的握手協(xié)
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Altera MIPS聯(lián)手SLS發(fā)布業(yè)界首款FPGA軟核處理器

  • 　　近日Altera公司、MIPS科技公司以及System Level Solutions (SLS) 公司聯(lián)合推出了MIPS-Based?、FPGA優(yōu)化軟核處理器，適用于Altera FPGA以及ASIC器件。MP32處理器是MIPS?兼容應(yīng)用類處理器，繼承了業(yè)界規(guī)模最大的軟件開發(fā)工具以及操作系統(tǒng)支持生態(tài)系統(tǒng)。MP32處理器是業(yè)界第一款基于FPGA的軟核處理器，由Wind River公司的VxWorks RTOS和MIPS Navigator ICS軟件開發(fā)套裝提供支持。
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FAE講堂：提升創(chuàng)造力的數(shù)字設(shè)計工具 FPGA Editor

  • 　　工程師在設(shè)計過程中，經(jīng)常需要一定的創(chuàng)造力(你不妨稱之為數(shù)字管道膠帶)才能夠保證設(shè)計的順利完成。過去8年時間里，我曾經(jīng)目睹許多優(yōu)秀工程師利用這一方法出色地完成了許多工作，而他們采用的最主要工具就是 FPGA Editor。 　　利用FPGA Editor，你可以察看完成的設(shè)計并確定是否在FPGA構(gòu)造一級真正實現(xiàn)了設(shè)計意圖 – 而這對于任何工程師或現(xiàn)場應(yīng)用工程師來說都是非常需要的。假設(shè)你拿到協(xié)作者的設(shè)計，需要對其進(jìn)行修改，但他們的 HDL源代碼非常難于理解，或者根本沒有任何注釋或文檔。也許你
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利用PWM給HCS12單片機(jī)應(yīng)用增加語音功能

  • 利用PWM給HCS12單片機(jī)應(yīng)用增加語音功能,本文利用飛思卡爾公司HCS12單片機(jī)的PWM模塊，還原存儲在存儲器中的聲音采樣數(shù)據(jù)，在幾乎不增加成本的情況下，實現(xiàn)嵌入式應(yīng)用中的擴(kuò)展語音功能。隨著嵌入式領(lǐng)域的拓展，目前許多微控制器芯片一般都不具備數(shù)據(jù)－模擬的
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基于ARM和FPGA的線陣CCD測徑系統(tǒng)的設(shè)計

  • 近幾年來，電線、電纜、光纖等產(chǎn)品的需求量大大增加，外徑尺寸的質(zhì)量控制成為許多生產(chǎn)廠家急需解決的問題。傳統(tǒng) ...
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Altera在FPGA上導(dǎo)入光傳輸

  • 　　LSI接口終于要實現(xiàn)“光纖”化了。美國阿爾特拉(Altera)公布了在FPGA中導(dǎo)入光纖接口的計劃。預(yù)定在2011年內(nèi)采用試制芯片進(jìn)行演示，2012年以后產(chǎn)品化。產(chǎn)品主要面向高清視頻傳輸、云計算、三維游戲以及高性能視頻監(jiān)控等用途。在這些產(chǎn)品中，除了主板上的LSI間布線外，還可廣泛地用于機(jī)殼內(nèi)布線等用途。 　
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優(yōu)化FIR數(shù)字濾波器的FPGA實現(xiàn)

  • 摘要：基于提高速度和減少面積的理念，對傳統(tǒng)的FIR數(shù)字濾波器進(jìn)行改良?？紤]到FPGA的實現(xiàn)特點，研究并設(shè)計了采用Radix-2的Booth算法乘法器以及結(jié)合了CSA加法器和樹型結(jié)構(gòu)的快速加法器，并成功應(yīng)用于FIR數(shù)字濾波器的設(shè)
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第二代串行 RapidIO 和低成本、低功耗的 FPGA

  • 過去，F(xiàn)PGA在系統(tǒng)設(shè)計中發(fā)揮了重要作用，但現(xiàn)在還需要新的性能，同時需要降低整個系統(tǒng)的構(gòu)建和運營成本。功能豐富、低成本的FPGA實現(xiàn)了快速的產(chǎn)品上市時間與較短的投資回報周期，并且擁有能夠適應(yīng)不斷發(fā)展的標(biāo)準(zhǔn)的靈活性和性能。系統(tǒng)/設(shè)計工程師現(xiàn)在還擁有了一個令人興奮的、改進(jìn)的工具集來解決不斷演進(jìn)的信號處理市場的挑戰(zhàn)。
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FPGA在嵌入式系統(tǒng)中的開發(fā)方向

  • FPGA在嵌入式系統(tǒng)中的開發(fā)方向,早期的嵌入式系統(tǒng)一般是以通用處理器或單片機(jī)為核心，在外圍電路中加入存儲器、功率驅(qū)動器、通信接口、顯示接口、人機(jī)輸入接口等外圍接口，再加上應(yīng)用軟件，有些還加上了嵌入式操作系統(tǒng)，從而構(gòu)成完整的系統(tǒng)。　　隨
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在賽靈思FPGA設(shè)計中保留可重復(fù)結(jié)果

  • 　　滿足設(shè)計的時序要求本身已非易事，而要實現(xiàn)某項設(shè)計的整體時序具有完全可重復(fù)性有時候卻是不可能的任務(wù)。幸運的是，設(shè)計人員可以借助有助于實現(xiàn)可重復(fù)時序結(jié)果的設(shè)計流程概念。影響最大的四個方面分別是 HDL 設(shè)計實踐、綜合優(yōu)化、平面布局和實施方案。 　　就獲得可重復(fù)結(jié)果而言，資源利用和頻率要求都很高的設(shè)計是最大的挑戰(zhàn)。它們也是可重復(fù)結(jié)果流程需求最高的設(shè)計。得到可重復(fù)結(jié)果的第一步是在 HDL設(shè)計階段運用設(shè)計合理的實踐。遵循出色的分層邊界實踐有助于保持邏輯整體性，而這在設(shè)計變更時有助于保持可重復(fù)結(jié)果。一條不錯的規(guī)
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基于賽靈思Virtex-5 FPGA的LTE仿真器實現(xiàn)

  • 　　功能強(qiáng)大的可編程邏輯平臺使得Prisma Engineering公司能夠針對所有蜂窩網(wǎng)絡(luò)提供可重配置無線測試設(shè)備。長期演進(jìn)(LTE)是移動寬帶的最3GPP標(biāo)準(zhǔn)，它打破了現(xiàn)有蜂窩網(wǎng)絡(luò)的固有模式。LTE與前代UMTS和GSM標(biāo)準(zhǔn)相比，除采用高頻譜效率的射頻技術(shù)外，其架構(gòu)還得到了大幅簡化。LTE系統(tǒng)的無線接入部分Node-B，是連接無線電和整個互聯(lián)網(wǎng)協(xié)議核心網(wǎng)絡(luò)之間的邊緣設(shè)備。這種架構(gòu)無法監(jiān)測和測試等效于UMTS中間鏈路上的元件。必須通過無線電接口，才能有效地測試LTE網(wǎng)絡(luò)元件。 　　這正是Prisma
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以基于賽靈思 FPGA 的硬件加速技術(shù)打造高速系統(tǒng)

  • 　　設(shè)計人員時常需要通過增加計算能力或額外輸入（或兩者）延長現(xiàn)有的嵌入式系統(tǒng)的壽命。而可編程系統(tǒng)平臺在這里大有用武之地。我們曾經(jīng)希望用安全網(wǎng)絡(luò)連接功能升級一套網(wǎng)絡(luò)可編程系統(tǒng)。安全網(wǎng)絡(luò)連接功能需要加密才能運行安全外殼 (SSH)、傳輸層安全 (TLS)、安全套接層(SSL) 或虛擬專用網(wǎng) (VPN) 等協(xié)議。這種安全需求與把各種系統(tǒng)接入因特網(wǎng)的需求同步增長，例如，為了啟用遠(yuǎn)程管理與分布式控制系統(tǒng)。 　　因該領(lǐng)域仍在發(fā)展并且標(biāo)準(zhǔn)尚未固定，因此成本主要取決于一次性工程費用。所以，F(xiàn)PGA 技術(shù)能實現(xiàn)最高價值。
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賽靈思推出ISE 12.3設(shè)計套件，引入AMBA 4 AXI4 IP 核

  • 　　ISE12.3增強(qiáng)PlanAhead 設(shè)計與分析控制臺，并進(jìn)一步優(yōu)化功耗，標(biāo)志著支持 AXI4 接口IP的推出，和即插即用FPGA 設(shè)計的實現(xiàn) 　　賽靈思公司（Xilinx, Inc.  ）宣布推出 ISE® 12.3設(shè)計套件，這標(biāo)志著這個FPGA 行業(yè)領(lǐng)導(dǎo)者針對片上系統(tǒng)設(shè)計的互聯(lián)功能模塊， 開始推出滿足AMBA® 4 AXI4 規(guī)范的IP核，以及用于提高生產(chǎn)力的 PlanAhead™ 設(shè)計和分析控制臺，同時還推出了用于降低了Spartan®-6 FPG
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fpga-pwm介紹

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