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EEPW首頁 >> 主題列表 >> fpga-pwm

基于FPGA的兩種DDS實現(xiàn)

  • 闡述了兩種DDS的原理，頻率合成方式(DDFS)和直讀方式(DDWS)，給出了FPGA實現(xiàn)方式，分析了DDS的幾個關(guān)鍵的技術(shù)指標(biāo)，并通過Matlab仿真。頻率合成方式是比較常用的DDS產(chǎn)生方式，對它做了詳細(xì)的原理性介紹和實現(xiàn)說明，重點(diǎn)通過仿真詳細(xì)對比了兩種實現(xiàn)方式在性能指標(biāo)上的優(yōu)劣，為后人的選擇提供技術(shù)參考。
  • 關(guān)鍵字： FPGA  DDS    

基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)

  • 基于FPGA的片上系統(tǒng)和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng),本系統(tǒng)立足于利用Intemet實現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實現(xiàn)上，采用了基于SOPC技術(shù)的嵌入式解決方案，通過在FPGA中嵌入NioslI軟核處理器和所需外設(shè)的IP Core(硅知識產(chǎn)權(quán)核)，然后再配備相應(yīng)的網(wǎng)絡(luò)接口，實現(xiàn)利用互聯(lián)
  • 關(guān)鍵字： 系統(tǒng)  監(jiān)控系統(tǒng)  遠(yuǎn)程  嵌入式  基于  FPGA  

基于FPGA的太陽跟蹤器的設(shè)計及實現(xiàn)

  • 在簡要介紹地日運(yùn)行規(guī)律的基礎(chǔ)上，確定了視日運(yùn)動跟蹤法的計算模型及跟蹤裝置的機(jī)械結(jié)構(gòu)。采用FPGA芯片XC3S1500為處理器，以步進(jìn)電機(jī)為執(zhí)行機(jī)構(gòu)，采用Verilog語言設(shè)計實現(xiàn)了高度角一方位角太陽跟蹤系統(tǒng)。根據(jù)系統(tǒng)的要求建立了計時模塊、太陽高度角方位角計算模塊、日出日落時間計算模塊和步進(jìn)電機(jī)脈沖控制模塊。通過實驗測試該系統(tǒng)能夠達(dá)到預(yù)期的性能指標(biāo)，對提高太陽能的利用率具有重要的現(xiàn)實意義。
  • 關(guān)鍵字： FPGA  跟蹤器    

基于FPGA芯片和頻率合成器ADF4360-4的GPS信號源的設(shè)計方案

  • 基于FPGA芯片和頻率合成器ADF4360-4的GPS信號源的設(shè)計方案,　頻率合成器是發(fā)射系統(tǒng)和接收系統(tǒng)中的核心器件，采用相位負(fù)反饋頻率控制技術(shù)，具有良好的窄帶載波跟蹤性能和帶寬調(diào)制跟蹤性能，為系統(tǒng)上、下變頻提供本振信號，對相位噪聲和雜散具有很好的抑制作用，通過鎖相頻率合
  • 關(guān)鍵字： GPS  信號源  設(shè)計  方案  ADF4360-4  合成器  FPGA  芯片  頻率  

基于FPGA的SoC和嵌入式系統(tǒng)的遠(yuǎn)程監(jiān)控系統(tǒng)

  • 本系統(tǒng)立足于利用Intemet實現(xiàn)核環(huán)境信息的遠(yuǎn)程采集。在實現(xiàn)上，采用了基于SOPC技術(shù)的嵌入式解決方案，通過...
  • 關(guān)鍵字： 遠(yuǎn)程監(jiān)控  SoC  嵌入式  FPGA  

基于FPGA和頻率合成器的GPS信號源的設(shè)計

  • 頻率合成器是發(fā)射系統(tǒng)和接收系統(tǒng)中的核心器件，采用相位負(fù)反饋頻率控制技術(shù)，具有良好的窄帶載波跟蹤性能和...
  • 關(guān)鍵字： ADF4360-4  FPGA  頻率合成器  GPS信號源  

一種基于FPGA和單片機(jī)的掃頻儀研究與設(shè)計

  • 一個網(wǎng)絡(luò)的頻率特性包括幅頻特性和相頻特性，在系統(tǒng)設(shè)計時，各個網(wǎng)絡(luò)的頻率特性對該系統(tǒng)的穩(wěn)定性、工作頻帶...
  • 關(guān)鍵字： 掃頻儀  FPGA  單片機(jī)  掃頻信號  

基于65nm FPGA的多模無線基站的高端應(yīng)用

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： 65nm  TD-SCDMA  FPGA  多模無線基站  

FPGA/EPLD的自上而下設(shè)計方法

  • FPGA/EPLD的自上而下設(shè)計方法,FPGA/EPLD的自上而下(Top-Down)設(shè)計方法：　　傳統(tǒng)的設(shè)計手段是采用原理圖輸入的方式進(jìn)行的，如圖1所示。通過調(diào)用FPGA/EPLD廠商所提供的相應(yīng)物理元件庫，在電路原理圖中繪制所設(shè)計的系統(tǒng)，然后通過網(wǎng)表轉(zhuǎn)換產(chǎn)生某一特
  • 關(guān)鍵字： 方法  設(shè)計  自上而下  FPGA/EPLD  

基于FPGA與SRAM的大容量數(shù)據(jù)存儲的設(shè)計

  • 基于FPGA與SRAM的大容量數(shù)據(jù)存儲的設(shè)計,　1 前言　針對FPGA中內(nèi)部BlockRAM有限的缺點(diǎn)，提出了將FPGA與外部SRAM相結(jié)合來改進(jìn)設(shè)計的方法，并給出了部分VHDL程序?！　? 硬件設(shè)計　　這里將主要討論以Xilinx公司的FPGA(XC2S600E-6fg456)和ISSI公司的SRAM(IS61
  • 關(guān)鍵字： 存儲  設(shè)計  數(shù)據(jù)  大容量  FPGA  SRAM  基于  

基于上位機(jī)與FPGA開發(fā)板的光纖通道接口適配器

  • 基于上位機(jī)與FPGA開發(fā)板的光纖通道接口適配器,　　隨著存儲技術(shù)的迅速發(fā)展，存儲容量得到了迅速的增長，存儲系統(tǒng)的數(shù)據(jù)傳輸速度成為了主要的瓶頸。光纖的傳輸具有其速度上的優(yōu)勢，然而，在光纖傳輸要受到光纖通道接口的限制，因此光纖通道應(yīng)用于高速數(shù)據(jù)傳輸?shù)囊?/li>
  • 關(guān)鍵字： 通道  接口  適配器  光纖  開發(fā)  上位  FPGA  基于  

基于XC866的PWM直流無刷電機(jī)的正弦波控制

  • 傳統(tǒng)的直流無刷電機(jī)采用方波控制方式，控制簡單，容易實現(xiàn)，同時存在轉(zhuǎn)矩脈動、換相噪聲等問題，在一些對噪聲有要求的應(yīng)用領(lǐng)域存在局限性。針對這些應(yīng)用，采用正弦波控制可以很好的解決這個問題。

    直流無刷電機(jī)的
  • 關(guān)鍵字： 電機(jī)  控制  直流  PWM  XC866  基于  

Altera展示25-Gbps收發(fā)器，樹立滿足業(yè)界帶寬需求關(guān)鍵里程碑

  • 　　Altera公司(NASDAQ: ALTR)今天宣布，公司率先在可編程邏輯中成功演示25-Gbps收發(fā)器性能，在收發(fā)器技術(shù)上樹立了關(guān)鍵里程碑。Altera在28-nm收發(fā)器測試芯片上實現(xiàn)了這一具有里程碑意義的技術(shù)，該芯片是Altera用于在28-nm FPGA上成功實現(xiàn)28-Gbps收發(fā)器的原型開發(fā)平臺。實現(xiàn)25-Gbps里程碑，使目前已有FPGA解決方案的性能提高兩倍多，并在功能上優(yōu)于競爭ASSP產(chǎn)品。您可以在Altera網(wǎng)站上觀看28-nm收發(fā)器測試芯片的視頻演示。 　　Altera 28-nm
  • 關(guān)鍵字： Altera  收發(fā)器   FPGA  

出租車計費(fèi)器的EOA設(shè)計與實現(xiàn)

  • 摘要：以現(xiàn)場可編程邏輯器件(FPGA)為設(shè)計載體，以硬件描述語言(VHDL)為主要表達(dá)方式，以QuartusⅡ開發(fā)軟件和GW48EDA開發(fā)系統(tǒng)為設(shè)計工具，給出了一種出租車計費(fèi)器的工作原理和軟硬件實現(xiàn)方法。同時對該出租車計費(fèi)器進(jìn)
  • 關(guān)鍵字： FPGA  
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fpga-pwm介紹

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