fpga-pwm 文章進(jìn)入fpga-pwm技術(shù)社區(qū)

具有多個電壓軌的FPGA和DSP電源設(shè)計(jì)實(shí)例（一）

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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基于AT89S51單片機(jī)的PWM專用信號發(fā)生器設(shè)計(jì)

介紹一種脈沖渦流無損檢測系統(tǒng)所使用的多波形專用PWM信號發(fā)生器的設(shè)計(jì)。
關(guān)鍵字：信號發(fā)生器設(shè)計(jì) 專用 PWM AT89S51 單片機(jī) 基于

基于智能PWM控制的機(jī)車制動控制單元的設(shè)計(jì)

本文介紹了一種基于智能脈沖寬度調(diào)制(Pulse WidthModulation，PWM)控制的機(jī)車制動控制單元的設(shè)計(jì)和實(shí)現(xiàn)方法。
關(guān)鍵字：控制單元設(shè)計(jì) 制動機(jī)車 PWM 基于智能

基于FPGA的二值圖像連通域標(biāo)記快速算法實(shí)現(xiàn)

摘要：針對高速圖像目標(biāo)實(shí)時識別和跟蹤任務(wù)，需要利用系統(tǒng)中有限的硬件資源實(shí)現(xiàn)高速、準(zhǔn)確的二值圖像連通域標(biāo)記，提出了一種適合FPGA實(shí)現(xiàn)的二值圖像連通域標(biāo)記快速算法。算法以快捷、有效的方式識別、并記錄區(qū)域間復(fù)雜的連通關(guān)系。與傳統(tǒng)的二值圖像標(biāo)記算法相比，該算法具有運(yùn)算簡單性、規(guī)則性和可擴(kuò)展性的特點(diǎn)。利用FPGA實(shí)現(xiàn)該算法時，能夠準(zhǔn)確有效的識別出圖像中復(fù)雜的連通關(guān)系，產(chǎn)生正確的標(biāo)記結(jié)果。在100MHz工作時鐘下，處理384
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基于FPGA的高速可變周期脈沖發(fā)生器的設(shè)計(jì)

1 引言要求改變脈沖周期和輸出脈沖個數(shù)的脈沖輸出電路模塊在許多工業(yè)領(lǐng)域都有運(yùn)用。采用數(shù)字器件設(shè)計(jì)周期和輸出個數(shù)可調(diào)節(jié)的脈沖發(fā)生模塊是方便可行的。為了使之具有高速、靈活的優(yōu)點(diǎn)，本文采用Atelra公司的可編程芯片F(xiàn)PGA設(shè)計(jì)了一款周期和輸出個數(shù)可變的脈沖發(fā)生器。經(jīng)過板級調(diào)試獲得良好的運(yùn)行效果。 2 總體設(shè)計(jì)思路脈沖的周期由高電平持續(xù)時間與低電平持續(xù)時間共同構(gòu)成，為了改變周期，采用兩個計(jì)數(shù)器來分別控制高電平持續(xù)時間和低電平持續(xù)時間。計(jì)數(shù)器采用可并行加載初始值的N位減法計(jì)數(shù)器。設(shè)定：當(dāng)要求的高電平
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FPGA所需的電源供應(yīng)：深入分析

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字：美國國家半導(dǎo)體公司 FPGA DC/DC

基于FPGA的IDE硬盤接口卡的實(shí)現(xiàn)

引言本文采用FPGA實(shí)現(xiàn)了IDE硬盤接口協(xié)議。系統(tǒng)提供兩套符合ATA-6規(guī)范的IDE接口，一個與普通IDE硬盤連接，另一個與計(jì)算機(jī)主板上的IDE接口相連。系統(tǒng)采用FPGA實(shí)現(xiàn)接口協(xié)議，完成接口數(shù)據(jù)的截獲、處理（在本文中主要是數(shù)據(jù)加密）和轉(zhuǎn)發(fā)，支持PIO和Ultra DMA兩種數(shù)據(jù)傳輸模式。下面重點(diǎn)介紹用FPGA實(shí)現(xiàn)接口協(xié)議的方法。 1 IDE接口協(xié)議簡介 1.1 IDE接口引腳定義 IDE（Integrated Drive Electronics）即“電子集成驅(qū)動器”，又稱為ATA接口。表1列
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基于ARM和FPGA的多功能車輛總線嵌入式系統(tǒng)設(shè)計(jì)

基于ARM和FPGA的多功能車輛總線嵌入式系統(tǒng)設(shè)計(jì),本文介紹了一種基于ARM和FPGA，從軟件到硬件完全自主開發(fā)多功能車輛總線(Multifunction Vehicle Bus)MVB嵌入式系統(tǒng)的設(shè)計(jì)和實(shí)現(xiàn)。
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賽靈思推出新型完整FPGA解決方案

　　賽靈思公司宣布推出支持DDR2 SDRAM接口的低成本Spartan™-3A FPGA開發(fā)套件、支持多種高性能存儲器接口（I/Fs）的Virtex™-5 FPGA 開發(fā)平臺(ML-561) ，以及存儲器接口生成器（MIG）軟件1.7版本。這些完整的解決方案使FPGA用戶能夠快速實(shí)施并驗(yàn)證在不同數(shù)據(jù)速率和總線寬度下的專用存儲器接口設(shè)計(jì)，從而加快產(chǎn)品的上市時間。　　這些包括器件特性描述、數(shù)據(jù)輸入電路以及存儲器控制器的解決方案，均已在使用了美光科技公司（Micron Techn
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賽靈思推出65nm FPGA一周年：VIRTEX-5 FPGA率先實(shí)現(xiàn)量產(chǎn)

　　賽靈思公司日前隆重宣布，其屢獲殊榮的65nm Virtex-5 FPGA系列兩款器件LX50 和 LX50T最先實(shí)現(xiàn)量產(chǎn)。自2006年5月15日推出65nm Virtex-5 FPGA平臺以來，賽靈思目前已向市場發(fā)售了三款平臺（LX、LXT和SXT）的13種器件，它們?yōu)榭蛻籼峁┝藷o需任何折衷的業(yè)界最高的性能、最低的功耗，并擁有業(yè)界唯一內(nèi)建的PCI Express®™ 端點(diǎn)和千兆以太網(wǎng)模塊，以及業(yè)界最高的DSP性能。　　賽靈思公司高級產(chǎn)品部執(zhí)行副總裁Iain Morris 表示
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功率分配系統(tǒng)（PDS）設(shè)計(jì)：利用旁路電容/去耦電容（一）

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基于現(xiàn)場可編程門陣列（FPGA）技術(shù)的射頻讀卡器設(shè)計(jì)

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什么是FPGA？

什么是可編程邏輯？在數(shù)字電子系統(tǒng)領(lǐng)域，存在三種基本的器件類型：存儲器、微處理器和邏輯器件。存儲器用來存儲隨機(jī)信息，如數(shù)據(jù)表或數(shù)據(jù)庫的內(nèi)容。微處理器執(zhí)行軟件指令來完成范圍廣泛的任務(wù)，如運(yùn)行字處理程序或視頻游戲。邏輯器件提供特定的功能，包括器件與器件間的接口、數(shù)據(jù)通信、信號處理、數(shù)據(jù)顯示、定時和控制操作、以及系統(tǒng)運(yùn)行所需要的所有其它功能。固定邏輯與可編程邏輯邏輯器件可分為兩大類 – 固定邏輯器件和可編程邏輯器件。正如其命名一樣，固定邏輯器件中的電路是永久性的，它們完成一種
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基于FPGA的RISC微處理器的設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA和電子設(shè)計(jì)自動化技術(shù)，采用模塊化設(shè)計(jì)的方法和VHDL語言，設(shè)計(jì)一個基于FPGA的RISC微處理器。
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基于FPGA的微處理器內(nèi)核設(shè)計(jì)與實(shí)現(xiàn)

與傳統(tǒng)投片實(shí)現(xiàn)ASIC相比，F(xiàn)PGA具有實(shí)現(xiàn)速度快、風(fēng)險(xiǎn)小、可編程、可隨時更改升級等一系列優(yōu)點(diǎn)，因而得到了越米越廣泛的應(yīng)用。MCS-51應(yīng)用時間長、范圍廣，相關(guān)的軟硬件資源豐富，因而往往在FPGA應(yīng)用中嵌人MCS-51內(nèi)核作為微控制器。但是傳統(tǒng)MCS-51的指令效率太低，每個機(jī)器周期高達(dá)12時鐘周期，因此必須對內(nèi)核加以改進(jìn)，提高指令執(zhí)行速度和效率，才能更好地滿足FPGA的應(yīng)用。通過對傳統(tǒng)MCS-51單片機(jī)指令時序和體系結(jié)構(gòu)的分析，使用VHDL語言采用自頂向下的設(shè)計(jì)方法重新設(shè)計(jì)了一個高效的微控制器內(nèi)核
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