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EDA技術(shù)與FPGA設(shè)計應(yīng)用

  • 摘 要：EDA技術(shù)是現(xiàn)代電子設(shè)計技術(shù)的核心，它在現(xiàn)代集成電路設(shè)計中占據(jù)重要地位。隨著深亞微米與超深亞微米技術(shù)的迅速發(fā)展，F(xiàn)PGA設(shè)計越來越多地采用基于VHDL的設(shè)計方法及先進的EDA工具。本文詳細(xì)闡述了EDA技術(shù)與FPGA
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采用基于FPGA的SoC進行數(shù)字顯示系統(tǒng)設(shè)計

  • 系統(tǒng)級芯片(SoC)可采用現(xiàn)場可編程門陣列(FPGA)或?qū)Ｓ眉呻娐?ASIC)兩種方式實現(xiàn)。目前業(yè)界通常將處理器、邏輯單元和存儲器等系統(tǒng)嵌入FPGA中構(gòu)成靈活的SoC解決方案，本文以Virtex-II系列Platform FPGA為例，說明采用
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基于DM6446的視頻運動車輛檢測系統(tǒng)設(shè)計

比亞迪S6搭載電子防眩+隱形電子羅盤內(nèi)后視鏡

基于FPGA的多體制雷達(dá)信號源的設(shè)計

  • 隨著雷達(dá)技術(shù)的發(fā)展，出現(xiàn)了多種體制的雷達(dá)，比如脈沖多普勒雷達(dá)、SAR、相控陣?yán)走_(dá)先進，雖然這些雷達(dá)的功能不同，但是為了提作用距離和距離向上的分辨率，都彩了大時寬積信號。 在雷達(dá)信號源設(shè)計領(lǐng)域，DDS技術(shù)
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Microchip推出15款全新8位PIC單片機

  • 全球領(lǐng)先的集成單片機、模擬器件和閃存專利解決方案的供應(yīng)商——Microchip Technology Inc.(美國微芯科技公司)宣布，推出三個全新增強型中檔8位MCU系列，擴展了其經(jīng)認(rèn)證的全速USB 2.0設(shè)備PIC?單片機產(chǎn)品組合。新產(chǎn)品包括15款擁有高達(dá)128 KB閃存、14至100引腳可擴展的MCU。
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FTF2012(美國)改變無處不在

  • 2012，對飛思卡爾來說，是個不尋常的年份，因為2012年以來在公司身上發(fā)生的改變是明顯的，或者說是深刻的。歲末年初進行了業(yè)務(wù)部門調(diào)整，變?nèi)秊槎?4月份傳出消息，從分離出來后就執(zhí)掌公司的Rich Bayer宣布退休，選擇并任命了新任CEO。
  • 關(guān)鍵字： 飛思卡爾  MCU  ARM  201209  

京微雅格做中國自己的FPGA

  • 京微雅格，是世界上除了美國硅谷以外唯一能夠自主開發(fā)FPGA產(chǎn)品的公司。九年前，京微雅格創(chuàng)立，在累計投資3500萬美元之后，先后研發(fā)出7款具有自主知識產(chǎn)權(quán)的集FPGA、CPU、存儲器為一體的可編程系列芯片。京微雅格CEO劉明博士這樣來形容京微雅格在FPGA產(chǎn)業(yè)中的位置，“我們已經(jīng)加入到這個俱樂部，成為了其中的一員”。
  • 關(guān)鍵字： 京微雅格  FPGA  201209  

一種自適應(yīng)紅外圖像增強處理的FPGA實現(xiàn)

  • 摘要：本文介紹了一種自適應(yīng)平臺直方圖算法對紅外圖像增強處理及該算法在FPGA器件上的實現(xiàn)。該方法是根據(jù)圖像的直方圖，自適應(yīng)地選擇平臺閾值，實現(xiàn)自適應(yīng)平臺直方圖均衡化，增強了目標(biāo)的對比度。
  • 關(guān)鍵字： FPGA  紅外圖像  平臺閾值  201209  

NI發(fā)布兩款全新NI CompactRIO擴展機箱

  • 美國國家儀器公司(National Instruments, 簡稱 NI)近日發(fā)布8槽NI 9154 MXI-Express RIO擴展機箱和4槽NI 9146以太網(wǎng)RIO擴展機箱，進一步擴大了C系列平臺的規(guī)模，使其能夠連接需要成百上千I/O通道的應(yīng)用。 通過NI LabVIEW FPGA模塊，工程師可進行自定制在線處理、閉環(huán)控制、同步以及自定義定時和觸發(fā)，由此完全控制兩個機箱內(nèi)的現(xiàn)場可編程門陣列(FPGA)的功能。
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基于VHDL語言的FPGA簡易數(shù)字鐘設(shè)計

  • 作為一個菜鳥我很愿意分享下我做的一些小東西，記得一年前好像少幾天吧，看記錄是2009年5月19日我用51單片機做數(shù)字鐘的情景，那個時候用匯編，焦頭爛額，做了三天，還請教了老師。哎，現(xiàn)在都已經(jīng)用C了，而且重心已經(jīng)
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FPGA全局復(fù)位及局部復(fù)位設(shè)計

  • 隨著FPGA設(shè)計越來越復(fù)雜，芯片內(nèi)部的時鐘域也越來越多，使全局復(fù)位已不能夠適應(yīng)FPGA設(shè)計的需求，更多的設(shè)計趨向于使用局部的復(fù)位。本節(jié)將會從FPGA內(nèi)部復(fù)位“樹”的結(jié)構(gòu)來分析復(fù)位的結(jié)構(gòu)。我們的復(fù)位線將會
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FPGA和ASIC的比較

  • ASIC是英文的Application Specific Integrated Circuits縮寫，即專用集成電路，是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計、制造的集成電路。目前用CPLD(復(fù)雜可編程邏輯器件)和FPGA(現(xiàn)場可編程邏輯陣列)來進行AS
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FPGA引腳信號分配的幾個原則

  • 現(xiàn)在的FPGA正變得越來越復(fù)雜，向引腳分配信號的任務(wù)曾經(jīng)很簡單，現(xiàn)在也變得相當(dāng)繁復(fù)。下面這些用于向多用途引腳指配信號的指導(dǎo)方針有助于設(shè)計師根據(jù)最多到最少的約束信號指配原則提前考慮信號指配，并減少反復(fù)的次數(shù)
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FPGA與CPLD的比較

  • 盡管FPGA和CPLD都是可編程器件,有很多共同特點,但由于CPLD和FPGA結(jié)構(gòu)上的差異，具有各自的特點：1、CPLD更適合完成各種算法和組合邏輯,FPGA更適合于完成時序邏輯。換句話說,FPGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適
  • 關(guān)鍵字： FPGA  CPLD  比較    
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