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基于FPGA的星載計算機(jī)自檢EDAC電路設(shè)計

  • 摘要：為了消除空間環(huán)境中單粒子翻轉(zhuǎn)(SEU)的影響,目前星載計算機(jī)中均對RAM存儲單元采用檢錯糾錯(EDAC)設(shè)計。隨著FPGA在航天領(lǐng)域的廣泛應(yīng)用,FPGA已成為EDAC功能實(shí)現(xiàn)的最佳硬件手段。本文介紹了EDAC的編碼和實(shí)現(xiàn),提出一
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基于FPGA 的UART 擴(kuò)展總線設(shè)計和應(yīng)用

  • 摘要：現(xiàn)在嵌入式系統(tǒng)的功能越來越集合化,需要控制大量外設(shè)。外設(shè)模塊普遍采用UART作為通信接口,但是通常處理器都會自帶一個UART串口。實(shí)際應(yīng)用中一個串口往往不夠用,需要對系統(tǒng)進(jìn)行擴(kuò)展。本文所介紹的就是以FPGA為實(shí)
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基于FPGA的水聲信號采樣存儲系統(tǒng)設(shè)計

  • 摘要：為了提高水聲傳感器網(wǎng)絡(luò)通信系統(tǒng)試驗和算法研究的效率，水聲傳感器網(wǎng)絡(luò)節(jié)點(diǎn)需要具有水聲通信的原始波形數(shù)據(jù)的記錄功能。本文設(shè)計了一種水聲信號采樣存儲系統(tǒng)，實(shí)現(xiàn)了數(shù)據(jù)變速率AD采集、數(shù)據(jù)環(huán)形存儲、數(shù)據(jù)連續(xù)
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基于FPGA的高精度時差測量系統(tǒng)設(shè)計

  • 摘要：在時差定位(TDOA)技術(shù)中，高精度的時差測量是準(zhǔn)確定位的關(guān)鍵。針對這一需要， 提出一種基于FPGA 的高精度時差測量系統(tǒng)的實(shí)現(xiàn)方案。本系統(tǒng)的時差測算單元以Altera 公司Cyclone 系列的EP1C3T144 芯片為核心，并提
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基于FPGA的軟件無線電平臺設(shè)計

  • 0 引 言軟件無線電的出現(xiàn)，是無線電通信從模擬到數(shù)字、從固定到移動后，由硬件到軟件的第三次變革。簡單地說，軟件無線電就是一種基于通用硬件平臺，并通過軟件可提供多種服務(wù)的、適應(yīng)多種標(biāo)準(zhǔn)的、多頻帶多模式的、可
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基于EDA 技術(shù)（FPGA）的自動門控制系統(tǒng)設(shè)計

  • 引 言門和人類文明是孿生的，它伴隨著人類文明的發(fā)展而躍動。21 世紀(jì)的今天，門更加突出了安全理念，強(qiáng)調(diào)了有效性：有效地防范、通行、疏散，同時還突出了建筑藝術(shù)的理念，強(qiáng)調(diào)門與建筑以及周圍環(huán)境整體的協(xié)調(diào)、和諧
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快速充放電的利器 詳解超級電容技術(shù)

汽車電子已經(jīng)成為汽車市場的主要差異化指標(biāo)

  • 電子設(shè)備在整車制造成本所占比例也不斷增加，從1989年的16%增至2011年的30%以上。汽車廠商正在越來越多地使用電子系統(tǒng)和半導(dǎo)體集成電路用于汽車的各種應(yīng)用，包括車內(nèi)娛樂電子設(shè)備、傳動系統(tǒng)和身體控制電子設(shè)備以及汽車安全和舒適設(shè)備。
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Altera通過早期使用計劃，讓客戶提前了解面向FPGA的OpenCL效能優(yōu)勢

  • 　　Altera公司(NASDAQ: ALTR)今天發(fā)布其面向FPGA的OpenCL (開放計算語言)早期使用計劃(EAP)，支持客戶提前了解Altera面向FPGA的OpenCL解決方案。采用這一開放標(biāo)準(zhǔn)，設(shè)計團(tuán)隊可以在高級C語言框架中面向FPGA設(shè)計他們自己的系統(tǒng)和算法，大大簡化了FPGA的開發(fā)。作為EAP計劃的一部分，客戶能夠預(yù)先了解Altera的OpenCL解決方案，參加面向FPGA的OpenCL培訓(xùn)課程，獲得相關(guān)資料，觀看其技術(shù)演示。 　　OpenCL是一種開放編程標(biāo)準(zhǔn)，能夠跨CPU、GPU和
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基于FPGA嵌入式系統(tǒng)的雷達(dá)信號模擬器設(shè)計

  • 摘 要： 結(jié)合FPGA嵌入式系統(tǒng)具有硬件電路高并行度和軟件編程控制簡單的特點(diǎn)，設(shè)計了一套基于FPGA嵌入式系統(tǒng)的雷達(dá)信號模擬器，能夠完成雷達(dá)中頻和視頻信號、雜波和干擾信號的模擬，實(shí)現(xiàn)雷達(dá)系統(tǒng)在不具備實(shí)際接收前端
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基于FPGA在彈上信息處理機(jī)中的應(yīng)用

  • 引言信息處理機(jī)(圖1)用于完成導(dǎo)彈上多路遙測信息的采集、處理、組包發(fā)送。主要功能包括高速1553B總線的數(shù)據(jù)收發(fā) 、422接口設(shè)備的數(shù)據(jù)加載與檢測、多路數(shù)據(jù)融合和數(shù)據(jù)接收、處理、組包發(fā)送的功能。其中，總線數(shù)據(jù)和其
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基于Spartan-3 FPGA的視頻采集系統(tǒng)設(shè)計

  • 引言視頻采集的主流實(shí)現(xiàn)方案有兩種：一是基于ASIC，該方案一般采用意法、AMD等公司的專用視頻處理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信號處理器。它們作為輔處理器，可在主CPU控制下進(jìn)行視頻信號的采集壓
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基于FPGA的通信接口模塊設(shè)計與實(shí)現(xiàn)

  • 摘要 針對前端射頻及信號處理部分與中心機(jī)需要進(jìn)行遠(yuǎn)程通信的需要，設(shè)計了一款由FPGA實(shí)現(xiàn)的通信接口模塊。該模塊實(shí)現(xiàn)了射頻及信號處理部分與中心機(jī)的通信，包括中心機(jī)發(fā)給前端受控模塊的控制命令；前端受控模塊發(fā)送給
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基于FPGA的IRIG-B編碼器的設(shè)計

  • 我國靶場測量、工業(yè)控制、電力系統(tǒng)測量與保護(hù)、計算、通信、氣象等測試設(shè)備均采用國際標(biāo)準(zhǔn)IRIG-B格式的時間碼(簡稱B碼)作為時間同步標(biāo)準(zhǔn)。B碼是一種串行的時間格式，分為直流碼(DC碼)和交流碼(AC碼)兩種，其格式和碼
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基于FPGA的可復(fù)用通信接口設(shè)計

  • 摘要：集成電路設(shè)計越來越向系統(tǒng)級的方向發(fā)展，解決模塊間的接口問題顯得尤為重要。 SPI 串行總線是一種常用的標(biāo)準(zhǔn)接口，其使用簡單方便而且占用系統(tǒng)資源少，應(yīng)用相當(dāng)廣泛。 本文將介紹一種新的通用的SPI 總線的FPGA
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