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通過智能電機控制優(yōu)化實時性能與效率

  • ??????? 摘要：本文介紹了高級電機的類型及利弊，并介紹了集成型電機控制方案。 　　關(guān)鍵詞：智能;電機控制;MCU;集成型 　　數(shù)十年來，大多數(shù)電機控制應(yīng)用都依賴于可為其實現(xiàn)低成本與實施簡便性的通用有刷 DC 與步進(jìn)電機。不過，隨著微處理器 (MCU) 架構(gòu)的不斷創(chuàng)新與集成度的不斷提高，當(dāng)今開發(fā)人員能夠采用更先進(jìn)與更智能的電機類型與控制機制，以極低的成本提高電機的精度、性能、電源效率和使用一系列狀態(tài)簡化控制復(fù)雜性。所支持的狀態(tài)越
  • 關(guān)鍵字： TI  電機控制  MCU  

FPGA控制下面陣CCD時序發(fā)生器設(shè)計及硬件實現(xiàn)

  • 摘要 在分析Sony公司ICX098BQ面陣CCD圖像傳感器驅(qū)動時序的基礎(chǔ)上，對可調(diào)節(jié)曝光時間的CCD時序發(fā)生器及其硬件電路進(jìn)行設(shè)計。選用FPGA器件作為硬件設(shè)計平臺，使用VHDL語言對時序關(guān)系進(jìn)行了硬件描述。采用QuartusII 8.0
  • 關(guān)鍵字： FPGA  CCD  面陣  發(fā)生器    

符合中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中的HDLC協(xié)議的FPGA設(shè)計與實現(xiàn)

  • 隨著通信與網(wǎng)絡(luò)技術(shù)的不斷發(fā)展，使我國用現(xiàn)有的E1資源來傳輸以太網(wǎng)業(yè)務(wù)成為廣泛的應(yīng)用。以太網(wǎng)數(shù)據(jù)要通過E1線路傳輸就必須對以太網(wǎng)凈荷數(shù)據(jù)進(jìn)行幀封裝，才能從E1線路上恢復(fù)出以太網(wǎng)數(shù)據(jù)幀，完成以太網(wǎng)數(shù)據(jù)的交換。通常，以太網(wǎng)數(shù)據(jù)是通過HDLC協(xié)議或GFP協(xié)議來進(jìn)行封裝的。本文介紹了中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中以太網(wǎng)到單路E1轉(zhuǎn)換器HDLC協(xié)議封裝的FPGA（現(xiàn)場可編程邏輯陣列）設(shè)計與實現(xiàn)。
  • 關(guān)鍵字： 中國移動  FPGA  201106  

AVR單片機集成CAN總線控制器分析與應(yīng)用

  • CAN總線應(yīng)用中，總線節(jié)點是CAN總線的基本組成部分。CAN總線節(jié)點有兩種典型設(shè)計方法，第一種方法采用MCU結(jié)合獨立CAN控制器組成總線節(jié)點[1]；第二種方法采用獨立的MCU，這時MCU需要內(nèi)部集成CAN控制器。由于第二種設(shè)計方法所用的器件少，電路關(guān)系簡單，已得到廣泛應(yīng)用。本文重點分析AVR系列單片機內(nèi)部集成的CAN控制器及其應(yīng)用方法。
  • 關(guān)鍵字： AVR  MCU  CAN  201106  

我國嵌入式系統(tǒng)/MCU市場與技術(shù)發(fā)展探析

  • 據(jù)賽迪顧問業(yè)務(wù)群組研究總監(jiān)宋宇介紹，在2009年我國MCU(微控制器，單片機)市場經(jīng)歷了近年來的首次負(fù)增長后，2010年中國MCU市場呈現(xiàn)爆發(fā)性恢復(fù)增長，無論是銷量還是銷售額增長都遠(yuǎn)遠(yuǎn)超過前幾年的平均水平，市場恢復(fù)的速度和幅度都明顯超出了業(yè)界的普遍預(yù)期。
  • 關(guān)鍵字： 嵌入式  MCU  201106  

基于FPGA的NAND Flash ECC校驗

  • 摘要 基于Flash存儲器的Hamming編碼原理，在Altera QuartusⅡ7．0開發(fā)環(huán)境下，實現(xiàn)ECC校驗功能。測試結(jié)果表明，該程序可實現(xiàn)每256 Byte數(shù)據(jù)生成3 Byte的ECC校驗數(shù)據(jù)，能夠檢測出1 bit錯誤和2 bit錯誤，對于1 bit錯誤
  • 關(guān)鍵字： Flash  FPGA  NAND  ECC    

8位RISC MCU IP軟核仿真的新方法

  • 8位RISC MCU IP軟核仿真的新方法,　本文提出的建立虛擬指令存儲器模塊對MCU IP核仿真的方案和自動生成指令測試文件的方法，大大提高了MCU IP核仿真和驗證的效率。此方法不僅對本文中MCU IP核的仿真和驗證有效，也可用于同類中其它IP核的仿真和驗證。例如當(dāng)對MCU進(jìn)行升級設(shè)計、擴展尋址范圍或指令寬度時，只要修改仿真文件和轉(zhuǎn)化程序的相關(guān)參數(shù)即可。
  • 關(guān)鍵字： 真的  方法  軟核  IP  RISC  MCU  8位  

一種基于ARM 的FPGA可重構(gòu)配置方法的實現(xiàn)及應(yīng)用

  • 隨著半導(dǎo)體工藝技術(shù)的迅猛發(fā)展，現(xiàn)場可編程邏輯器件FPGA的集成度迅速提高，已達(dá)到百萬門量級，與此同時，F(xiàn)PGA中的邏 ...
  • 關(guān)鍵字： ARM  FPGA  加載配置  

IIR數(shù)字濾波器的Matlab和FPGA實現(xiàn)

  • 摘要：提出一種通過兩個二階節(jié)級聯(lián)構(gòu)成四階IIR數(shù)字橢圓濾波器的設(shè)計方法，并利用Matlab仿真軟件設(shè)計了通帶內(nèi)波紋不大于0．1 dB，阻帶衰減不小于42 dB的IIR數(shù)字濾波器。論述了一種采用可編程邏輯器件，通過VHDL硬件描
  • 關(guān)鍵字： Matlab  FPGA  IIR  數(shù)字濾波器    

FPGA時鐘設(shè)計

  • 摘要：在FPGA設(shè)計中，為了成功地操作，可靠的時鐘是非常關(guān)鍵的。設(shè)計不良的時鐘在極限的溫度、電壓下將導(dǎo)致錯誤的行為。在設(shè)計PLD／FPGA時通常采用如下四種類型時鐘：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。
  • 關(guān)鍵字： FPGA  時鐘設(shè)計    

基于FPGA的自適應(yīng)波束形成算法實現(xiàn)

  • 　1 引 言　　在雷達(dá)及聲納信號處理系統(tǒng)中，波束形成算法通常采用DSP軟件編程實現(xiàn)，控制邏輯電路采用CPLD來完成，這種方法具有軟件編程靈活、功能易于擴展的優(yōu)點，但對于實時性能要求很高的系統(tǒng)，如雷達(dá)、聲納探測和
  • 關(guān)鍵字： FPGA  自適應(yīng)波束  算法    

基于FPGA的實時中值濾波器硬件實現(xiàn)

  • 針對高清圖像在中值濾波預(yù)處理過程中排序量多、速度慢的特點，提出適合鄰域圖像并行處理機的分塊存儲方法。在流水線結(jié)構(gòu)下，1個時鐘周期可以并行處理32個3×3鄰域的中值濾波運算，實現(xiàn)了高速、實時的1 920×1 080灰度圖像中值濾波器。
  • 關(guān)鍵字： FPGA  中值濾波  硬件實現(xiàn)    

基于FPGA的多路數(shù)字信號復(fù)分接器的設(shè)計

  • 在現(xiàn)代數(shù)字通信中，對數(shù)據(jù)傳輸容量和傳輸效率的要求越來越高，因此經(jīng)常依據(jù)時分復(fù)用[1]的原理通過數(shù)字復(fù)接與分...
  • 關(guān)鍵字： 數(shù)字復(fù)接技術(shù)  FPGA  時分復(fù)用  

萊迪思宣布首個符合PCI Express 2.0規(guī)范的低成本FPGA

  • 　　萊迪思半導(dǎo)體公司日前宣布LatticeECP3TMFPGA系列符合PCI Express 2.0在2.5Gbps的規(guī)范。針對最近PCI – SIG研討會上涉及的1-通道和 4-通道配置，LatticeECP3 FPGA和其PCI Express(PCIe)IP核通過了符合PCI - SIGPCIe 2.0規(guī)范和互操作性的測試，確保萊迪思的解決方案與現(xiàn)有的支持系統(tǒng)的PCIe 2.0具有互操作性。
  • 關(guān)鍵字： 萊迪思  FPGA  

瑞薩將為全國賽選手提供特別獎與紀(jì)念獎

  • 　　日前，作為“2011全國大學(xué)生電子設(shè)計競賽”惟一冠名贊助商，瑞薩電子公司表示將通過更多方式大力支持參加競賽的隊員，幫助他們順利完成自己的參賽作品，發(fā)揮其創(chuàng)新能力。瑞薩電子非常歡迎各參賽隊瑞薩電子開發(fā)板及瑞薩MCU作為輔助開發(fā)平臺，同時提供資深技術(shù)工程師的技術(shù)指導(dǎo)。 　　
  • 關(guān)鍵字： 瑞薩  開發(fā)板  MCU  
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