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給C語言(主要是單片機(jī)的C)的初學(xué)者門的一點(diǎn)點(diǎn)參考

軟件工具可立刻解決MCU的引腳沖突

基于PCI接口芯片外擴(kuò)FIFO的FPGA實(shí)現(xiàn)

基于FPGA的MIII總線與RS422通信協(xié)議轉(zhuǎn)換板的設(shè)計(jì)

FPGA設(shè)計(jì)工具淺談

FPGA硬件電路的調(diào)試

六款全新32位PIC32MX5/6/7單片機(jī)（Microchip）

低成本浮點(diǎn)Piccolo MCU推動低能耗實(shí)時(shí)控制應(yīng)用發(fā)展

Picochip將在一個USB適配器上實(shí)現(xiàn)完整的3G基站

LTE/HSPA+雙模方案（Picochip）

Picochip 與Wavesat在LTE互聯(lián)互通測試中實(shí)現(xiàn)突破

FIR濾波器的FPGA實(shí)現(xiàn)方法

  • 為了給實(shí)際應(yīng)用中選擇合適FIR濾波器的FPGA實(shí)現(xiàn)結(jié)構(gòu)提供參考，首先從FIR數(shù)字濾波器的基本原理出發(fā)，分析了FIR濾波器的結(jié)構(gòu)特點(diǎn)，然后分別介紹了基于FPGA的FIR濾波器的串行、并行、轉(zhuǎn)置型、FFT型和分布式結(jié)構(gòu)型的實(shí)現(xiàn)方法，對于各種實(shí)現(xiàn)的結(jié)構(gòu)做了分析、比較以及優(yōu)化處理，特別是對基于FFT的FIR濾波器與傳統(tǒng)卷積結(jié)構(gòu)進(jìn)行了精確的數(shù)值計(jì)算比較，最后得出滿足于低階或高階的各種FIR濾波器實(shí)現(xiàn)結(jié)構(gòu)的適用范圍及其優(yōu)缺點(diǎn)，并針對實(shí)際工程應(yīng)用提出了下一步需解決的問題。
  • 關(guān)鍵字： FPGA  FIR  濾波器  實(shí)現(xiàn)方法    

基于FPGA的24×24位低功耗乘法器的設(shè)計(jì)

  • 通過對現(xiàn)有編碼算法的改進(jìn)，提出一種新的編碼算法，它降低功耗的方法是通過減少部分積的數(shù)量來實(shí)現(xiàn)的。因?yàn)槌朔ㄆ鞯倪\(yùn)算主要是部分積的相加，因此，減少部分積的數(shù)量可以降低乘法器中加法器的數(shù)量，從而實(shí)現(xiàn)功耗的減低。在部分積的累加過程中．又對用到的傳統(tǒng)全加器和半加器進(jìn)行了必要的改進(jìn)，避免了CMOS輸入信號不必要的翻轉(zhuǎn)，從而降低了乘法器的動態(tài)功耗。通過在Altera公司的FPGA芯片EP2CTOF896C中進(jìn)行功耗測試，給出了測試結(jié)果，并與現(xiàn)有的兩種編碼算法進(jìn)行了比較。功耗分別降低3．5％和8．4％。
  • 關(guān)鍵字： FPGA  24位  低功耗  乘法器    

基于FPGA的多時(shí)鐘片上網(wǎng)絡(luò)設(shè)計(jì)

  • 本文介紹了一個基于FPGA 的高效率多時(shí)鐘的虛擬直通路由器，通過優(yōu)化中央仲裁器和交叉點(diǎn)矩陣，以爭取較小面積和更高的性能。同時(shí)，擴(kuò)展路由器運(yùn)作在獨(dú)立頻率的多時(shí)鐘NoC 架構(gòu)中，并在一個3×3Mesh 的架構(gòu)下實(shí)驗(yàn)，分析其性能特點(diǎn)，比較得出多時(shí)鐘片上網(wǎng)絡(luò)具有更高的性能。
  • 關(guān)鍵字： FPGA  多時(shí)鐘  片上網(wǎng)絡(luò)    
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