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基于SOPC的視頻采集系統(tǒng)設(shè)計(jì)

　　0 引言　　視頻采集的主流實(shí)現(xiàn)方案有兩種：一是基于ASIC，該方案一般采用意法、AMD等公司的專用視頻處理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信號(hào)處理器。它們作為輔處理器，可在主CPU控制下進(jìn)行視頻信號(hào)的采集壓縮。隨著FPGA的發(fā)展，通過(guò)SOPC技術(shù)實(shí)現(xiàn)視頻采集已成為一種易于開(kāi)發(fā)、設(shè)計(jì)靈活的方案。而這主要得益于IP復(fù)用技術(shù)的發(fā)展。在FPGA上構(gòu)建復(fù)雜嵌入式系統(tǒng)可利用既有的功能模塊及其驅(qū)動(dòng)程序。該方案具有更大的集成度和靈活性，因而必將成為電子設(shè)計(jì)發(fā)展的一大趨勢(shì)。　　本文介紹了
關(guān)鍵字： SOPC 視頻采集 DSP ASIC FPGA

基于FPGA電火花加工脈沖電源的設(shè)計(jì)

　　0引言　　數(shù)控電火花(electrical discharge machining，EDM)機(jī)床是一種實(shí)現(xiàn)工件精密加工的特種加工工具。早期的電火花成型加工機(jī)床的脈沖電源電路是用分立元件組成，或者是用單片機(jī)來(lái)實(shí)現(xiàn)。分立元件電路設(shè)計(jì)復(fù)雜，電路調(diào)試?yán)щy，基于單片機(jī)或者是32位的嵌入式CPU的脈沖電源性能有了很大的提高，也具有了很高的智能性，但對(duì)于不同的處理器，其移植性不太好，而且如果硬件電路一旦完成就不能進(jìn)行更改與升級(jí)。而采用現(xiàn)場(chǎng)可編程門陣列FPGA在很好的繼承單片機(jī)或者是嵌入式CPU設(shè)計(jì)的電源的優(yōu)點(diǎn)
關(guān)鍵字： FPGA 脈沖電源 EDM 數(shù)控機(jī)床嵌入式

利用視頻套件加速FPGA上的視頻開(kāi)發(fā)

　　隨著下一代視頻壓縮標(biāo)準(zhǔn)問(wèn)世，行業(yè)從基本視頻處理向更復(fù)雜的集成處理解決方案轉(zhuǎn)移，這使得系統(tǒng)的要求超越了獨(dú)立DSP力所能及的視頻性能。FPGA以不到30美元的價(jià)格提供20GMACs以上的DSP性能，從而為成本敏感型軍事、汽車、醫(yī)療、消費(fèi)、工業(yè)和安全應(yīng)用填補(bǔ)了這一空白。只有FPGA能夠?yàn)檎锥藢?duì)端視頻解決方案提供邏輯、嵌入式處理、OS支持和驅(qū)動(dòng)器。　　妨礙開(kāi)發(fā)人員將FPGA用于視頻應(yīng)用的因素并非他們?nèi)狈?duì)FPGA性能優(yōu)勢(shì)的了解，而是缺乏使用其設(shè)計(jì)流程的經(jīng)驗(yàn)，對(duì)于那些習(xí)慣于用C語(yǔ)言編程的傳統(tǒng)DSP程序開(kāi)發(fā)
關(guān)鍵字： FPGA 視頻套件 VSK Simulink

一種基于FPGA控制全彩大屏幕顯示的設(shè)計(jì)(圖)

目前的DVI接口分為兩種，一個(gè)是DVI-D接口，只能接收數(shù)字信號(hào)，接口上只有3排8列共24個(gè)針腳，其中右上角的一個(gè)針腳為...
關(guān)鍵字： FPGA 接口芯片 DVI 聯(lián)機(jī)控制圖像數(shù)據(jù) gamma校正 D-Sub End-user 控制原理

瑞薩助陣2008機(jī)器人世界杯賽

　　2008年7月14日-20日，由RoboCup國(guó)際聯(lián)合會(huì)主辦，蘇州市人民政府和中國(guó)科學(xué)技術(shù)大學(xué)聯(lián)合承辦的“2008機(jī)器人世界杯賽”在蘇州國(guó)際博覽會(huì)舉辦，這將是RoboCup世界杯賽首次在中國(guó)舉辦，大約450支隊(duì)伍2500多名參賽者及學(xué)者參加了比賽和學(xué)術(shù)研討會(huì)。此次瑞薩以贊助者的身份加盟了此次盛會(huì)，為這些可愛(ài)的機(jī)器人提供“芯”動(dòng)力。在RoboCup世界杯賽所有項(xiàng)目中，RoboCup足球世界杯賽觀賞性極強(qiáng)，其特殊的魅力讓機(jī)器人足球風(fēng)靡全球。據(jù)悉，RoboCu
關(guān)鍵字：瑞薩機(jī)器人 MCU

基于DSP的圖象采集與處理系統(tǒng)的設(shè)計(jì)

　　0 引言　　圖像處理系統(tǒng)的一個(gè)關(guān)鍵問(wèn)題就是數(shù)據(jù)量龐大，數(shù)據(jù)處理相關(guān)性高，實(shí)時(shí)實(shí)現(xiàn)比較困難。即使采用高速單片機(jī)也無(wú)法滿足實(shí)時(shí)處理的需求，而DSP芯片則具有速度快，信號(hào)處理功能強(qiáng)大，實(shí)時(shí)性好等特點(diǎn)，因此，將DSP用于圖像處理可使這一難題得到較好的解決。　　1 系統(tǒng)構(gòu)成　　本系統(tǒng)采用基于CameraLink接口的圖像輸出相機(jī)。DSP采用TI的TMS320C6711，這是一種高性能DSP處理器，其工作頻率為150 MHz，最大處理能力高達(dá)900MFLOps，該DSP既可滿足高速處理要求，又可滿足高
關(guān)鍵字： DSP 圖象采集與處理 Camera Link USB FPGA

2008年嵌入式設(shè)計(jì)調(diào)查結(jié)果：工程師很辛苦

　　Tech Insights/Embedded Systems Design 2008年嵌入式市場(chǎng)調(diào)研報(bào)告表明，嵌入式系統(tǒng)設(shè)計(jì)人員在2008年要參與更多項(xiàng)目的開(kāi)發(fā)，按期完成開(kāi)發(fā)任務(wù)是他們最大的問(wèn)題，有一半以上（大于50%）的開(kāi)發(fā)項(xiàng)目不能按期完成。? 　　調(diào)查結(jié)果表明：自2005年以來(lái)，2008年新項(xiàng)目對(duì)應(yīng)項(xiàng)目改進(jìn)的比例是這幾年中最高的。在所有開(kāi)發(fā)項(xiàng)目中，新開(kāi)發(fā)項(xiàng)目占46%，剩余54%為以往開(kāi)發(fā)項(xiàng)目的升級(jí)和改進(jìn)。項(xiàng)目的改進(jìn)和升級(jí)主要是針對(duì)新的軟件特性（占81%），或因采用了新處理器（55%），
關(guān)鍵字：嵌入式設(shè)計(jì) 工程師商用OS 定制OS FPGA DSP MCU

一種機(jī)器人視覺(jué)系統(tǒng)模塊的設(shè)計(jì)

　　一、概述　　視覺(jué)技術(shù)是近幾十年來(lái)發(fā)展的一門新興技術(shù)。機(jī)器視覺(jué)可以代替人類的視覺(jué)從事檢驗(yàn)、目標(biāo)跟蹤、機(jī)器人導(dǎo)向等方面的工作，特別是在那些需要重復(fù)、迅速的從圖象中獲取精確信息的場(chǎng)合。盡管在目前硬件和軟件技術(shù)條件下，機(jī)器視覺(jué)功能還處于初級(jí)水平，但其潛在的應(yīng)用價(jià)值引起了世界各國(guó)的高度重視，發(fā)達(dá)國(guó)家如美國(guó)、日本、德國(guó)、法國(guó)等都投入了大量的人力物力進(jìn)行研究，近年來(lái)已經(jīng)在機(jī)器視覺(jué)的某些方面獲得了突破性的進(jìn)展，機(jī)器視覺(jué)在車輛安全技術(shù)、自動(dòng)化技術(shù)等應(yīng)用中也越來(lái)越顯示出其重要價(jià)值。本文根據(jù)最新的CMOS圖像采集芯片設(shè)
關(guān)鍵字：機(jī)器人機(jī)器視覺(jué) CMOS 圖像傳感器 FPGA

采用C8051F020設(shè)計(jì)的嵌入式測(cè)試儀

　　0 引言　　隨著測(cè)控技術(shù)的不斷發(fā)展，將嵌入式操作系統(tǒng)應(yīng)用到測(cè)控領(lǐng)域，從而實(shí)現(xiàn)在線實(shí)時(shí)測(cè)試已經(jīng)成為一種發(fā)展趨勢(shì)，而且越來(lái)越多的工業(yè)現(xiàn)場(chǎng)對(duì)各種測(cè)試儀器的需求不斷增高，希望測(cè)試儀器能夠向在線實(shí)時(shí)測(cè)試方向發(fā)展?；谶@些需求，本文給出了基于C8051F020控制的測(cè)試儀鍵盤顯示部分的設(shè)計(jì)方案。在整個(gè)嵌入式測(cè)試系統(tǒng)中，本部分只是作為下位機(jī)，并通過(guò)RS485總線接口與上位機(jī)進(jìn)行通信，從而將接收到的測(cè)試數(shù)據(jù)根據(jù)控制命令的要求在顯示器中予以顯示，同時(shí)將測(cè)試人員發(fā)送的各類請(qǐng)求信號(hào)回送給上位機(jī)以對(duì)測(cè)試數(shù)據(jù)進(jìn)行一定的處理
關(guān)鍵字：嵌入式測(cè)試 MCU 測(cè)控 LCD

分布式數(shù)據(jù)采集系統(tǒng)中的時(shí)鐘同步

　　引言　　隨著網(wǎng)絡(luò)技術(shù)的發(fā)展，各種分布式的網(wǎng)絡(luò)和局域網(wǎng)都得到了廣泛的應(yīng)用[1]。分布式數(shù)據(jù)采集系統(tǒng)廣泛應(yīng)用于船舶、飛機(jī)等采集數(shù)據(jù)多、實(shí)時(shí)性要求較高的地方。同步采集是這類分布式數(shù)據(jù)采集系統(tǒng)的一個(gè)重要要求，數(shù)據(jù)采集的實(shí)時(shí)性、準(zhǔn)確性和系統(tǒng)的高效性都要求系統(tǒng)能進(jìn)行實(shí)時(shí)數(shù)據(jù)通信。因此，分布式數(shù)據(jù)采集系統(tǒng)中的一個(gè)關(guān)鍵技術(shù)就是實(shí)現(xiàn)數(shù)據(jù)的同步傳輸。　　由于產(chǎn)生時(shí)鐘的晶振具有頻率漂移的特性，故對(duì)于具有多個(gè)采集終端的分布式系統(tǒng)，如果僅僅在系統(tǒng)啟動(dòng)時(shí)進(jìn)行一次同步，數(shù)據(jù)的同步傳輸將會(huì)隨著系統(tǒng)運(yùn)行時(shí)間的增長(zhǎng)而失步。因此時(shí)
關(guān)鍵字：數(shù)據(jù)采集分布式時(shí)鐘同步 FPGA

TI推出免費(fèi)ZigBee?2007與ZigBee 2007 PRO協(xié)議軟件

　　日前，德州儀器 (TI) 宣布推出業(yè)界領(lǐng)先的 ZigBee 認(rèn)證 Z-Stack 軟件的最新版（可通過(guò) http://focus.ti.com.cn/cn/docs/toolsw/folders/print/z-stack.html 免費(fèi)下載），此舉進(jìn)一步加強(qiáng)了其在 ZigBee 軟硬件系列解決方案領(lǐng)域的領(lǐng)先地位。Z-Stack 2.1.0 軟件全面支持ZigBee 與 ZigBee PRO 特性集并符合最新智能能源規(guī)范，非常適用于高級(jí)電表架構(gòu) (AMI)。　　Z-Stack 2.1.0 軟件可與
關(guān)鍵字： TI ZigBee Z-Stack MCU

ATM流量控制器IP核的設(shè)計(jì)和實(shí)現(xiàn)

　　0 引言　　ATM異步傳遞方式是建立在電路交換和分組交換基礎(chǔ)上的一種面向連接的快速分組交換技術(shù)，它采用定長(zhǎng)分組作為傳輸和交換的單位，并具有端到端QOS保證、完善的流量控制和擁塞控制，以及較好的技術(shù)綜合能力等優(yōu)勢(shì)，這些都是目前的IP技術(shù)所不及的。和傳統(tǒng)的STM電路相比，ATM技術(shù)對(duì)數(shù)據(jù)交換中猝發(fā)分組的適應(yīng)能力和傳輸線路的利用率都是很高的。雖然，由于靈活性和價(jià)格的原因，ATM技術(shù)沒(méi)有獲得預(yù)期的成功，但其流量控制機(jī)制對(duì)當(dāng)前變長(zhǎng)分組骨干網(wǎng)的流量控制還是具有重要的參考價(jià)值，所以有必要對(duì)ATM的流量控制及其實(shí)
關(guān)鍵字： IP核 ATM 流量控制器 CPLD FPGA

基于電源芯片VB409的無(wú)變壓器供電電源設(shè)計(jì)

　　在小型的MCU應(yīng)用系統(tǒng)中，采用AC 220V供電時(shí)，一般要使用變壓器對(duì)電源進(jìn)行處理，將高壓交流電降到低壓后再進(jìn)行直流處理，或者將交流電變?yōu)楦邏褐绷麟姾笤龠M(jìn)行高頻變換，以得到MCU系統(tǒng)的工作電源。這對(duì)于結(jié)構(gòu)沒(méi)有特殊要求的系統(tǒng)，在設(shè)計(jì)上屬于常規(guī)的問(wèn)題，使用上述的線性電源技術(shù)或者開(kāi)關(guān)電源技術(shù)，均能得到方便的解決。但是有些MCU應(yīng)用系統(tǒng)在體積上要求極其小巧，甚至不能安放變壓器，所以常規(guī)的電源處理就不能滿足其要求了。因此，使用能夠直接接收高壓交流電并將其直接變換成低壓直流的技術(shù)，是最佳的設(shè)計(jì)選擇。VB409的出
關(guān)鍵字：電源芯片供電電源變壓器 MCU

基于FPGA的通信系統(tǒng)基帶驗(yàn)證平臺(tái)的設(shè)計(jì)

　　1 引言　　在通信領(lǐng)域尤其是無(wú)線通信方面，隨著技術(shù)不斷更新和新標(biāo)準(zhǔn)的發(fā)布，設(shè)計(jì)者需要一個(gè)高速通用硬件平臺(tái)來(lái)實(shí)現(xiàn)并驗(yàn)證自己的通信系統(tǒng)和相關(guān)算法。FPGA(現(xiàn)場(chǎng)可編程門陣列)作為一種大規(guī)模可編程邏輯器件，體系結(jié)構(gòu)和邏輯單元靈活、集成度高、適用范圍寬，并且設(shè)計(jì)開(kāi)發(fā)周期短、設(shè)計(jì)制造成本低、開(kāi)發(fā)工具先進(jìn)并可實(shí)時(shí)在線檢驗(yàn)，廣泛應(yīng)用于產(chǎn)品的原型設(shè)計(jì)和產(chǎn)品生產(chǎn)。　　與傳統(tǒng)的DSP(數(shù)字信號(hào)處理器)或GPP(通用處理器)相比，F(xiàn)PGA在某些信號(hào)處理任務(wù)中表現(xiàn)出非常強(qiáng)的性能，具有高吞吐率、架構(gòu)和算法靈活、并行計(jì)
關(guān)鍵字： FPGA 通信基帶驗(yàn)證 DSP GPP

AES算法的快速硬件設(shè)計(jì)與實(shí)現(xiàn)

　　信息安全是計(jì)算機(jī)科學(xué)技術(shù)的熱點(diǎn)研究領(lǐng)域，數(shù)據(jù)加密則是信息安全的重要手段。隨著可編程技術(shù)的飛速發(fā)展及高速集成電路的不斷出現(xiàn)，采用FPGA實(shí)現(xiàn)加密算法已受到越來(lái)越廣泛的關(guān)注和重視[1][2]。與傳統(tǒng)的軟件加密方法相比，硬件加密的優(yōu)點(diǎn)是：(1)安全性好，不易被攻擊；(2)計(jì)算速度快，效率高；(3)成本低，性能可靠。加密系統(tǒng)中體現(xiàn)數(shù)據(jù)傳輸速度的一個(gè)重要性能指標(biāo)是數(shù)據(jù)吞吐量，計(jì)算公式為：(數(shù)據(jù)長(zhǎng)度M/時(shí)鐘個(gè)數(shù)N)×時(shí)鐘頻率F。提高數(shù)據(jù)吞吐量是改善加密系統(tǒng)性能的關(guān)鍵，也是加密算法硬件實(shí)現(xiàn)技術(shù)的重要內(nèi)容
關(guān)鍵字： FPGA AES 信息安全數(shù)據(jù)加密