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采用FPGA的可編程電壓源系統(tǒng)原理及設(shè)計(jì)

  • 采用FPGA的可編程電壓源系統(tǒng)原理及設(shè)計(jì),概述：介紹一種基于FPGA的可編程電壓源系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)。采用FPGA為控制芯片，應(yīng)用QuartusⅡ軟件和硬件描述語言為工具，通過數(shù)／模轉(zhuǎn)換和運(yùn)放把數(shù)字信號(hào)轉(zhuǎn)換成模擬電壓信號(hào)。實(shí)驗(yàn)表明，該系統(tǒng)操作靈活方便，穩(wěn)定性強(qiáng)
  • 關(guān)鍵字： 原理  設(shè)計(jì)  系統(tǒng)  電壓  FPGA  可編程  采用  

基于EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法

  • 基于EDA仿真技術(shù)解決FPGA設(shè)計(jì)開發(fā)中故障的方法,　FPGA近年來在越來越多的領(lǐng)域中應(yīng)用，很多大通信系統(tǒng)（如通信基站等）都用其做核心數(shù)據(jù)的處理。但是過長的編譯時(shí)間，在研發(fā)過程中使得解決故障的環(huán)節(jié)非常令人頭痛。本文介紹的就是一種用仿真方法解決故障從而減少研
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采用FPGA技術(shù)的智能導(dǎo)盲犬設(shè)計(jì)方案

  • 采用FPGA技術(shù)的智能導(dǎo)盲犬設(shè)計(jì)方案,眾所周知眼晴是“心靈之窗”，而對于突然失去或從未擁有過“心靈之窗”的盲人來說，生活上的困難與心理上的痛苦是可想而知的。他們的衣食住行存在諸多不便，而在出行與人際交往中遇到的困難更加突出，基于此設(shè)計(jì)了智
  • 關(guān)鍵字： 設(shè)計(jì)  方案  智能  技術(shù)  FPGA  采用  

采用CPLD/FPGA的VHDL語言電路優(yōu)化原理設(shè)計(jì)

  • 采用CPLD/FPGA的VHDL語言電路優(yōu)化原理設(shè)計(jì),VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來的。它是一種面向設(shè)計(jì)、多層次的硬件描述語言，是集行為描述、RTL
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高清晰LCD HDTV中使用Cyclone III FPGA技術(shù)

  • 高清晰LCD HDTV中使用Cyclone III FPGA技術(shù),當(dāng)今的液晶顯示(LCD) 技術(shù)在高清晰電視(HDTV) 領(lǐng)域得到了廣泛應(yīng)用，其挑戰(zhàn)在于如何獲得更高的分辨率，實(shí)現(xiàn)更快的數(shù)據(jù)速率。提高數(shù)據(jù)速率需要專業(yè)圖像處理算法來支持快速移動(dòng)的視頻。業(yè)界遇到的主要問題是：怎樣實(shí)現(xiàn)這
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基于FPGA快速A 律壓縮編碼的設(shè)計(jì)與實(shí)現(xiàn)

  • 摘要:本文針對A律13折線法的算法特點(diǎn)，提出一種并行數(shù)據(jù)處理算法，實(shí)現(xiàn)了編碼的流水線操作。運(yùn)用VHDL語言將其在FPGA中實(shí)現(xiàn)，借助quartus II6.0平臺(tái)進(jìn)行驗(yàn)證，并對驗(yàn)證結(jié)果進(jìn)行分析，評估了系統(tǒng)的性能，證實(shí)了該算法的
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基于ARM和FPGA的微加速度計(jì)數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

  • 摘要：基于常用的MEMS慣性器件微型加速度計(jì)，介紹一種采用ARM和FPGA架構(gòu)來采集加速度數(shù)值的設(shè)計(jì)方案，微加速度計(jì)的模擬輸出信號(hào)經(jīng)A／D芯片轉(zhuǎn)換后由FPGA進(jìn)行處理和緩存，然后ARM接收FPGA的輸出數(shù)據(jù)并對數(shù)據(jù)進(jìn)行顯示和
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艾科瑞德推出超高速數(shù)據(jù)采集處理平臺(tái)DSPEED-ADC_S4000

  • 　　北京艾科瑞德科技日前宣布，其采用業(yè)界頂級超高速10bit 2GSPS ADC的數(shù)據(jù)采集處理平臺(tái)DSPEED-ADC_S4000正式上市。該平臺(tái)采用兩片10bit 2GSPS ADC完成前端超高速模數(shù)轉(zhuǎn)換，配合兩片Xilinx Virtex-5系列高密度FPGA以及一顆TI高性能定點(diǎn)DSP TMS320C6455作為運(yùn)算核心，集成大容量DDR2、FIFO等高速動(dòng)態(tài)存儲(chǔ)器，可完成諸如數(shù)字下變頻、多級濾波、數(shù)據(jù)抽取、傅立葉變換等各種復(fù)雜的數(shù)字信號(hào)處理應(yīng)用及算法評估。平臺(tái)尺寸為6U cPCI工業(yè)標(biāo)準(zhǔn)，接插件上
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Altera和Apical交付首個(gè)HD WDR FPGA監(jiān)控應(yīng)用解決方案

  • 　　Altera公司和Apical有限公司今天宣布，為視頻監(jiān)控?cái)z像機(jī)提供世界上第一個(gè)高清晰寬動(dòng)態(tài)范圍(WDR) CMOS圖像傳感器處理解決方案。在內(nèi)華達(dá)洲拉斯維加斯3月24號(hào)到26號(hào)舉行的國際安防大會(huì)(ISC)西部博覽會(huì)上，Altera展示了這一解決方案。Altera和Apical全面的解決方案保證了各種照明條件下優(yōu)異的視頻圖像質(zhì)量，而這是前幾代監(jiān)控?cái)z像機(jī)面臨的主要瓶頸問題。結(jié)合Altera的 Cyclone® III和Cyclone IV FPGA以及Apical的知識(shí)產(chǎn)權(quán)(IP)，這一解決方案
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基于FPGA實(shí)現(xiàn)的FFT插值正弦波頻率估計(jì)

  • 摘要：在分析雙線幅度法(Rife)、修正雙線幅度法(MRife)、傅里葉系數(shù)插值迭代3種算法的基礎(chǔ)上，結(jié)合FPGA的并行處理優(yōu)勢，將迭代變?yōu)椴⑿羞\(yùn)算，由此得出了一種快速頻率估計(jì)算法。并將新算法進(jìn)行FPGA設(shè)計(jì)，給出了算法
  • 關(guān)鍵字： FPGA  FFT  插值  正弦波    

USB2．0接口傳輸?shù)腇PGA控制與實(shí)現(xiàn)

  • 摘要：為解決PC與FPAG的高速數(shù)據(jù)傳輸，通過USB實(shí)現(xiàn)了PC和FPGA的通信。介紹了USB接口芯片CY7C68013的基本工作原理；編寫了USB固件程序和應(yīng)用程序；利用從屬FIFO方式，實(shí)現(xiàn)了數(shù)據(jù)的快速讀寫。測試結(jié)果表明，利用FPGA控
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基于IPTV系統(tǒng)中的FPGA供電問題解決方案

  • 目前越來越多的家用電器從低速的撥號(hào)上網(wǎng)向?qū)拵Щヂ?lián)網(wǎng)接入或互聯(lián)網(wǎng)協(xié)議電視(IPTV)轉(zhuǎn)移，尤其是IPTV有望在中國...
  • 關(guān)鍵字： FPGA  IPTV  供電  

基于ARM+FPGA的重構(gòu)控制器設(shè)計(jì)

  • 摘要：為滿足可重配置系統(tǒng)的靈活性要求，介紹了一種“ARM處理器+FPGA”結(jié)構(gòu)的重構(gòu)控制器的設(shè)計(jì)，提出由ARM微處理器通過模擬JTAG接口的FPGA在系統(tǒng)配置目標(biāo)可編程器件的方法。給出系統(tǒng)設(shè)計(jì)的硬件結(jié)構(gòu)，并詳細(xì)介紹了JTA
  • 關(guān)鍵字： 控制器  設(shè)計(jì)  重構(gòu)  FPGA  ARM  基于  

基于FPGA/MCU結(jié)構(gòu)的線性調(diào)頻高度表設(shè)計(jì)

Altera榮膺邁瑞公司“優(yōu)秀供應(yīng)商獎(jiǎng)”

  • 　　Altera公司宣布，公司榮獲深圳邁瑞生物醫(yī)療電子股份有限公司 2009年度“優(yōu)秀供應(yīng)商獎(jiǎng)”，這是過去四年中Altera第三次獲得這一獎(jiǎng)項(xiàng)，這是對Altera為邁瑞持續(xù)優(yōu)異地提供業(yè)界一流的技術(shù)、服務(wù)和支持的認(rèn)可。 　　邁瑞公司供應(yīng)鏈副總裁曾映表示：“Altera與我們有著長期的合作關(guān)系，他們提供領(lǐng)先的技術(shù)以及專業(yè)的服務(wù)和支持，幫助邁瑞不斷創(chuàng)新并贏得市場。我們非常高興授予他們優(yōu)秀供應(yīng)商獎(jiǎng)。” 　　Altera亞太地區(qū)副總裁兼董事總經(jīng)理Erhaan Sh
  • 關(guān)鍵字： Altera  FPGA  
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