rf-fpga 文章進(jìn)入rf-fpga技術(shù)社區(qū)

NS推出全新視頻系統(tǒng)時(shí)鐘電路模塊參考設(shè)計(jì)

　　美國(guó)國(guó)家半導(dǎo)體公司 (National Semiconductor Corporation)宣布推出一款可支持Xilinx ML571 串行數(shù)字視頻系統(tǒng)開(kāi)發(fā)電路板的全新視頻系統(tǒng)時(shí)鐘電路模塊參考設(shè)計(jì)。Xilinx 公司的ML571電路板只要加裝美國(guó)國(guó)家半導(dǎo)體該款時(shí)鐘電路模塊，便可確保內(nèi)置串行/解串器的Virtex -5 LXT FPGA芯片在時(shí)鐘抖動(dòng)方面有更卓越的表現(xiàn)，從而使許多采用FPGA 的視頻系統(tǒng)解決方案易符合電影與電視工程師協(xié)會(huì)(SMPTE)的SMPTE 424M的抖動(dòng)標(biāo)準(zhǔn)。該參考設(shè)計(jì)模塊可以簡(jiǎn)
關(guān)鍵字： NS 視頻時(shí)鐘電路 FPGA

同步數(shù)字復(fù)接的設(shè)計(jì)及其FPGA實(shí)現(xiàn)

摘要：在簡(jiǎn)要介紹同步數(shù)字復(fù)接基本原理的基礎(chǔ)上，采用VHDL語(yǔ)言對(duì)同步數(shù)字復(fù)接各組成模塊進(jìn)行了設(shè)計(jì)，并在ISE集成環(huán)境下進(jìn)行了設(shè)計(jì)描述、綜合、布局布線及時(shí)序仿真，取得了正確的設(shè)計(jì)結(jié)果，同時(shí)利用中小容量的FPGA實(shí)現(xiàn)了同步數(shù)字復(fù)接功能。關(guān)鍵詞：同步數(shù)字復(fù)接/分接 FPGA 位同步幀同步檢測(cè) 　　基群速率數(shù)字信號(hào)的合成設(shè)備和分接設(shè)備是電信網(wǎng)絡(luò)中使用較多的關(guān)鍵設(shè)備，在數(shù)字程控交換機(jī)的用戶模塊、小靈通基站控制器和集團(tuán)電話中都需要使用這種同步數(shù)字復(fù)接設(shè)備。近年來(lái)，隨著需要自建內(nèi)部通信系統(tǒng)的公司和企
關(guān)鍵字： FPGA 同步數(shù)字復(fù)接/分接位同步幀同步檢測(cè)

FPGA的多路可控脈沖延遲系統(tǒng)

摘要采用數(shù)字方法和模擬方法設(shè)計(jì)了一種最大分辨率為0.15 ns級(jí)的多路脈沖延遲系統(tǒng)，可以實(shí)現(xiàn)對(duì)連續(xù)脈沖信號(hào)的高分辨率可控延遲；采用Flash FPGA克服了現(xiàn)有SRAM FPGA系統(tǒng)掉電后程序丟失的缺點(diǎn)，提高了系統(tǒng)反應(yīng)速度。本系統(tǒng)適用于需要將輸入脈沖信號(hào)進(jìn)行精確延遲來(lái)產(chǎn)生測(cè)試或控制用的連續(xù)脈沖信號(hào)場(chǎng)合，具有很強(qiáng)的適用性。關(guān)鍵詞數(shù)字方法模擬方法分辨率脈沖延遲 ProASIC3 　　在科學(xué)研究、通信和一些自動(dòng)控制中，經(jīng)常需要精確定時(shí)的
關(guān)鍵字： FPGA 數(shù)字方法模擬方法分辨率脈沖延遲 ProASIC3

NS模塊確保Xilinx的視頻電路具超低抖動(dòng)時(shí)鐘

2008年9月12日，美國(guó)國(guó)家半導(dǎo)體公司(NationalSemiconductorCorporation)宣布推出一款可支持XilinxML571...
關(guān)鍵字： Xilinx ML571 Virtex-5 LXT FPGA 超低抖動(dòng) 時(shí)鐘

FPGA系統(tǒng)內(nèi)部邏輯在線測(cè)試技術(shù)研究

　　1 引言　　隨著FPGA向低成本、低功耗、高性能方向發(fā)展，其I／O引腳大多采用微間距TOFP或BGA封裝工藝，因而使引出多種內(nèi)部信號(hào)的I／O引腳以及FPGA的驗(yàn)證工作變得非常困難，同時(shí)FPGA的驗(yàn)證和調(diào)試耗時(shí)占總開(kāi)發(fā)時(shí)間的50％以上。　　在驗(yàn)證和調(diào)試系統(tǒng)時(shí)，傳統(tǒng)上是把信號(hào)線引到I／O引腳，然后采用示波器、邏輯分析儀或總線分析儀進(jìn)行測(cè)量和分析。由于這些設(shè)備相當(dāng)昂貴，而且調(diào)試時(shí)又需要許多連線夾，因此一不小心就會(huì)燒壞器件或電路板。　　伴隨著EDA 工具的快速發(fā)展，Altera公司在Quartus
關(guān)鍵字： FPGA I／O EDA QuartusⅡ 存儲(chǔ)

FFT實(shí)時(shí)譜分析系統(tǒng)的FPGA設(shè)計(jì)和實(shí)現(xiàn)

摘要：采用按時(shí)間抽選的基4原位算法和坐標(biāo)旋轉(zhuǎn)數(shù)字式計(jì)算機(jī)(CORDIC)算法實(shí)現(xiàn)了一個(gè)FFT實(shí)時(shí)譜分析系統(tǒng)。整個(gè)設(shè)計(jì)采用流水線工作方式，保證了系統(tǒng)的速度，避免了瓶頸的出現(xiàn)；整個(gè)系統(tǒng)采用FPGA實(shí)現(xiàn)，實(shí)驗(yàn)表明，該系統(tǒng)既有DSP器件實(shí)現(xiàn)的靈活性又有專用 FFT芯片實(shí)現(xiàn)的高速數(shù)據(jù)吞吐能力，可以廣泛地應(yīng)用于數(shù)字信號(hào)處理的各個(gè)領(lǐng)域。關(guān)鍵詞：快速傅里葉變換 CORDIC算法現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA) 　　快速傅里葉變換(Fast Fourier Transformation, FFT) 實(shí)時(shí)譜分析是
關(guān)鍵字： FPGA 快速傅里葉變換 CORDIC算法 FFT

RS編譯碼的一種硬件解決方案

摘要: 提出了基于歐氏算法和頻譜分析相結(jié)合的RS碼硬件編譯碼方法;利用FPGA芯片實(shí)現(xiàn)了GF(28)上最高速率為50Mbps、最大延時(shí)為640ns的流式譯碼方案,滿足了高速率的RS編譯碼需求。關(guān)鍵詞: RS碼 FPGA 伴隨式關(guān)鍵方程 IDFT 　　差錯(cuò)控制編碼技術(shù)對(duì)改善誤碼率、提高通信的可靠性具有重要作用。RS碼既可以糾正隨機(jī)錯(cuò)誤,又可以糾正突發(fā)錯(cuò)誤,具有很強(qiáng)的糾錯(cuò)能力,在通信系統(tǒng)中應(yīng)用廣泛。由于RS碼的譯碼復(fù)雜度高,數(shù)學(xué)運(yùn)算量大,常
關(guān)鍵字： FPGA RS碼伴隨式關(guān)鍵方程 IDFT

虛擬FPGA邏輯驗(yàn)證分析儀的設(shè)計(jì)

　　隨著FPGA技術(shù)的廣泛使用，越來(lái)越需要一臺(tái)能夠測(cè)試驗(yàn)證FPGA芯片中所下載電路邏輯時(shí)序是否正確的儀器。目前，雖然Agilent、Tektronix 等大公司生產(chǎn)的高端邏輯分析儀能夠?qū)崿F(xiàn)FPGA電路的測(cè)試驗(yàn)證功能，但此類儀器價(jià)格高昂，一般要十萬(wàn)、數(shù)十萬(wàn)人民幣。所以，研究開(kāi)發(fā)價(jià)格適中且具有邏輯分析儀和FPGA電路的測(cè)試驗(yàn)證功能的儀器是非常有價(jià)值的。　　本文所介紹的基于虛擬儀器技術(shù)的邏輯驗(yàn)證分析儀，采用FPGA技術(shù)來(lái)實(shí)現(xiàn)儀器硬件部分的主要設(shè)計(jì)，應(yīng)用圖形化編程語(yǔ)言LabVIEW來(lái)實(shí)現(xiàn)儀器的測(cè)試軟件設(shè)計(jì)。文
關(guān)鍵字： FPGA 邏輯分析儀測(cè)試虛擬儀器 LabVIEW

Newtec在衛(wèi)星寬帶終端中選用Altera FPGA

　　在當(dāng)今高速視頻下載和數(shù)據(jù)傳輸環(huán)境中，互聯(lián)網(wǎng)已經(jīng)成為世界上很多家庭的日常工具。該技術(shù)雖然發(fā)展很快，但是歐洲仍有很多農(nóng)村地區(qū)還沒(méi)有寬帶接入——直到現(xiàn)在。Altera公司宣布，Newtec獲得大獎(jiǎng)的Sat3Play寬帶終端采用了Cyclone II FPGA來(lái)提供寬帶服務(wù)。　　Sat3Play寬帶終端是雙向衛(wèi)星系統(tǒng)的組成部分，支持ISP和電信公司在還沒(méi)有實(shí)現(xiàn)低成本寬帶鏈接的地區(qū)提供語(yǔ)音、數(shù)據(jù)和電視服務(wù)。Newtec是衛(wèi)星通信產(chǎn)品和解決方案的世界級(jí)供應(yīng)商，產(chǎn)品包括DVB調(diào)制器、數(shù)字
關(guān)鍵字： FPGA Altera Newtec 寬帶接入

Camera Link協(xié)議和FPGA的數(shù)字圖像信號(hào)源設(shè)計(jì)

　　1 引言　　目前，各種圖像設(shè)備已廣泛應(yīng)用到航空航天、軍事、醫(yī)療等領(lǐng)域。圖像信號(hào)源作為地面圖像采集裝置測(cè)試系統(tǒng)中的一部分，其傳輸方式及信號(hào)精度都是影響系統(tǒng)性能的重要因素。由于圖像信號(hào)的傳輸速率高，數(shù)據(jù)量大，在傳輸過(guò)程中，其精度和傳輸距離易受影響。為了提高信號(hào)傳輸距離和精度設(shè)計(jì)了由FPGA內(nèi)部發(fā)出圖像數(shù)據(jù)，并通過(guò)FPGA進(jìn)行整體時(shí)序控制；輸出接口信號(hào)轉(zhuǎn)換成符合Camera Link標(biāo)準(zhǔn)的低電壓差分信號(hào)(LVDS)進(jìn)行傳輸。該圖像信號(hào)源已成功應(yīng)用于某彈載記錄器的地面測(cè)試臺(tái)系統(tǒng)中。　　2 Camera
關(guān)鍵字： FPGA Camera Link 標(biāo)準(zhǔn) CMOS

Atmel推出399美元的入門(mén)級(jí)開(kāi)發(fā)工具包

　　愛(ài)特梅爾公司（Atmel Corporation）宣布推出 AT91CAP7A-STK入門(mén)級(jí)開(kāi)發(fā)工具包，是專為評(píng)測(cè)其基于ARM7 處理器的CAP 可定制微控制器（MCU）系列而設(shè)的入門(mén)級(jí)工具。CAP7 可定制MCU可讓設(shè)計(jì)人員從 “ARM7加FPGA” 設(shè)計(jì)轉(zhuǎn)移到低一次性研發(fā)費(fèi)用（NRE）的單芯片解決方案，單位器件的成本約降低達(dá) 30%，而且性能提高8倍，靜態(tài)功耗和工作功耗分別減少98% 和70%. 　　CAP7 入門(mén)級(jí)開(kāi)發(fā)工具包僅售399美元，包括一塊配有愛(ài)特梅
關(guān)鍵字： Atmel MCU 開(kāi)發(fā)工具包 ARM7 FPGA

基于S3C2440微處理器的工業(yè)超聲探傷儀設(shè)計(jì)

　　超聲探傷儀廣泛應(yīng)用在航空航天、石油化工、冶金造船等行業(yè)，用于檢測(cè)金屬或非金屬內(nèi)部缺陷以及分析材質(zhì)，是無(wú)損檢測(cè)領(lǐng)域重要的檢測(cè)儀器之一。　　超聲探傷時(shí)，應(yīng)用得最多的是A型顯示，如圖1所示。在A型顯示中，橫坐標(biāo)代表被測(cè)物的深度，縱坐標(biāo)代表回波信號(hào)的幅度。　　目前同內(nèi)生產(chǎn)的數(shù)字式超聲探傷儀仍主要以單片機(jī)為核心，單片機(jī)固有的性能瓶頸制約了儀器的性能指標(biāo)和功能擴(kuò)展，與國(guó)外先進(jìn)水平相比，國(guó)產(chǎn)產(chǎn)品技術(shù)水平仍有較大的差距。　　本文介紹的新型嵌入式數(shù)字超聲探傷儀以32位RISC CPUS3C2440為控制中心
關(guān)鍵字：探傷儀超聲單片機(jī) FPGA Linux 嵌入式

基于循環(huán)前綴ML估計(jì)的同步分析及FPGA實(shí)現(xiàn)

　　引言　　正交頻分復(fù)用(OrthogonalFrequency Division Multiplexing，OFDM)技術(shù)已經(jīng)成為第四代移動(dòng)通信研究的熱點(diǎn)，同時(shí)，OFDM同步又是OFDM的關(guān)鍵技術(shù)，研究OFDM同步技術(shù)的目的就是為了防止碼間干擾和載波干擾。當(dāng)前OFDM同步的算法是根據(jù)OFDM原理提出的基于數(shù)據(jù)符號(hào)方法，它的優(yōu)點(diǎn)是捕獲快、精度高，適合分組數(shù)據(jù)通信，具體的實(shí)現(xiàn)是在分組數(shù)據(jù)包的包頭加一個(gè)專門(mén)用來(lái)做定時(shí)、頻偏的OFDM塊?；跀?shù)據(jù)符號(hào)的算法又可以分為兩類：基于訓(xùn)練符號(hào)(導(dǎo)頻碼)的方法和基于循
關(guān)鍵字： OFDM FPGA DSP I／O

一種高速波控系統(tǒng)的設(shè)計(jì)

　　1 引言　　相控陣是通過(guò)波控系統(tǒng)控制陣列天線各單元通道的相位、幅度以形成空間波束并控制其方位角和俯仰角。早期的波控系統(tǒng)一般采用硬件電路來(lái)實(shí)現(xiàn)，這種實(shí)現(xiàn)方法的缺點(diǎn)是設(shè)備量大，不靈活，很難實(shí)現(xiàn)波束的復(fù)雜計(jì)算，不易滿足特殊要求。后來(lái)采用單片機(jī)、DSP芯片來(lái)設(shè)計(jì)波控系統(tǒng)，單片機(jī)通常不計(jì)算波控碼，僅僅是根據(jù)接收到的波控碼布相，而DSP可以自己計(jì)算波控碼，但是單片機(jī)、DSP都是象流水線一樣串行的運(yùn)行指令，也就是說(shuō)，不能并行地對(duì)各天線單元通道進(jìn)行波控碼計(jì)算和布相。　　針對(duì)波控系統(tǒng)要求高速計(jì)算、多通道并行邏
關(guān)鍵字：以太網(wǎng) 接口天線 FPGA

RF: 究竟能否成為插入式IP？

　　當(dāng)移動(dòng)設(shè)備SoC集成射頻電路時(shí)，它們將需要可重用 RF IP。但是它們能夠做到嗎？　　對(duì)于下一代智能手機(jī)、移動(dòng)視頻播放器以及 Web 漫游附件的整合，其含意不僅是要將多用途基帶與應(yīng)用處理器、加速器和內(nèi)存一起放到同一片 SoC （系統(tǒng)單芯片）上，而且還要將許多小信號(hào)RF電路整合到SoC上。其中就存在一項(xiàng)重大難題。　　在今天的 SoC 中，要想滿足時(shí)間表并維持合理的設(shè)計(jì)復(fù)雜性，硅 IP （知識(shí)產(chǎn)權(quán)）的重用是絕對(duì)必要的。但是，盡管 IP 的重用在數(shù)字行業(yè)人所共知，甚至已經(jīng)成為一些甚高頻模塊的常見(jiàn)現(xiàn)象
關(guān)鍵字： SoC RF 射頻 MIPS