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基于FPGA的MPEG-2復用器中FIFO的一種設計方案

  •  近幾年基于MPEC-2的DVB普通數(shù)字電視在美國、南美、亞洲、大洋洲和非洲通過衛(wèi)星進行廣播?；贛PEG-2／DVB的多路節(jié)目復用器是數(shù)字電視傳輸系統(tǒng)的關鍵設備之一，因此，它的研發(fā)顯得尤為重要。      目前，復用器的設計方案主要基于DSP(數(shù)字信號處理器)的實現(xiàn)技術，這種設計方法在理論上也能實現(xiàn)對傳送流的復用，考慮到實現(xiàn)復用器諸多高速、復雜的邏輯功能，同時，F(xiàn)PGA(現(xiàn)場可編程門陣列)理論上可以無限次地重新配置，這樣在一定程度上為系統(tǒng)的升級或局部功
  • 關鍵字： FPGA  MPEG-2  

基于FPGA的偽碼測距電路的設計與實現(xiàn)

  •     1　引　言 　　現(xiàn)場可編程門陣列（FPGA）用硬件電路完成算法的過程，一方面解決了系統(tǒng)的開銷問題，提供了提高系統(tǒng)整體性能的條件，另一方面，由于靜態(tài)RAM型的FPGA具備可重構特性，這使得資源利用率得到顯著提高。FPGA既具有通用計算系統(tǒng)的靈活性，又有專用處理系統(tǒng)的性能，對實現(xiàn)高性能信號處理具有很高的應用價值，而且可重構的特性使其可以根據(jù)算法來調(diào)整相應的通信結構和數(shù)據(jù)字長。FPGA以其高度的靈活性與硬件的高密度性在通信信號處理中得到了廣泛的應用。 　　在對Xili
  • 關鍵字： 嵌入式系統(tǒng)  單片機  FPGA  偽碼測距  

FPGA創(chuàng)新中心落戶無錫國家集成電路設計基地

  • 可編程解決方案領導廠商賽靈思公司（Xilinx）與無錫國家高新技術產(chǎn)業(yè)開發(fā)區(qū)管理委員會今天共同宣布成立無錫國家集成電路設計基地FPGA（現(xiàn)場可編程門陣列）創(chuàng)新中心，并隆重舉行賽靈思正式授權“無錫國家集成電路設計基地—賽靈思聯(lián)合實驗室”揭牌儀式。無錫新區(qū)管委會副主任朱曉紅以及賽靈思公司研究實驗室高級總監(jiān)、全球大學計劃負責人Patrick Lysaght等出席了成立大會并為聯(lián)合實驗室揭牌。 作為國家級的集成電路設計基地，新的FPGA創(chuàng)新中心的成立以及聯(lián)合實驗室的打造，意味著可編程設計在電子設計領域的
  • 關鍵字： 嵌入式系統(tǒng)  單片機  FPGA  無錫  集成電路設計  嵌入式  

FPGA：22年從配角到主角

  •     任何一個從事后看來很成功的新事物從誕生到發(fā)展壯大都不可避免地經(jīng)歷過艱難的歷程并可能成為被研究的案例，F(xiàn)PGA也不例外。1985年，當全球首款FPGA產(chǎn)品——XC2064誕生時，注定要使用大量芯片的PC機剛剛走出硅谷的實驗室進入商業(yè)市場，因特網(wǎng)只是科學家和政府機構通信的神秘鏈路，無線電話笨重得像磚頭，日后大紅大紫的Bill Gates正在為生計而奮斗，創(chuàng)新的可編程產(chǎn)品似乎并沒有什么用武之地。 　　事實也的確如此。最初，F(xiàn)PGA只是用于膠合邏輯，從膠合邏輯到算法
  • 關鍵字： 嵌入式系統(tǒng)  單片機  FPGA  嵌入式  

數(shù)字差分BPSK擴頻接收機的設計與FPGA實現(xiàn)

利用FPGA實現(xiàn)UART的設計

  • 引 言 　　隨著計算機技術的發(fā)展和廣泛應用，尤其是在工業(yè)控制領域的應用越來越廣泛，計算機通信顯的尤為重要。串行通信雖然使設備之間的連線大為減少，但隨之帶來串／并轉(zhuǎn)換和位計數(shù)等問題，這使串行通信技術比并行通信技術更為復雜。串／并轉(zhuǎn)換可用軟件實現(xiàn)，也可用硬件實現(xiàn)。用軟件實現(xiàn)串行傳送大多采用循環(huán)移位指令將一個字節(jié)由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡單但速度慢，而且大量占用CPU的時間，影響系統(tǒng)的性能。更為方便的實現(xiàn)方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
  • 關鍵字： 嵌入式系統(tǒng)  單片機  UART  FPGA  

基于FPGA的八位RISC CPU的設計

  •     1  引 言 　　隨著數(shù)字通信和工業(yè)控制領域的高速發(fā)展，要求專用集成電路（ASIC）的功能越來越強，功耗越來越低，生產(chǎn)周期越來越短，這些都對芯片設計提出了巨大的挑戰(zhàn)，傳統(tǒng)的芯片設計方法已經(jīng)不能適應復雜的應用需求了。SoC（System on a Chip）以其高集成度，低功耗等優(yōu)點越來越受歡迎。開發(fā)人員不必從單個邏輯門開始去設計ASIC，而是應用己有IC芯片的功能模塊，稱為核（core），或知識產(chǎn)權（IP）宏單元進行快速設計，效率大為提高。CPU 的IP
  • 關鍵字： 嵌入式系統(tǒng)  單片機  RISC  CPU  FPGA  

Altera首次實現(xiàn)了對關鍵工業(yè)以太網(wǎng)協(xié)議的FPGA IP支持

  • 　　Altera公司日前宣布為工業(yè)自動化應用中的以太網(wǎng)通信協(xié)議提供FPGA支持，這些應用包括ProfiNet、Ethernet/IP、Modbus-IDA、EtherCAT、SERCOS III接口和Ethernet Powerlink等。這些關鍵通信協(xié)議的知識產(chǎn)權(IP)內(nèi)核現(xiàn)在可以在Altera低成本Cyclone®系列FPGA中實現(xiàn)。 　　設計人員利用工業(yè)以太網(wǎng)IP內(nèi)核可以在一塊電路板上實現(xiàn)任何標準，這不但減小了外形尺寸，而且節(jié)省了時間。系統(tǒng)OEM能夠以高性價比方式在其自動化產(chǎn)品中增加工業(yè)
  • 關鍵字： 工業(yè)以太網(wǎng)  FPGA  IP  嵌入式  工業(yè)控制  

基于FPGA的智能控制器設計及測試方法研究

  • 摘要：通過模糊自整定PID控制器的設計，本文提出了一種基于VHDL描述、DSP Builder和Modelsim混合仿真、FPGA實現(xiàn)的智能控制器設計及測試新方法。首先，通過MATLAB仿真，得出智能控制器的結構和參數(shù)。然后，基于VHDL進行智能控制器的數(shù)字化實現(xiàn)及其開環(huán)測試。在此基礎上，通過分析一般智能控制器的測試特點，采用DSP Builder構建閉環(huán)測試系統(tǒng)，Modelsim運行DSP Builder生成文件來驗證QuartusII中所做VHDL設計的測試方法。實驗表明，該測試方法能有效模擬控制器的
  • 關鍵字： 嵌入式系統(tǒng)  單片機  FPGA  智能控制器  嵌入式  

Stratix II FPGA系統(tǒng)電源設計

  • 基于MAX1951的諸多特點，本文給出了采用該器件為Stratix II FPGA系統(tǒng)供電以降低其功耗的設計方案。
  • 關鍵字： 電源  設計  系統(tǒng)  FPGA  II  Stratix  

Altera宣布其Cyclone III FPGA提供對EtherCAT IP支持

  • 　　Altera公司日前宣布為EtherCAT技術協(xié)會的EtherCAT協(xié)議提供知識產(chǎn)權(IP)支持。此前IP是針對Cyclone® II器件，現(xiàn)在將針對Altera新的低成本、低功耗Cyclone III FPGA。 　　EtherCAT技術協(xié)會執(zhí)行總監(jiān)Martin Rostan說：“在競爭非常激烈的工廠自動化設備市場上，企業(yè)正在尋找能夠迅速突出產(chǎn)品優(yōu)勢的新功能和特性。Cyclone III FPGA實現(xiàn)對EtherCAT的支持，使設計人員能夠以高性價比方式，輕松加入實時以太網(wǎng)功能。” 　　
  • 關鍵字： 嵌入式系統(tǒng)  單片機  Altera  FPGA  Cyclone  EtherCAT  IP  嵌入式  

利用FPGA實現(xiàn)UART的設計

  • 引 言 　　隨著計算機技術的發(fā)展和廣泛應用，尤其是在工業(yè)控制領域的應用越來越廣泛，計算機通信顯的尤為重要。串行通信雖然使設備之間的連線大為減少，但隨之帶來串／并轉(zhuǎn)換和位計數(shù)等問題，這使串行通信技術比并行通信技術更為復雜。串／并轉(zhuǎn)換可用軟件實現(xiàn)，也可用硬件實現(xiàn)。用軟件實現(xiàn)串行傳送大多采用循環(huán)移位指令將一個字節(jié)由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡單但速度慢，而且大量占用CPU的時間，影響系統(tǒng)的性能。更為方便的實現(xiàn)方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
  • 關鍵字： 嵌入式系統(tǒng)  單片機  FPGA  UART  嵌入式  

降低FPGA功耗的設計

  • 　　使用這些設計技巧和ISE功能分析工具來控制功耗 　　新一代 FPGA的速度變得越來越快，密度變得越來越高，邏輯資源也越來越多。那么如何才能確保功耗不隨這些一起增加呢？很多設計抉擇可以影響系統(tǒng)的功耗，這些抉擇包括從顯見的器件選擇到細小的基于使用頻率的狀態(tài)機值的選擇等。 　　為了更好地理解本文將要討論的設計技巧為什么能夠節(jié)省功耗，我們先對功耗做一個簡單介紹。 　　功耗包含兩個因素：動態(tài)功耗和靜態(tài)功耗。動態(tài)功耗是指對器件內(nèi)的容性負載充放電所需的功耗。它很大程度上取決于  頻率、電壓和負載
  • 關鍵字： 嵌入式系統(tǒng)  單片機  FPGA  功耗  嵌入式  

擴頻通信系統(tǒng)的FPGA實現(xiàn)

  • 　　擴頻通信自上世紀50年代中期被美國軍方開始研究以來，一直為軍事通信所獨占，廣泛應用于軍事通信、電子對抗以及導航、測量等各個領域。進入上世紀90年代以后，擴頻通信又開始向各種民用通信領域發(fā)展，典型的如CDMA和GPS等。應用最廣的是直接序列擴頻方式(DSSS)。它是將待傳送的信息數(shù)據(jù)被偽隨機碼調(diào)制，實現(xiàn)頻譜擴展后再傳輸，接收端則采用相同的編碼進行解調(diào)及相關處理，恢復原始信息數(shù)據(jù)。 　　本文采用VHDL語言、Altera公司的集成開發(fā)環(huán)境QuartusII 6.0和Cyclone系列芯片EPlC3T14
  • 關鍵字： 通訊  無線  網(wǎng)絡  FPGA  無線  通信  

快速實現(xiàn)基于FPGA的脈動FIR濾波器

  • 引言 　　目前，用FPGA(現(xiàn)場可編程門陣列)實現(xiàn)FIR(有限沖擊響應)濾波器的方法大多利用FPGA中LUT(查找表)的特點采用DA(分布式算法)或CSD碼等方法，將乘加運算操作轉(zhuǎn)化為位與、加減和移位操作。這些結構需要占用器件較多的LE(邏輯元件)資源，設計周期長，工作頻率低，實時性差。本文提出一種基于Stratix系列FPGA器件的新的實時高速脈動FIR濾波器的快速實現(xiàn)方法。利 用FGPA集成的DSP(數(shù)字信號處理器)乘加模塊定制卷積運算單元，利用VHDL(甚高速集成電路硬件描述語言)元件例化語句快
  • 關鍵字： 嵌入式系統(tǒng)  單片機  FPGA  脈動FIR濾波器  嵌入式  
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