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利用FPGA實現(xiàn)外設(shè)通信接口之： 利用FPGA實現(xiàn)常用顯示接口（Display Interface）

  • 七段數(shù)碼管因為價格低廉，使用簡單，經(jīng)常被用來實現(xiàn)一些簡單的狀態(tài)顯示功能。七段數(shù)碼管的標(biāo)準(zhǔn)外觀圖如圖10.16所示。右下角的圓點用Dp來表示，用來實現(xiàn)小數(shù)點的顯示。
  • 關(guān)鍵字： 顯示接口  七段數(shù)碼管  FPGA  字符型LCD顯示接口  VGA  

利用FPGA實現(xiàn)外設(shè)通信接口之：利用FPGA實現(xiàn)USB 2.0通信接口

  • 利用FPGA來實現(xiàn)USB 2.0接口的方式一般有兩種，一是借助外圍的USB接口芯片，二是FPGA內(nèi)部實現(xiàn)USB協(xié)議控制器，外部通過USB的PHY芯片來實現(xiàn)接口。
  • 關(guān)鍵字： 外設(shè)通信接口  USB2.0  FPGA  CY7C68013  

利用FPGA實現(xiàn)外設(shè)通信接口之：FPGA在外設(shè)接口實現(xiàn)方面的優(yōu)勢

  • FPGA的一個重要的應(yīng)用領(lǐng)域就是數(shù)據(jù)采集和接口邏輯設(shè)計。隨著芯片封裝技術(shù)的提高，現(xiàn)在的FPGA已經(jīng)可以在單位面積上提供更多的I/O管腳資源。
  • 關(guān)鍵字： 外設(shè)接口  I/O資源  FPGA  

基于FPGA的片上可編程系統(tǒng)(SOPC)設(shè)計之：典型實例-基于NIOS II處理器的數(shù)字鐘設(shè)計

  • 本節(jié)旨在通過給定的工程實例——“數(shù)字鐘”來熟悉Altera軟嵌入式系統(tǒng)的軟硬件設(shè)計方法。同時使用基于Altera FPGA的開發(fā)板將該實例進(jìn)行下載驗證，完成工程設(shè)計的硬件實現(xiàn)。在本節(jié)中，將主要講解以下知識點。
  • 關(guān)鍵字： SOPC  NiosII  FPGA  數(shù)字鐘  

基于FPGA的片上可編程系統(tǒng)(SOPC)設(shè)計之：典型實例-基于NIOS II處理器的“Hello LED”程序設(shè)計

  • 本節(jié)旨在通過給定的工程實例——“Hello LED”來熟悉Altera軟嵌入式系統(tǒng)的軟硬件設(shè)計方法。同時使用基于Altera FPGA的開發(fā)板將該實例進(jìn)行下載驗證，完成工程設(shè)計的硬件實現(xiàn)。本節(jié)主要講解下面一些
  • 關(guān)鍵字： SOPC  NiosII  FPGA  

基于FPGA的片上可編程系統(tǒng)(SOPC)設(shè)計之：基于NIOS II的開發(fā)設(shè)計流程

  • NIOS II使用NIOS II IDE集成開發(fā)環(huán)境來完成整個軟件工程的編輯、編譯、調(diào)試和下載。在采用NIOS處理器設(shè)計嵌入式系統(tǒng)時，通常會按照以下步驟。
  • 關(guān)鍵字： 片上可編程系統(tǒng)  SOPC  FPGA  NiosII  

基于FPGA的片上可編程系統(tǒng)(SOPC)設(shè)計之：Altera公司的NIOS II解決方案

  • NIOS II是一個用戶可配置的通用RISC嵌入式處理器。Altera推出的NIOS II系列嵌入式處理器擴展了目前世界上最流行的軟核嵌入式處理器的性能。
  • 關(guān)鍵字： Altera  片上可編程系統(tǒng)  SOPC  FPGA  NiosII  

基于FPGA的片上可編程系統(tǒng)(SOPC)設(shè)計之：基于FPGA的SOPC系統(tǒng)組成原理和典型方案

  • SoC即System On Chip，是片上系統(tǒng)簡稱。它是IC設(shè)計與工藝技術(shù)水平不斷提高的結(jié)果。SoC從整個系統(tǒng)的角度出發(fā)，把處理機制、模型算法、芯片結(jié)構(gòu)、各層次電路直至器件的設(shè)計緊密結(jié)合起來，在單個（或少數(shù)幾個）芯片上完成整個系統(tǒng)的功能。所謂完整的系統(tǒng)一般包括中央處理器、存儲器以及外圍電路等。
  • 關(guān)鍵字： 片上可編程系統(tǒng)  SOPC  FPGA  

FPGA設(shè)計開發(fā)軟件Quartus II的使用技巧之： 編譯及仿真工程

  • 可以使用Quartus II Simulator在工程中仿真任何設(shè)計。根據(jù)所需的信息類型，可以進(jìn)行功能仿真以測試設(shè)計的邏輯功能，也可以進(jìn)行時序仿真。在目標(biāo)器件中測試設(shè)計的邏輯功能和最壞情況下的時序，或者采用Fast Timing模型進(jìn)行時序仿真，在最快的器件速率等級上仿真盡可能快的時序條件。
  • 關(guān)鍵字： QuartusII  編譯  FPGA  仿真  

FPGA設(shè)計開發(fā)軟件Quartus II的使用技巧之： 約束及配置工程

  • 設(shè)計好工程文件后，首先要進(jìn)行工程的約束。約束主要包括器件選擇、管腳分配及時序約束等。時序約束屬于較為高級的應(yīng)用，通過時序約束可以使工程設(shè)計文件的綜合更加優(yōu)化。下面對這幾種約束方式進(jìn)行介紹。
  • 關(guān)鍵字： QuartusII  約束  FPGA  配置  

FPGA設(shè)計開發(fā)軟件Quartus II的使用技巧之： LogicLock邏輯鎖定工具使用技巧

  • 邏輯鎖定方法學(xué)（LogicLock Methodology）內(nèi)容就是在設(shè)計時采用邏輯鎖定的基于模塊設(shè)計流程（LogicLock block-based design flow），來達(dá)到固定單模塊優(yōu)化的目的。這種設(shè)計方法學(xué)中第一次引入了高效團隊合作方法：它可以讓每個單模塊設(shè)計者獨立優(yōu)化他的設(shè)計，并把所用資源鎖定。
  • 關(guān)鍵字： QuartusII  LogicLock  FPGA  邏輯鎖定工具  

FPGA設(shè)計開發(fā)軟件Quartus II的使用技巧之： 典型實例-SignalTap II功能演示

  • 本節(jié)旨在通過給定的工程實例——“正弦波發(fā)生器”來熟悉Altera Quartus II高級調(diào)試功能SignalTap II和Intent Memory Content Editor的使用方法。同時使用基于Altera FPGA的開發(fā)板將該實例進(jìn)行下載驗證，完成工程設(shè)計的硬件實現(xiàn)。在本節(jié)中，將主要講解下面知識點。
  • 關(guān)鍵字： QuartusII  SignalTapII  FPGA  

FPGA設(shè)計開發(fā)軟件Quartus II的使用技巧之： 典型實例-LogicLock功能演示

  • 本節(jié)旨在通過Quartus軟件自帶的工程實例——“l(fā)ockmult”來熟悉Altera Quartus II邏輯鎖定功能LogicLock的使用方法。在本節(jié)中，將主要講解下面知識點。
  • 關(guān)鍵字： QuartusII  LogicLock  FPGA  

FPGA系統(tǒng)設(shè)計的仿真驗證之： FPGA設(shè)計仿真驗證的原理和方法

  • 嚴(yán)格來講，F(xiàn)PGA設(shè)計驗證包括功能與時序仿真和電路驗證。仿真是指使用設(shè)計軟件包對已實現(xiàn)的設(shè)計進(jìn)行完整測試，模擬實際物理環(huán)境下的工作情況。
  • 關(guān)鍵字： 仿真驗證  ModelSim  FPGA  CompilerII  FoundationSeries  Quartus  

FPGA系統(tǒng)設(shè)計的仿真驗證之： 功能仿真和時序仿真的區(qū)別和實現(xiàn)方法

  • 這里我們使用一個波形發(fā)生器作為例子，來說明如何使用Modelsim對Quartus II生成的IP Core和相應(yīng)的HDL文件進(jìn)行功能仿真和時序仿真。這個例子里面使用到了由Quartus II生成的一個片上ROM存儲單元。這種存儲單元和RAM一樣，都是基本的FPGA片上存儲單元，在以后的設(shè)計里面會經(jīng)常使用到。
  • 關(guān)鍵字： 仿真驗證  功能仿真  FPGA  時序仿真  
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