新聞中心

EEPW首頁(yè) > 模擬技術(shù) > 設(shè)計(jì)應(yīng)用 > 基于靜態(tài)CMOS和單相能量回收電路的乘法器電路設(shè)計(jì)

基于靜態(tài)CMOS和單相能量回收電路的乘法器電路設(shè)計(jì)

作者: 時(shí)間:2010-08-30 來(lái)源:網(wǎng)絡(luò) 收藏

本文引用地址:http://m.butianyuan.cn/article/187816.htm

  


  從圖中可見(jiàn),用靜態(tài)電路構(gòu)成的輸出比較穩(wěn)定,輸出等于0或VDD,功率消耗為1.51×10-7W。而用回收電路構(gòu)成的二位的輸出不夠穩(wěn)定,對(duì)噪聲信號(hào)較為敏感,但是并不影響輸出邏輯,功率消耗減小為1.17×10-7W。從節(jié)能的角度來(lái)看,回收電路性能更好。

  3 結(jié)語(yǔ)

  本文首先介紹了回收反相器電路,詳細(xì)討論電路的工作原理,同時(shí)用PSpice工具仿真了基于靜態(tài)電路和單相電路構(gòu)成的兩位電路。仿真結(jié)果表明本文介紹的單相電路能夠極大地降低電路功耗。今后的工作還應(yīng)繼續(xù)優(yōu)化電路結(jié)構(gòu),穩(wěn)定電路的輸出狀態(tài),增強(qiáng)電路的抗干擾能力。

p2p機(jī)相關(guān)文章:p2p原理



上一頁(yè) 1 2 3 下一頁(yè)

關(guān)鍵詞: CMOS 單相 乘法器 能量 能量回收

評(píng)論


相關(guān)推薦

技術(shù)專區(qū)

關(guān)閉