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模數(shù)轉(zhuǎn)換器時(shí)鐘優(yōu)化:測(cè)試工程觀點(diǎn)

作者: 時(shí)間:2011-12-05 來(lái)源:網(wǎng)絡(luò) 收藏
ADDING-LEFT: 0px; PADDING-BOTTOM: 5px; MARGIN-LEFT: 0px; LINE-HEIGHT: 15px; PADDING-TOP: 0px; FONT-FAMILY: Arial, Helvetica, sans-serif">?編碼限制在通帶頻率內(nèi)
?占空比限制于50%
?成本比LCBP增加50%

注意

?為了獲得最佳性能,將帶通濾波器放置在分頻器前面

?分頻器可能使情況變壞
?最大輸出功率受到濾波器插入損耗和最大輸入功率的限制

?最大輸出功率受到濾波器插入損耗和最大輸入功率的限制
?在定制濾波器時(shí)要求很高的最大功率

使用背對(duì)背Schottky二極管在信號(hào)進(jìn)入ADC時(shí)鐘輸入端時(shí)將信號(hào)箝位是明智的。這使得源幅度增加,因此增加了擺率,同時(shí)使得時(shí)鐘幅度與時(shí)鐘輸入電平兼容。

如果是小時(shí)鐘系統(tǒng)或者最后的電路級(jí)具有短的走線,可以結(jié)合箝位二極管使用變壓器。變壓器是無(wú)源的,不會(huì)將抖動(dòng)添加到整體時(shí)鐘信號(hào)中。變壓器還可以為振蕩器信號(hào)提供增益,增加式4中的A項(xiàng)(幅度)。最后,變壓器自身可提供通帶濾波。具有增益(阻抗比為1:2或1:4)的變壓器有較窄的帶寬,提供了更好的時(shí)鐘信號(hào)濾波。變壓器還可以將該單端信號(hào)轉(zhuǎn)換為差分信號(hào),這在目前的ADC時(shí)鐘輸入接口中是常見(jiàn)的,也是強(qiáng)力推薦的。

應(yīng)當(dāng)注意,并非所有的二極管都能發(fā)揮良好的作用(圖14)。在相同的條件下進(jìn)行測(cè)量,其中基線是相對(duì)于所有其他二極管的性能最好的二極管的SNR曲線。應(yīng)當(dāng)仔細(xì)閱讀說(shuō)明書(shū)并且特別注意動(dòng)態(tài)電阻和電容的參數(shù)。具有低R和C值的二極管可以加快箝位速度。

模數(shù)轉(zhuǎn)換器時(shí)鐘優(yōu)化:測(cè)試工程觀點(diǎn)
圖14. 箝位Schottky二極管的選擇影響AD9446-80的性能

這里將16 bit 80 MSPS ADC AD9446用作測(cè)試平臺(tái);其中增加了時(shí)鐘源中的背對(duì)背二極管。圖15中示出了用于進(jìn)行評(píng)估的電路。

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圖15. 測(cè)量圖14中數(shù)據(jù)的AD9446時(shí)鐘電路

在時(shí)鐘硬件接口中減少抖動(dòng)
在與ADC的時(shí)鐘輸入引腳連接時(shí),可以使用許多電路和解決方案。然而,式5提醒我們,信號(hào)鏈路中的每個(gè)有源元件(振蕩源、驅(qū)動(dòng)器或扇出門(mén)、分頻器等)將增加ADC的時(shí)鐘輸入引腳處的總抖動(dòng)量。圖16示出,增加兩個(gè)門(mén)(每個(gè)門(mén)貢獻(xiàn)700 fs的抖動(dòng))到具有300 fs抖動(dòng)的時(shí)鐘源中,在140 MHz頻率下會(huì)使分辨率從約12 bit下降到小于10 bit。 在時(shí)鐘硬件接口中減少抖動(dòng)
在與ADC的時(shí)鐘輸入引腳連接時(shí),可以使用許多電路和解決方案。然而,式5提醒我們,信號(hào)鏈路中的每個(gè)有源元件(振蕩源、驅(qū)動(dòng)器或扇出門(mén)、分頻器等)將增加ADC的時(shí)鐘輸入引腳處的總抖動(dòng)量。圖16示出,增加兩個(gè)門(mén)(每個(gè)門(mén)貢獻(xiàn)700 fs的抖動(dòng))到具有300 fs抖動(dòng)的時(shí)鐘源中,在140 MHz頻率下會(huì)使分辨率從約12 bit下降到小于10 bit。

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圖16. 多個(gè)驅(qū)動(dòng)器門(mén)增加抖動(dòng)并且減小SNR

因此,使時(shí)鐘信號(hào)鏈路中的元件數(shù)目最小有助于降低總的RSS抖動(dòng)。

還應(yīng)當(dāng)注意所選擇的時(shí)鐘門(mén)的類(lèi)型。如果希望在較高的模擬輸入頻率下獲得較好的性能,則簡(jiǎn)單的邏輯門(mén)可能不是最佳選擇。最好仔細(xì)閱讀候選器件的技術(shù)資料并理解相關(guān)的參數(shù),如抖動(dòng)和偏移。當(dāng)這些器件與抖動(dòng)特別低的時(shí)鐘源一起工作時(shí),這是非常重要的。例如,在圖17中,時(shí)鐘源A具有800 fs的抖動(dòng),時(shí)鐘源B具有125 fs的抖動(dòng)。使用晶體濾波器可以將其抖動(dòng)分別減少到175 fs和60 fs。然而,分頻器(或者具有類(lèi)似抖動(dòng)參數(shù)的門(mén)電路)可能使抖動(dòng)均增加到200 fs以上。這再次說(shuō)明了在時(shí)鐘信號(hào)鏈路中正確選擇和放置時(shí)鐘驅(qū)動(dòng)器的重要性。

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圖17. 門(mén)電路將增加抖動(dòng)

另一種常見(jiàn)方法,即使用FPGA,并不能實(shí)現(xiàn)技術(shù)資料上的性能。FPGA(其常具有提供分頻的數(shù)字時(shí)鐘管理器(DCM))可以用作一個(gè)靈活的門(mén)驅(qū)動(dòng)器。然而,如圖18所示,使用AD9446-80(80 MSPS ADC)進(jìn)行測(cè)試,該方法導(dǎo)致SNR顯著下降;例如,能夠?qū)崿F(xiàn)13 bit的ENOB。紅色曲線為使用高性能振蕩器時(shí)的基線



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