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EEPW首頁(yè) >> 主題列表 >> 現(xiàn)場(chǎng)可編程門陣列(fpga)

現(xiàn)場(chǎng)可編程門陣列(fpga) 文章 進(jìn)入現(xiàn)場(chǎng)可編程門陣列(fpga)技術(shù)社區(qū)

圖像的二維提升小波變換的FPGA實(shí)現(xiàn)

  • 圖像的二維提升小波變換的FPGA實(shí)現(xiàn),小波分析理論以其良好的時(shí)頻區(qū)域性和多分辨率分析能力，開(kāi)辟了圖像處理的嶄新領(lǐng)域。小波變換是一種很好的圖像分解方法，非常適合于分析突變信號(hào)而用于靜止圖像邊緣的提取和壓縮。高階小波變化還可以用于實(shí)時(shí)處理視頻
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FPGA幫您實(shí)現(xiàn)家居遙控

  • 　引言　　人們生活中的家用電器種類日益增多，遙控器的種類也隨之增加，不同種類的遙控器之間一般不能相互替代，這給人們的生活帶來(lái)諸多不便?！　「黝愡b控器功能大致相同，大多都有數(shù)字鍵、啟動(dòng)停止鍵、前進(jìn)鍵、快
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基于FPGA的紅外遙控信號(hào)接收模塊的設(shè)計(jì)

  • 摘要：文中分析了紅外線遙控器系統(tǒng)的數(shù)據(jù)編碼和傳輸機(jī)制，并用VerilogHDL語(yǔ)言設(shè)計(jì)了基于FPGA的紅外接收模塊硬件電路，在VCS和VirSim仿真工具中進(jìn)行了仿真測(cè)試；用XilinxISE 10．1軟件進(jìn)行了綜合、適配和FPGA器件下栽
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IIS接口的FPGA實(shí)現(xiàn)

  • IIS接口的FPGA實(shí)現(xiàn),在嵌入式系統(tǒng)中經(jīng)常采用IIS(Inter-IC Sound)總線連接專用音頻器件以實(shí)現(xiàn)音頻輸入輸出。不少嵌入式處理器帶有專用的通過(guò)操作特殊功能寄存器實(shí)現(xiàn)對(duì)外接音頻器件的操作，但也有一些嵌入式處理器沒(méi)有擴(kuò)展IIS總線，如ARM7
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基于USB通信的FPGA高速數(shù)據(jù)采集系統(tǒng)

  • 摘要：為了解決高速數(shù)據(jù)采集以及數(shù)據(jù)傳輸問(wèn)題，設(shè)計(jì)了基于USB通信的FPGA高速數(shù)據(jù)采集系統(tǒng)。方案以FPGA為控制核心，實(shí)現(xiàn)A／D控制、數(shù)據(jù)緩存雙口RAM和控制CY7C68013A三個(gè)功能。系統(tǒng)采用Verilog HDL語(yǔ)言，通過(guò)ISE軟件編
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基于FPGA的線陣CCD驅(qū)動(dòng)設(shè)計(jì)

  • 摘要：電荷耦合器件(CCD)作為一種新型的光電器件，被廣泛地應(yīng)用于非接觸測(cè)量。而CCD驅(qū)動(dòng)設(shè)計(jì)是CCD應(yīng)用的關(guān)鍵問(wèn)題之一。為了克服早期CCD驅(qū)動(dòng)電路體積大，設(shè)計(jì)周期長(zhǎng)，調(diào)試?yán)щy等缺點(diǎn)，以線陣CCD圖像傳感器TCD1251UD為
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線性調(diào)頻信號(hào)基于FPGA IP核的脈沖壓縮設(shè)計(jì)

  • 摘要：為實(shí)現(xiàn)線性調(diào)頻信號(hào)的數(shù)字脈沖壓縮，設(shè)計(jì)一個(gè)FPGA硬件平臺(tái)，并著重提出一種基于FPGA IP核的脈沖壓縮設(shè)計(jì)方法。針對(duì)脈沖壓縮進(jìn)行了理論分析和Matlab仿真，設(shè)計(jì)完成后對(duì)系統(tǒng)軟、硬件進(jìn)行了全面測(cè)試，并根據(jù)實(shí)測(cè)數(shù)
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基于FPGA的LCoS驅(qū)動(dòng)和圖像處理系統(tǒng)設(shè)計(jì)

  • 摘要：針對(duì)分辨率為1 024times;768的LCoS屏編寫了Verilog HDL驅(qū)動(dòng)代碼，在quartusⅡ9．1平臺(tái)上綜合編譯，并在Altera的FPGA芯片EP3C5E14 4C8上進(jìn)行了功能驗(yàn)證和實(shí)際輸出信號(hào)測(cè)量。采用異步FIFO結(jié)構(gòu)解決了跨異步時(shí)鐘域
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基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設(shè)計(jì)

  • 1、引言　　最佳聲納系統(tǒng)的設(shè)計(jì)需要從聲納波形、聲納信道和聲納接收機(jī)三方面進(jìn)行綜合考慮[1]。在聲納信道 ...
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基于CPLD／FPGA的USB讀寫控制器

  • 引言
    隨著計(jì)算機(jī)科技的發(fā)展，無(wú)紙辦公日益成為各單位日常辦公的主要形式。而隨著USB存儲(chǔ)設(shè)備日益廣泛的使用，數(shù)據(jù)泄漏的危害也越來(lái)越嚴(yán)重。因此在單位內(nèi)部對(duì)USB存儲(chǔ)設(shè)備的操作權(quán)限進(jìn)行控制是很有必要的。
  • 關(guān)鍵字： CPLD  FPGA  USB  讀寫    

基于FPGA的交流電測(cè)量?jī)x的設(shè)計(jì)

  • 在電力調(diào)度自動(dòng)化系統(tǒng)中，測(cè)量電壓和頻率是最重要的功能。如何快速、準(zhǔn)確地采集顯得尤為重要。目前根據(jù)采集信...
  • 關(guān)鍵字： FPGA  交流電測(cè)量?jī)x  

Leon3軟核的FPGA SelectMap接口配置設(shè)計(jì)

  • 摘要：與通常采用外圍的CPLD器件和CPU來(lái)產(chǎn)生配置接口控制邏輯的方法不同，本文設(shè)計(jì)了采用嵌入到FPGA的Leon3開(kāi)源CPU軟核來(lái)控制實(shí)現(xiàn)Virtex系列FPGA的SelectMap接口配置的方法，可將其應(yīng)用于對(duì)FPGA芯片的在線配置。該方
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一種基于MCU+FPGA的LED大屏幕控制系統(tǒng)的設(shè)計(jì)

  • 　　存儲(chǔ)器是用來(lái)存儲(chǔ)程序和數(shù)據(jù)的部件，有了存儲(chǔ)器，計(jì)算機(jī)才有記憶功能，才能保證正常工作。它根據(jù)控制器指定的位置存進(jìn)和取出信息。 引言　　只要在現(xiàn)在的市場(chǎng)上走一圈就會(huì)發(fā)現(xiàn)，大部分的中小規(guī)模 LED 　LED（L
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FPGA平臺(tái)實(shí)現(xiàn)最小開(kāi)關(guān)損耗的SVPWM算法

  • 摘要：詳細(xì)分析了SVPWM的原理，介紹一種根據(jù)負(fù)載的功率因子來(lái)決定電壓空間零矢量的分配與作用時(shí)間的SVPWM算法，使得橋臂開(kāi)關(guān)在通過(guò)其電流最大時(shí)的一段連續(xù)時(shí)間內(nèi)沒(méi)有開(kāi)關(guān)動(dòng)作。這樣在提高開(kāi)關(guān)頻率的同時(shí)減小了開(kāi)關(guān)電
  • 關(guān)鍵字： SVPWM  FPGA  開(kāi)關(guān)損耗  算法    

基于FPGA無(wú)線傳感器網(wǎng)絡(luò)MAC控制器的設(shè)計(jì)

  • 摘要 給出了一種由FPGA實(shí)現(xiàn)的無(wú)線傳感器網(wǎng)絡(luò)MAC控制器的設(shè)計(jì)方法，采用自頂向下的方法設(shè)計(jì)各個(gè)模塊，并在QuartusII8.0完成了仿真，該控制器主要支持IEEE802．15．4協(xié)議。測(cè)試結(jié)果表明，該MAC控制器支持20～250 kbmi
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現(xiàn)場(chǎng)可編程門陣列(fpga)介紹

您好，目前還沒(méi)有人創(chuàng)建詞條現(xiàn)場(chǎng)可編程門陣列(fpga)!
歡迎您創(chuàng)建該詞條，闡述對(duì)現(xiàn)場(chǎng)可編程門陣列(fpga)的理解，并與今后在此搜索現(xiàn)場(chǎng)可編程門陣列(fpga)的朋友們分享。    創(chuàng)建詞條
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