block ram 文章進(jìn)入block ram技術(shù)社區(qū)

FPGA研發(fā)之道(11)-設(shè)計不是湊波形(一)FIFO(上)

　　FIFO是FPGA內(nèi)部一種常用的資源，可以通過FPGA廠家的的IP生成工具生成相應(yīng)的FIFO。FIFO可分為同步FIFO和異步FIFO，其區(qū)別主要是，讀寫的時鐘是否為同一時鐘，如使用一個時鐘則為同步FIFO，讀寫時鐘分開則為異步FIFO。一般來說，較大的FIFO可以選擇使用內(nèi)部BLOCK RAM資源，而小的FIFO可以使用寄存器資源例化使用。　　一般來說，F(xiàn)IFO的主要信號包括：　　實際使用中，可編程滿的信號(XILINX 的FIFO)較為常用，ALTERA的FIFO中，可以通過寫深度(即寫入
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單片機(jī)硬件系統(tǒng)擴(kuò)展外設(shè)的設(shè)計原則

　　一個單片機(jī)應(yīng)用系統(tǒng)的硬件電路設(shè)計包含兩部分內(nèi)容：一是系統(tǒng)擴(kuò)展，即單片機(jī)內(nèi)部的功能單元，如 ROM、RAM、I/O、定時器/計數(shù)器、中斷系統(tǒng)等不能滿足應(yīng)用系統(tǒng)的要求時，必須在片外進(jìn)行擴(kuò)展，選擇適當(dāng)?shù)男酒?，設(shè)計相應(yīng)的電路。二是系統(tǒng)的配置，即按照系統(tǒng)功能要求配置外圍設(shè)備，如鍵盤、顯示器、打印機(jī)、A/D、D/A轉(zhuǎn)換器等，要設(shè)計合適的接口電路。　　　　系統(tǒng)的擴(kuò)展和配置應(yīng)遵循以下原則：　　1、盡可能選擇典型電路，并符合單片機(jī)常規(guī)用法。為硬件系統(tǒng)的標(biāo)準(zhǔn)化、模塊化打下良好的基礎(chǔ)。　
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FPGA研發(fā)之道(4)靈活性的陷阱

　　如果說用一個詞來描述FPGA的特性，靈活性肯定名列前茅。　　FPGA的靈活性在于：　　(一)I/O的靈活性，其可以通過其I/O組成各種接口與各種器件連接，并且支持不同的電氣特性。　　(二)內(nèi)部存儲器靈活性，可以通過IP生成工具生成各種深度和寬度的RAM或者FIFO等。　　(三)邏輯的靈活性，內(nèi)部邏輯通可生成的各種類型IP。　　對于I/O接口來說，F(xiàn)PGA的I/O可以支持不同類型的電平和驅(qū)動能力，各I/O未定義之前其地位平等，例如一個數(shù)據(jù)信號可將其約束在任意引腳，只要其電平符合連接的
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賽普拉斯為其領(lǐng)先業(yè)界的高容量F-RAM產(chǎn)品線增添新的封裝方式和溫度范圍選項

　　賽普拉斯半導(dǎo)體公司日前宣布，其鐵電隨機(jī)存取存儲器(F-RAM™)產(chǎn)品系列中的1Mb并行異步接口F-RAM增加44-pin TSOPII封裝方式，其2 Mb串行外設(shè)接口(SPI)F-RAM的溫度范圍擴(kuò)展為-40?C 至 +105?C。　　新封裝方式可在替代標(biāo)準(zhǔn)的電池供電的SRAM時實現(xiàn)管腳兼容，應(yīng)用于工業(yè)自動化、計算、網(wǎng)絡(luò)和汽車電子應(yīng)用中的關(guān)鍵任務(wù)系統(tǒng)中。F-RAM與生俱來的非易失性可以實現(xiàn)瞬間數(shù)據(jù)捕獲，無需電池即可實現(xiàn)長達(dá)百年的保存時間。棄用電池可以降低系統(tǒng)成本和復(fù)雜性。2 Mb SP
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多參數(shù)室內(nèi)環(huán)境智能監(jiān)測系統(tǒng)設(shè)計

　　摘要：針對室內(nèi)環(huán)境質(zhì)量與人們的健康和工作效率密切相關(guān)的情況，設(shè)計了一種多參數(shù)多采集點室內(nèi)環(huán)境監(jiān)測系統(tǒng)。系統(tǒng)硬件主要包括單片機(jī)系統(tǒng)、FPGA數(shù)據(jù)采集電路、傳感器信號調(diào)理電路等。軟件包括單片機(jī)硬件驅(qū)動程序、FPGA數(shù)字邏輯設(shè)計和基于VB的上位機(jī)應(yīng)用程序。實驗結(jié)果表明：系統(tǒng)工作穩(wěn)定，誤差在設(shè)計允許范圍內(nèi)。　　引言　　隨著經(jīng)濟(jì)持續(xù)快速發(fā)展，人們的生活水平不斷提高，對各種室內(nèi)環(huán)境的要求也越來越高。傳統(tǒng)的室內(nèi)環(huán)境監(jiān)測設(shè)備實時性差、精度低、體積大、功耗大，難以適應(yīng)現(xiàn)代經(jīng)濟(jì)發(fā)展的要求?；谝陨媳尘?，本文設(shè)計了
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基于FPGA的監(jiān)測數(shù)字示波器設(shè)計

摘要：在核監(jiān)測中，常將各種傳感器輸出的信號通過A/D轉(zhuǎn)換器轉(zhuǎn)換為數(shù)字信號，然后利用數(shù)字信號處理技術(shù)對各種核信號進(jìn)行數(shù)字處理。為了準(zhǔn)確測量核信號數(shù)字波形的各種參數(shù)，對基于FPGA雙口RAM的數(shù)字示波器進(jìn)行了設(shè)計和測試分析。實驗表明，該數(shù)字示波器能準(zhǔn)確獲取核信號的數(shù)字渡形及各種參數(shù)的值，可對核信號的波形進(jìn)行錄制、回放和精確分析，為核監(jiān)測及其儀器準(zhǔn)確設(shè)計提供有力的保證。福島核事故促進(jìn)了核監(jiān)測儀器的飛速發(fā)展。在核爆監(jiān)測中，需對核輻射的各種信號如光輻射、放射線沾染、沖擊波、電磁輻射等進(jìn)行測量，通過測量這些信號的
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未來PC RAM可以永不丟失數(shù)據(jù)

PC在我們的生活中一直起著重要的作用，但是由于其硬件性能近來沒有大的提升，市場銷售情況已是每況愈下。雖然處理器已經(jīng)從高主頻轉(zhuǎn)向多核心，電腦的內(nèi)存介質(zhì)似乎也需要一次重大的革新。
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賽靈思FPGA全局時鐘網(wǎng)絡(luò)結(jié)構(gòu)詳解

在 Xilinx 系列 FPGA 產(chǎn)品中，全局時鐘網(wǎng)絡(luò)是一種全局布線資源，它可以保證時鐘信號到達(dá)各個目標(biāo)邏輯單元的時延基本相同。其時鐘分配樹結(jié)構(gòu)如圖1所示。
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Microsemi主流FPGA產(chǎn)品組合加入全新小封裝器件

致力于提供功率、安全、可靠與高性能半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation，紐約納斯達(dá)克交易所代號：MSCC) 宣布為其主流SERDES-based SmartFusion?2 系統(tǒng)級芯片(SoC) FPGA和IGLOO?2 FPGA器件提供全新小尺寸解決方案。
關(guān)鍵字：美高森美 FPGA RAM

單片機(jī)中data,idata,xdata,pdata,code區(qū)別

很多單片機(jī)初學(xué)者甚至有些用老工程師對data,idata,xdata,pdata,code這些東西一直都搞不明白是怎么回事。最 ...
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AVR單片機(jī)三種存儲器使用問題

AVR 系列單片機(jī)內(nèi)部有三種類型的被獨立編址的存儲器，它們分別為：Flash 程序存儲器、內(nèi)部SRAM 數(shù)據(jù)存儲器和EEP ...
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單片機(jī)下程序RAM， ROM ，F(xiàn)lash

8K的flash是有8*1024個字節(jié)，一條指令可能有1~4個機(jī)器碼，即1~4個字節(jié)，其中1~2機(jī)器碼的指令使用最為頻繁，所以這樣 ...
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51單片機(jī)RAM 數(shù)據(jù)存儲區(qū)學(xué)習(xí)筆記

1.RAM keil C語言編程RAM是程序運行中存放隨機(jī)變量的數(shù)據(jù)空間。在keil中編寫程序，如果當(dāng)前模式為small模式， ...
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MEMS、MCU和傳感器融合的平衡

摘要：MEMS傳感器技術(shù)的流行，讓傳感器技術(shù)的應(yīng)用變得越來越廣泛，與此同時，配合傳感器的MCU產(chǎn)品也必須做出一定的調(diào)整，以適應(yīng)傳感器和MCU相配合以達(dá)到最優(yōu)的整體應(yīng)用效果。本文詳細(xì)分析了如何在MEMS傳感器和MCU之前進(jìn)行設(shè)計的平衡。
關(guān)鍵字： MEMS MCU 傳感器陀螺儀 RAM 201312