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中高壓斷路器在線監(jiān)測裝置的設(shè)計與實現(xiàn)

  • 為了對開關(guān)設(shè)備的重要參數(shù)能進(jìn)行長期連續(xù)的監(jiān)測,設(shè)計出一種采用DSP處理器加CPLD結(jié)構(gòu)的在線監(jiān)測系統(tǒng),詳細(xì)分析了行程信號采集、線圈電流信號采集、數(shù)據(jù)存儲、通信和實時RTC等主要硬件模塊的設(shè)計方案。系統(tǒng)實現(xiàn)了對高壓斷路器狀態(tài)的在線監(jiān)測和機械故障的診斷,為開關(guān)設(shè)備狀態(tài)監(jiān)測提供了一種可行的解決方案。
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Altera簡化工廠自動化系統(tǒng)的工業(yè)以太網(wǎng)設(shè)計

  • Altera公司(NASDAQ: ALTR)日前宣布,提供能夠簡化工廠自動化系統(tǒng)中基于FPGA的工業(yè)以太網(wǎng)設(shè)計集成的許可結(jié)構(gòu)。
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Altera電機控制提高系統(tǒng)集成度、可擴展的性能和靈活性

  • Altera公司(NASDAQ: ALTR)日前宣布,新的電機控制開發(fā)工作臺前所未有的提高了電機控制系統(tǒng)設(shè)計的系統(tǒng)集成度和靈活性,而且性能還可以擴展,同時大幅度縮短開發(fā)時間,降低風(fēng)險。工作臺包括一組可定制的單軸和多軸芯片驅(qū)動參考設(shè)計,以及系列電機控制硬件開發(fā)板,結(jié)合系統(tǒng)和軟件設(shè)計方法,滿足下一代驅(qū)動系統(tǒng)的多種需求。
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2012嵌入式系統(tǒng)聯(lián)誼會(秋季)即將在京舉辦

  • 隨著微電子技術(shù)和軟件技術(shù)的發(fā)展,嵌入式處理器、專用數(shù)字器件、外設(shè)和DSP算法正在以IP核的方式嵌入到FGPA中,以單芯片F(xiàn)PGA完成整個嵌入式系統(tǒng)設(shè)計已成為現(xiàn)實,這樣的芯片業(yè)界稱為可編程的片上系統(tǒng)(SOPC或PSoC)。國際和國內(nèi)的芯片公司都有了這樣的芯片產(chǎn)品并在通信、工業(yè)控制等市場領(lǐng)域有了廣泛的應(yīng)用,教育和科研界對此也相當(dāng)重視。
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基于FPGA的可重構(gòu)系統(tǒng)及其結(jié)構(gòu)分析

  • 基于FPGA的可重構(gòu)系統(tǒng)及其結(jié)構(gòu)分析, 1 引言電子系統(tǒng)功能實現(xiàn)的模式不外硬件和軟件兩種?;隈T.諾依曼或者哈佛體系結(jié)構(gòu)的通用微處理器(MPU、MCU、DSP等)系統(tǒng)是軟件實現(xiàn)模式,其硬件電路結(jié)構(gòu)固定,通過串行執(zhí)行指令實現(xiàn)功能。軟件設(shè)計靈活、易升級,但執(zhí)
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一種基于ARM內(nèi)核SoC的FPGA 驗證環(huán)境設(shè)計方法

  • 摘 要:針對片上系統(tǒng)(SoC) 開發(fā)周期較長和現(xiàn)場可編程門陣列(FPGA) 可重用的特點,設(shè)計了基于ARM7TDMI 處理 ...
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基于PXA255設(shè)計的圖像采集傳輸系統(tǒng)

  • 0 引言 圖像處理技術(shù)的快速發(fā)展,使得圖像采集處理系統(tǒng)在提高農(nóng)業(yè)生產(chǎn)自動化程度中的應(yīng)用越來越廣泛。目前 ...
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醫(yī)療電子市場 FPGA技術(shù)市場巨大

  •   目前,世界各地對醫(yī)療保健的需求在不斷增長,對保健模式的要求也越來越高。Altera醫(yī)療業(yè)務(wù)部高級市場經(jīng)理John Sotir認(rèn)為,變化體現(xiàn)在兩方面,特別是醫(yī)院環(huán)境中。首先,預(yù)測和預(yù)防保健的發(fā)展提高了患者的生活質(zhì)量,在不斷發(fā)展的診斷成像平臺的支持下,社會醫(yī)療保健總成本也在不斷下降。其次,功能強大的、基于價值的便攜式醫(yī)療設(shè)備在性能上超越了幾年前的大型高成本設(shè)備,在此基礎(chǔ)上,政府政策能夠擴大醫(yī)療保健的覆蓋范圍。   他還指出,推動中國醫(yī)療電子設(shè)計快速發(fā)展的幾個因素包括:經(jīng)濟增長推動了市場需求;人口增長和老
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軟核、固核、硬核在FPGA中的概念分析

  • 從IP核的提供方式上,通常將其分為軟核、固核和硬核這3類。從完成IP核所花費的成本來講,硬核代價最大;從使用靈活性來講,軟核的可復(fù)用使用性最高。1. 軟核(Soft IP Core)軟核在EDA 設(shè)計領(lǐng)域指的是綜合之前的寄存器傳
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FPGA中內(nèi)嵌專用硬核

  • 內(nèi)嵌專用硬核是相對底層嵌入的軟核而言的,指FPGA處理能力強大的硬核(Hard Core),等效于ASIC電路。為了提高FPGA性能,芯片生產(chǎn)商在芯片內(nèi)部集成了一些專用的硬核。例如:為了提高FPGA的乘法速度,主流的FPGA 中都集
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FPGA中豐富的布線資源

  • 布線資源連通FPGA內(nèi)部的所有單元,而連線的長度和工藝決定著信號在連線上的驅(qū)動能力和傳輸速度。FPGA芯片內(nèi)部有著豐富的布線資源,根據(jù)工藝、長度、寬度和分布位置的不同而劃分為4類不同的類別。第一類是全局布線資源
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FPGA中嵌入式塊RAM(BRAM)

  • 大多數(shù)FPGA都具有內(nèi)嵌的塊RAM,這大大拓展了FPGA的應(yīng)用范圍和靈活性。塊RAM可被配置為單端口RAM、雙端口RAM、內(nèi)容地址存儲器 (CAM)以及FIFO等常用存儲結(jié)構(gòu)。RAM、FIFO是比較普及的概念,在此就不冗述。CAM存儲器在其
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FPGA中可配置邏輯塊(CLB)

  • CLB是FPGA內(nèi)的基本邏輯單元。CLB的實際數(shù)量和特性會依器件的不同而不同,但是每個CLB都包含一個可配置開關(guān)矩陣,此矩陣由4或6個輸入、一些 選型電路(多路復(fù)用器等)和觸發(fā)器組成。開關(guān)矩陣是高度靈活的,可以對其進(jìn)行
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FPGA可編程輸入輸出單元(IOB)

  • 可編程輸入/輸出單元簡稱I/O單元,是芯片與外界電路的接口部分,完成不同電氣特性下對輸入/輸出信號的驅(qū)動與匹配要求,其示意結(jié)構(gòu)如圖1-2所示。FPGA內(nèi)的I/O按組分類,每組都能夠獨立地支持不同的I/O標(biāo)準(zhǔn)。通過軟件的
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基于CPLD的水輪發(fā)電機組轉(zhuǎn)速監(jiān)控系統(tǒng)的設(shè)計

  • 摘 要:給出了采用CPLD的水輪發(fā)電機組轉(zhuǎn)速監(jiān)控系統(tǒng)的設(shè)計原理和VHDL的語言描述,該設(shè)計具有結(jié)構(gòu)簡單、成本低和抗干擾性能強等特點。1 概 述轉(zhuǎn)速數(shù)據(jù)是水輪發(fā)電機組運行狀況的重要標(biāo)志之一。準(zhǔn)確地測量機組的轉(zhuǎn)速并
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