首頁　 資訊　 商機 　 下載　 拆解 　 高校　 招聘 　 雜志　 會展　 EETV　 百科 　 問答　 電路圖　 工程師手冊 　 Datasheet　 100例 　 活動中心　 E周刊閱讀 　 樣片申請
EEPW首頁 >> 主題列表 >> cpld／fpga

ASIC設(shè)計轉(zhuǎn)FPGA時需要注意的幾點

  • ASIC設(shè)計轉(zhuǎn)FPGA時需要注意的幾點-FPGA原型驗證和其他驗證方法是不同的,任何一種其他驗證方法都是ASIC驗證中的一個環(huán)節(jié),而FPGA驗證卻是一個過程。
  • 關(guān)鍵字： FPGA  

FPGA開發(fā)基礎(chǔ)知識問答

  • FPGA開發(fā)基礎(chǔ)知識問答-首先要將安裝的ModelSim目錄下的ModelSim.ini屬性設(shè)置為存檔類型（去掉只讀）
  • 關(guān)鍵字： FPGA  

FPGA開發(fā)要掌握的六大基礎(chǔ)知識（3）

  • FPGA開發(fā)要掌握的六大基礎(chǔ)知識（3）-Xilinx FPGA開發(fā)軟件為ISE.現(xiàn)在其版本更新比較快，大家現(xiàn)在常用的版本都在ISE12.1了。
  • 關(guān)鍵字： FPGA  賽靈思  Xilinx  

影響FPGA設(shè)計周期生產(chǎn)力的最大因素是什么？

  • 影響FPGA設(shè)計周期生產(chǎn)力的最大因素是什么？-提高FPGA設(shè)計生產(chǎn)力的工具、技巧和方法，9影響FPGA設(shè)計周期生產(chǎn)力的最大因素是什么？
  • 關(guān)鍵字： FPGA  時序  

FPGA學(xué)習(xí)的四大誤區(qū)

  • FPGA學(xué)習(xí)的四大誤區(qū)-FPGA為什么是可以編程的？恐怕很多菜鳥不知道，他們也不想知道。因為他們覺得這是無關(guān)緊要的。他們潛意識的認(rèn)為可編程嘛，肯定就是像寫軟件一樣啦。軟件編程的思想根深蒂固，看到Verilog或者VHDL就像看到C語言或者其它軟件編程語言一樣。
  • 關(guān)鍵字： FPGA  可編程邏輯  

在FPGA開發(fā)中盡量避免全局復(fù)位的使用？（2）

  • 在FPGA開發(fā)中盡量避免全局復(fù)位的使用？（2）-在Xilinx 的FPGA器件中，全局的復(fù)位/置位信號（Global Set/Reset (GSR)）（可以通過全局復(fù)位管腳引入）是幾乎絕對可靠的，因為它是芯片內(nèi)部的信號。
  • 關(guān)鍵字： FPGA  

如何使用腳本對Xilinx FPGA編程

  • 如何使用腳本對Xilinx FPGA編程-最近在做一個GUI的項目，想試著用FPGA實現(xiàn)一個簡單的GUI。硬件基本模塊和整個硬件系統(tǒng)已經(jīng)完成設(shè)計，但是軟件程序上還處在調(diào)試階段，由于程序比較大，F(xiàn)PGA內(nèi)部的BRAM已經(jīng)完全不夠用了，只能將運行的程序放到DDR DRAM中
  • 關(guān)鍵字： GUI  FPGA  Xilinx  

FPGA全局時鐘和第二全局時鐘資源的使用方法

  • FPGA全局時鐘和第二全局時鐘資源的使用方法-目前,大型設(shè)計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發(fā)沿設(shè)計,對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設(shè)計的要求,一般在FPGA設(shè)計中采用全局時鐘資源驅(qū)動設(shè)計的主時鐘,以達(dá)到最低的時鐘抖動和延遲。
  • 關(guān)鍵字： 全局時鐘  FPGA  賽靈思  

Verilog設(shè)計中的一些避免犯錯的小技巧

  • Verilog設(shè)計中的一些避免犯錯的小技巧-這是一個在設(shè)計中常犯的錯誤列表，這些錯誤常使得你的設(shè)計不可靠或速度較慢，為了提高你的設(shè)計性能和提高速度的可靠性你必須確定你的設(shè)計通過所有的這些檢查。
  • 關(guān)鍵字： FPGA  Verilog  

基于verilog的FPGA編程經(jīng)驗總結(jié)

  • 基于verilog的FPGA編程經(jīng)驗總結(jié)-用了半個多月的ISE，幾乎全是自學(xué)起來的，碰到了很多很多讓人DT好久的小問題，百度也百不到，后來還是都解決了，為了盡量方便以后的剛學(xué)ISE的童鞋不再因為一些小問題而糾結(jié)，把這幾天的經(jīng)驗總結(jié)了一下。好了，廢話不多說，上料！
  • 關(guān)鍵字： verilog  FPGA  

多核處理器會取代FPGA嗎？

  • 多核處理器會取代FPGA嗎？-有人認(rèn)為諸如圖形處理器（GPU）和Tilera處理器等多核處理器在某些應(yīng)用中正逐步替代現(xiàn)場可編程門陳列（FPGA）。理由是這些多核處理器的處理性能要高很多，例如，由于GPU起初主要負(fù)責(zé)圖形繪制，因此，其尤其善于處理單精度（SP）及（某種情況下）雙精度（DP）浮點（FP）運算。
  • 關(guān)鍵字： FPGA  GPU  Tilera  

7 50T 入門級FPGA評估套件上手評測

  • 7 50T 入門級FPGA評估套件上手評測-FPGA即現(xiàn)場可編程門陣列，屬于可編程邏輯器件的一種。隨著工藝的進步和EDA設(shè)計工具的不斷發(fā)展，F(xiàn)PGA的門檻（學(xué)習(xí)成本和價格成本）也越來越低，目前已經(jīng)成為實現(xiàn)數(shù)字系統(tǒng)的主流平臺之一。
  • 關(guān)鍵字： FPGA  可編程邏輯  Xilinx  

FPGA的快速入門經(jīng)驗談（part1）

  • FPGA的快速入門經(jīng)驗談（part1）-有很多年輕人，被割裂了歷史，被荒廢了未來，迷茫， 迷茫到幾乎絕望，不過，他們還年輕，青春尚存，還有創(chuàng)造力，還有奮斗的資本，其中不乏不甘心被拋棄，被覆蓋之人。
  • 關(guān)鍵字： FPGA  單片機  

FPGA開發(fā)技巧之同步復(fù)位與異步復(fù)位的理解

  • FPGA開發(fā)技巧之同步復(fù)位與異步復(fù)位的理解-前兩天和師兄討論了一下design rule其中提到了同步異步復(fù)位的比較這個常見問題，據(jù)說也是IC公司經(jīng)常問到的一面試題。
  • 關(guān)鍵字： FPGA  同步復(fù)位  異步復(fù)位  

詳細(xì)圖解在NetFPGA上創(chuàng)建一個OpenFlow Switch的網(wǎng)絡(luò)

  • 詳細(xì)圖解在NetFPGA上創(chuàng)建一個OpenFlow Switch的網(wǎng)絡(luò)-Author: KiKiCompany：Digilent ChinaEmail : Date: 2012.02.14 目的 如 圖所示，我們會創(chuàng)建一個基于OpenFlow Switch的網(wǎng)絡(luò)。
  • 關(guān)鍵字： FPGA  NetFPGA  
共6991條 51/467 |‹ « 49 50 51 52 53 54 55 56 57 58 » ›|

cpld／fpga介紹

您好，目前還沒有人創(chuàng)建詞條cpld／fpga!
歡迎您創(chuàng)建該詞條，闡述對cpld／fpga的理解，并與今后在此搜索cpld／fpga的朋友們分享。    創(chuàng)建詞條

熱門主題

樹莓派    linux   
關(guān)于我們 - 廣告服務(wù) - 企業(yè)會員服務(wù) - 網(wǎng)站地圖 - 聯(lián)系我們 - 征稿 - 友情鏈接 - 手機EEPW
Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《電子產(chǎn)品世界》雜志社 版權(quán)所有 北京東曉國際技術(shù)信息咨詢有限公司
備案 京ICP備12027778號-2 北京市公安局備案：1101082052    京公網(wǎng)安備11010802012473