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ISA總線實(shí)現(xiàn)多路同步DDS信號(hào)源設(shè)計(jì)

  • ISA總線實(shí)現(xiàn)多路同步DDS信號(hào)源設(shè)計(jì), 直接數(shù)字式頻率合成器以其極高的頻率分辨率、極短的頻率轉(zhuǎn)換時(shí)間、相位精確可調(diào)、設(shè)備結(jié)構(gòu)簡(jiǎn)單、易集成、體積小及成本低等優(yōu)點(diǎn)，在高分辨雷達(dá)系統(tǒng)、寬帶擴(kuò)頻通信系統(tǒng)以及現(xiàn)代測(cè)控系統(tǒng)中得到廣泛的應(yīng)用。為了便于信息
  • 關(guān)鍵字： 信號(hào)源  設(shè)計(jì)  DDS  同步  總線  實(shí)現(xiàn)  ISA  

基于FPGA的DDS勵(lì)磁恒流源設(shè)計(jì)

  • 目前勵(lì)磁電源信號(hào)發(fā)生部分通常采用直接頻率合成技術(shù)，主要功能電路由壓控振蕩器(VCO)、倍頻器、分頻器、混頻...
  • 關(guān)鍵字： DDS  勵(lì)磁恒流源  

基于DDS+PLL技術(shù)的頻率合成器的設(shè)計(jì)

  • 基于DDS+PLL技術(shù)的頻率合成器的設(shè)計(jì),摘要：介紹了一種頻率合成技術(shù)的設(shè)計(jì)與實(shí)現(xiàn)，基于DDS與PLL的技術(shù)產(chǎn)生高頻信號(hào)頻率。該頻率合成器由高性能DDS芯片AD9852與鎖相環(huán)芯片ADF4360-7構(gòu)成。該方案控制簡(jiǎn)單、編程靈活、可靠性高，且產(chǎn)生的信號(hào)具有輸出頻率高
  • 關(guān)鍵字： 合成器  設(shè)計(jì)  頻率  技術(shù)  DDS  PLL  基于  

基于DDS的勵(lì)磁恒流源設(shè)計(jì)

  • 摘要 針對(duì)某型磁性材料性能測(cè)試儀激勵(lì)恒流源的具體要求，采用了基于直接數(shù)字頻率合成技術(shù)的信號(hào)發(fā)生器設(shè)計(jì)方法，重點(diǎn)研究了由FPGA設(shè)計(jì)DDS信號(hào)發(fā)生器的系統(tǒng)設(shè)計(jì)原理、硬件構(gòu)成，以及在Quartus開發(fā)環(huán)境下。采用硬件描述
  • 關(guān)鍵字： 設(shè)計(jì)  勵(lì)磁  DDS  基于  

一種新的實(shí)現(xiàn)DDS的AVR信號(hào)發(fā)生器(原理圖和PCB圖)

  • 一種新的實(shí)現(xiàn)DDS的AVR信號(hào)發(fā)生器(原理圖和PCB圖),這是一個(gè)AVR DDS信號(hào)發(fā)生器V2.0新的實(shí)施，已經(jīng)在scienceprog.com出版。 很明顯，對(duì)于原原理圖和固件完全歸功于它的原創(chuàng)者。這里呈現(xiàn)的是一個(gè)不同的PCB，結(jié)構(gòu)緊湊，單只通孔，便于建筑構(gòu)件片面的。函數(shù)發(fā)生器有兩個(gè)BN
  • 關(guān)鍵字： 原理  PCB  信號(hào)發(fā)生器  AVR  DDS  實(shí)現(xiàn)  

ADI 新型 PLL 頻率合成器問世

  • Analog Devices, Inc. (ADI)，全球領(lǐng)先的高性能信號(hào)處理解決方案和 RF IC 供應(yīng)商，最近推出一款用于無(wú)線通信系統(tǒng)的 PLL（鎖相環(huán)）頻率合成器 ADF4351，它實(shí)現(xiàn)了集成度、性能、靈活性與頻率范圍的業(yè)界最佳組合。就單個(gè) RF器件而言，它支持最寬的連續(xù)頻率范圍。
  • 關(guān)鍵字： ADI  PLL  

GPS接收機(jī)載波跟蹤環(huán)路解決方案

  • 0引言隨著GPS衛(wèi)星應(yīng)用產(chǎn)業(yè)化進(jìn)程的逐步發(fā)展，對(duì)導(dǎo)航接收機(jī)關(guān)鍵技術(shù)的攻關(guān)必將縮短衛(wèi)星導(dǎo)航終端產(chǎn)品的研發(fā)...
  • 關(guān)鍵字： GPS接收機(jī)  載波跟蹤  Matlab  FLL  PLL  

基于單片機(jī)和DDS的高精度頻率信號(hào)實(shí)現(xiàn)

  • 介紹了專用DDS芯片AD9854的特性和工作原理，敘述了利用該芯片設(shè)計(jì)高精度頻率信號(hào)發(fā)生器的簡(jiǎn)易方法，并給出了MCS51系列單片機(jī)與AD9854的硬件接口設(shè)計(jì)和軟件編程方法。關(guān)鍵詞：DDS，AD9854，信號(hào)發(fā)生器 高精度的頻率信
  • 關(guān)鍵字： 信號(hào)  實(shí)現(xiàn)  頻率  高精度  單片機(jī)  DDS  基于  

基于DDS的程控信號(hào)發(fā)生器設(shè)計(jì)

  • 摘要：采用了直接數(shù)字頻率合成技術(shù)(DDS)和計(jì)算機(jī)控制技術(shù)，選擇美國(guó)Analog Devices公司的高度集成DDS芯片AD9851和AT89S52單片機(jī)作為控制器件，設(shè)計(jì)了一種基于DDS的程控信號(hào)發(fā)生器。用C語(yǔ)言進(jìn)行了軟件應(yīng)用設(shè)計(jì)。實(shí)驗(yàn)結(jié)
  • 關(guān)鍵字： 設(shè)計(jì)  信號(hào)發(fā)生器  程控  DDS  基于  

基于DDS技術(shù)三相功率可控PWM信號(hào)的FPGA實(shí)現(xiàn)

  • 摘要：本文利用FPGA和DDS技術(shù)實(shí)現(xiàn)了高精度、高分辨率的三相PWM脈沖信號(hào)，并通過AGC程控放大技術(shù)實(shí)現(xiàn)對(duì)PWM信號(hào)的功率可控。本設(shè)計(jì)具有控制靈活，輸出頻率穩(wěn)定和范圍寬等優(yōu)點(diǎn)，具有廣闊的應(yīng)用價(jià)值。
    關(guān)鍵詞：現(xiàn)場(chǎng)可
  • 關(guān)鍵字： FPGA  DDS  PWM  三相功率    

用于AD9834 波形發(fā)生器(DDS)的幅度控制電路

  • 電路功能與優(yōu)勢(shì) 圖 1所示電路提供一種簡(jiǎn)單的方法， 可控制 75 MHz低功耗(20 mW)波形發(fā)生器(DDS) AD9834的 ...
  • 關(guān)鍵字： 實(shí)驗(yàn)室電路  AD9834  DDS  

基于FPGA和DDS技術(shù)的軟件無(wú)線電可控?cái)?shù)字調(diào)制器的

  • 0引言軟件無(wú)線電是在無(wú)線通信領(lǐng)域提出的一種新的通信系統(tǒng)體系結(jié)構(gòu)，其核心思想是以開放性、標(biāo)準(zhǔn)化、模...
  • 關(guān)鍵字： 軟件無(wú)線電  DDS  

基于CORDIC改進(jìn)算法的DDS設(shè)計(jì)

  • 傳統(tǒng)DDS是由美國(guó)學(xué)者Tierney等提出，采用查找表結(jié)構(gòu)實(shí)現(xiàn)，很難滿足數(shù)字信號(hào)處理領(lǐng)域中高精度、高分辨率、實(shí)時(shí)...
  • 關(guān)鍵字： CORDIC  DDS  

用于以太網(wǎng)物理層時(shí)鐘同步PLL的VCO設(shè)計(jì)

  • 摘要：研究了一種基于以太網(wǎng)物理層時(shí)鐘同步的高帶寬低噪聲壓控振蕩器(VCO)，該VCO采用交叉耦合的電流饑餓型環(huán)形振蕩器，通過級(jí)聯(lián)11級(jí)環(huán)路電路和改善其控制電壓變換電路，優(yōu)化了VCO的輸出頻率范圍以及降低了輸出時(shí)鐘的
  • 關(guān)鍵字： PLL  VCO  設(shè)計(jì)  同步  時(shí)鐘  以太網(wǎng)  物理  用于  
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