fpga：quartusⅡ 文章進(jìn)入fpga：quartusⅡ技術(shù)社區(qū)

基于OpenBus系統(tǒng)的FPGA嵌入式設(shè)計(jì)與實(shí)現(xiàn)

隨著FPGA技術(shù)的發(fā)展，F(xiàn)PGA設(shè)計(jì)已不再只是硬件電路的設(shè)計(jì)，而是包含處理器、外國組件和接口邏輯在內(nèi)的完整數(shù)字系統(tǒng)，同時(shí)在處理器中編程完成嵌入式代碼的FPGA“軟”設(shè)計(jì)。與傳統(tǒng)的主要基于硬件描述語言進(jìn)行FPGA設(shè)計(jì)井發(fā)不同，本文在電路設(shè)計(jì)軟件Altium Desi gner開發(fā)環(huán)境下，結(jié)合Xilinx公司的ISE設(shè)計(jì)軟件，在Altium Designer的創(chuàng)新電子設(shè)計(jì)平臺(tái)NanoBoard 3000上，設(shè)計(jì)實(shí)現(xiàn)了基于Altium Designer特有的系統(tǒng)級(jí)設(shè)計(jì)方法OpenBus系
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基于DSP和FPGA的汽車防撞高速數(shù)據(jù)采集系統(tǒng)

隨著信息技術(shù)的不斷發(fā)展，數(shù)據(jù)采集技術(shù)已成為重要的現(xiàn)代化的工具，并且其應(yīng)用范圍也在不斷擴(kuò)大，在通信、雷達(dá)、醫(yī)療、遙測遙感等領(lǐng)域得到了廣泛的應(yīng)用。本文為了汽車防撞報(bào)警設(shè)備高速信號(hào)處理的目的，采用了DSP和FPGA處理器加上相關(guān)算法，實(shí)現(xiàn)了對激光雷達(dá)回波信號(hào)能夠高速的采集和處理。
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基于FPGA的模糊PID控制器設(shè)計(jì)

針對實(shí)現(xiàn)傳統(tǒng)模糊PID控制器時(shí)，需要建立比例、積分和微分三個(gè)模糊控制器，存在模糊規(guī)則較繁雜、運(yùn)算量大、速度慢等問題，提出了以PD模糊控制器代替P1模糊控制器，采用兩個(gè)PD模糊控制器，并引入FPGA技術(shù)，實(shí)現(xiàn)模糊PID控制器。通過QuartusⅡ和Matlab聯(lián)合仿真，比較了基于FBC和SBC實(shí)現(xiàn)的模糊PID控制器的控制效果，驗(yàn)證了設(shè)計(jì)方案的正確性和可行性。
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基于FPGA的相關(guān)測速系統(tǒng)

相關(guān)測速是以隨機(jī)過程的相關(guān)理論和信息理論為基礎(chǔ)發(fā)展起來的[1-2]，它的應(yīng)用始于上世紀(jì)40年代，首先應(yīng)用于軍事上，然后逐漸轉(zhuǎn)移到科學(xué)研究和民用上，現(xiàn)在已經(jīng)在各個(gè)領(lǐng)域內(nèi)得到日益廣泛的應(yīng)用。盡管相關(guān)測速的運(yùn)算量
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基于FPGA的多功能頻率計(jì)的設(shè)計(jì)

基于Altera公司FPGA芯片EP2C8Q208，嵌入MC8051 IP Core，用C語言對MC8051 IP Core進(jìn)行編程，以其作為控制核心，實(shí)現(xiàn)系統(tǒng)控制。在FPGA芯片中，利用Verilog HDL語言進(jìn)行編程，設(shè)計(jì)了以MC8051 IP Core為核心的控制模塊、計(jì)數(shù)模塊、鎖存模塊和LCD顯示模塊等幾部分，實(shí)現(xiàn)了頻率的自動(dòng)測量，測量范圍為0．1Hz～50MHz，測量誤差0．01％。并實(shí)現(xiàn)測頻率、周期、占空比等功能。
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FPGA廠商有哪些？FPGA主要生產(chǎn)廠商簡介

主要介紹FPGA的五大廠商1、XilinxXilinx(賽靈思)是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核
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Qualcomm使用NI VST進(jìn)行802.11ac測試，改進(jìn)測試速度和范圍

就傳統(tǒng)儀器而言，每次測試大約會(huì)取得40個(gè)重要的WLAN收發(fā)器數(shù)據(jù)點(diǎn)。 NI PXI矢量信號(hào)收發(fā)儀的測試速度非?？欤虼四軋?zhí)行完整的增益表掃頻，進(jìn)而采集共300,000個(gè)數(shù)據(jù)點(diǎn)。
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FPGA的寬帶步進(jìn)頻率信號(hào)源設(shè)計(jì)

介紹了基于FPGA和鎖相頻率合成器芯片ADF4350的寬帶步進(jìn)頻率信號(hào)源的設(shè)計(jì)與實(shí)現(xiàn)方法。通過分析兩種不同的實(shí)現(xiàn)方法，確定了以DDS輸出的掃描頻率控制鎖相環(huán)鑒相參考頻率的方法。該方法能有效結(jié)合二者優(yōu)勢，縮短頻率的穩(wěn)定時(shí)間，降低輸出雜散。通過FPGA的控制、配置，產(chǎn)生了最佳性能的LS波段寬帶步進(jìn)頻率信號(hào)，具有功耗低、集成度高、輸出頻率雜散抑制良好等特點(diǎn)。
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萊迪思iCE FPGA系列的出貨量達(dá)到1千5百萬片

　美國俄勒岡州希爾斯波羅市 - 2012年12月12日 - 萊迪思半導(dǎo)體公司(NASDAQ: LSCC)今日宣布自從2011年12月以來，已經(jīng)發(fā)運(yùn)了1千5百萬片iCE FPGA器件，包括其標(biāo)志性產(chǎn)品超低密度iCE40 FPGA系列，成為了公司過去十年來出貨最快的產(chǎn)品。這一了不起的數(shù)字反映了iCE40器件正以前所未有的速度獲得移動(dòng)消費(fèi)類應(yīng)用的廣泛采用，這一領(lǐng)域占據(jù)了絕大多數(shù)的器件出貨量。　　萊迪思將在1月8日至11日在拉斯維加斯舉辦的消費(fèi)電子展(CES)上召開一個(gè)&
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Altera發(fā)布業(yè)界首款FPGA自適應(yīng)軟件工具包

　　2012年12月13號(hào)，北京——Altera公司(NASDAQ: ALTR)和ARM (LON: ARM; NASDAQ: ARMH)今天宣布，通過雙方特有協(xié)議，兩家公司聯(lián)合開發(fā)了DS-5嵌入式軟件開發(fā)工具包，實(shí)現(xiàn)了Altera SoC器件的FPGA自適應(yīng)調(diào)試功能。Altera版ARM?開發(fā)Studio 5 (DS-5?)工具包經(jīng)過設(shè)計(jì)，消除了集成雙核CPU子系統(tǒng)與Altera SoC器件中FPGA架構(gòu)的調(diào)試壁壘。ARM體系結(jié)構(gòu)最先進(jìn)的多核調(diào)試器與FPGA邏
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QIC 在縮短大容量FPGA編譯時(shí)間中的作用

前言
按照相對論的理論，時(shí)間也是可以被拉長縮短的，只不過需要巨大的能量支撐著您達(dá)到一個(gè)和光速可比擬的高速度而已。這話說著輕松，你我心里都明白，估計(jì)咱們的有生之年是看不到這樣的情景的hellip;hellip;回到
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IC觀察：安防不僅僅是安全保障

　　安防產(chǎn)業(yè)的發(fā)展可以說是大跨步式發(fā)展。前些年，安防只是一個(gè)熱詞，實(shí)際的應(yīng)用也主要集中在國家和政府層面的安防上。近幾年來，隨著奧運(yùn)會(huì)、世博會(huì)等大型活動(dòng)的助推，安防從概念轉(zhuǎn)向?qū)崒?shí)在在的應(yīng)用，金融系統(tǒng)、航空領(lǐng)域等越來越多的行業(yè)也開始應(yīng)用安防監(jiān)控。　　當(dāng)今，在物聯(lián)網(wǎng)技術(shù)的推動(dòng)下，平安城市、智能交通、智能社區(qū)、智能樓宇、智能家居的建設(shè)正在如火如荼地建設(shè)中，這自然也少不了安防的應(yīng)用。　　不過，安防在這些領(lǐng)域的應(yīng)用，已從傳統(tǒng)的安全監(jiān)控延伸到更加寬泛的層面。　　例如在智能樓宇的安防系統(tǒng)中，建筑的不斷增高帶來
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眾志和達(dá)借助Altera FPGA進(jìn)軍8Gbps光纖通道存儲(chǔ)市場

Altera公司日前宣布，中國信息存儲(chǔ)與數(shù)據(jù)安全領(lǐng)域領(lǐng)先的技術(shù)與服務(wù)提供商無錫眾志和達(dá)存儲(chǔ)技術(shù)股份有限公司(簡稱眾志和達(dá))采用Altera FPGA解決方案構(gòu)建8Gbps光纖通道協(xié)議 (8G Fibre Channel) 存儲(chǔ)，正式進(jìn)軍8GFC存儲(chǔ)市場，也因此成為國內(nèi)唯一一家具備獨(dú)立研發(fā)光纖通道協(xié)議硬核知識(shí)產(chǎn)權(quán)(IP)、自主生產(chǎn)光纖通道協(xié)議主機(jī)總線適配器(HBA)實(shí)力的領(lǐng)先存儲(chǔ)廠商。
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基于FPGA的高階FIR抽取濾波器有效實(shí)現(xiàn)結(jié)構(gòu)

摘要針對高階FIR抽取濾波器直接型結(jié)構(gòu)和多相濾波結(jié)構(gòu)中存在乘法器資源使用較多，導(dǎo)致實(shí)際系統(tǒng)實(shí)現(xiàn)困難的問題，提出了一種適合FPGA實(shí)現(xiàn)的高效多相結(jié)構(gòu)。該結(jié)構(gòu)采用分時(shí)復(fù)用技術(shù)，通過提高FPGA工作時(shí)鐘頻率，對降采樣
關(guān)鍵字： FPGA FIR 抽取濾波器