- 本文主要介紹了虛擬化路由器的結構以及其中的關鍵調度機制的算法和實現，通過多級的調度處理，實現了支持多個可靈活配置，線速轉發(fā)的路由實例的虛擬化路由器。本文所提到虛擬化路由器實際設計名稱為“IsoRouter”，它基于NetFPGA板卡，本文所介紹的調度機制不針對具體某一型號的FPGA，它可以在任何一款FPGA上實現。
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路由器 FPGA
- FPGA設計一個很重要的設計是時序設計，而時序設計的實質就是滿足每一個觸發(fā)器的建立(Setup)/保持(Hold)時間的要求。建立時間(Setup Time)：是指在觸發(fā)器的時鐘信號上升沿到來以前，數據穩(wěn)定不變的時間，如果建立時間
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FPGA 基礎 時序設計
- 邏輯分析儀測試在基于FPGA的LCD顯示控制中的應用摘要：邏輯分析儀作為基礎儀器，應該在基礎數字電路教學中得到廣泛應用。本文介紹了基于FPGA的液晶顯示控制設計方案，通過使用OLA2032B邏輯分析儀，對控制線進行監(jiān)測與
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FPGA LCD 邏輯分析儀 測試
- 摘要：首先介紹了兩種高精度相位差測量算法，一種是基于直接數字頻率合成(DDS)的相關測量法，另一種是基于快速傅里葉變換(FFT)的FFT測量法。其次，通過理論仿真分析兩種算法在不同信噪比和數據長度下的性能，并在此基
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FPGA 高精度 測量算法 相位差
- 現場可編程門陣列(Field Programmable Gate Array，FPGA)可通過用戶軟件編程來配置生成硬件電路，極大提高了電子系統(tǒng)設計中的靈活性和通用性，因而被廣泛應用于航天、通信、醫(yī)療和工控等重要領域。但在空間環(huán)境中，基于SRAM的FPGA容易受SEU(Single Event Upset)和SETs(Single Event Transients)的影響，從而導致系統(tǒng)故障。DMR(Dual Modular Redundancy)和TMR(Triple Modular Redundancy
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乘法器 FPGA
- 0 引 言USB(通用串行總線)是英特爾、微軟、IBM、康柏等公司1994年聯合制定的一種通用串行總線規(guī)范，它解決了與網絡通信問題，而且端口擴展性能好、容易使用。最新的USB2.0支持3種速率：低速1.5 Mbit/s，全速12 Mbit/
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Verilog C68013 68013 FPGA
- 摘要：以單片機和可編程邏輯器件(FPGA)為控制核心，設計了一個程控濾波器，實現了小信號程控放大、程控調整濾波器截止頻率和幅頻特性測試的功能。其中放大模塊由可變增益放大器AD603實現，最大增益60dB，10dB步進可調
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FPGA 程控濾波器
- 摘要：隨著技術的發(fā)展，工業(yè)檢測技術受到人們的重視，其中圖像檢測由于其具有直觀，方便，信息量較全面而使得它在工業(yè)檢測方面具有重要的應用。以FPGA作為控制核心，設計了一個小型圖像采集系統(tǒng)。通過FPGA實現CMOS圖
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USB 系統(tǒng) 設計 采集 數字 FPGA 基于 圖像
- 摘要：為了擴展VME總線和CAN總線的應用范圍，充分利用兩種總線的不同傳輸特點，采用了模塊設計方法，提出一種基于FPGA和MCU的總線轉換方案。該方案給出了FPGA與上位VME總線部分的VME總線接口設計，利用MCU控制CPLD擴
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CAN-VME FPGA MCU 總線
- 摘要：介紹一種基于FPGA的網絡圖像采集處理系統(tǒng)設計，該系統(tǒng)采用單片FPGA，實現了圖像的采集、壓縮和網絡傳輸功能，具有體積小，集成度高，算法升級靈活方便的特點。詳述了模塊的圖像采集邏輯、RAM控制邏輯、壓縮算法
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FPGA 網絡 圖像采集 處理系統(tǒng)
- 引言當前嵌入式系統(tǒng)技術已得到了廣泛應用，但傳統(tǒng)嵌入式系統(tǒng)的人機接口多采用小鍵盤操作的文本菜單方式...
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FPGA 鼠標接口 嵌入式系統(tǒng)
- 針對某些特殊的測試試驗要求測試系統(tǒng)高性能、微體積、低功耗，在存儲測試理論基礎上，進行了動態(tài)存儲測試系...
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FPGA 存儲測試 采樣頻率
- 基于FPGA及嵌入式CPU（NiosⅡ）的TFT-LCD接口設計,摘要：本文介紹了一種基于 FPGA及 NiosII軟核處理器與 TFT-LCD接口的方法。它直接采用 CPU對存貯器的讀寫，實現了對 TFT-LCD屏的實時操作。它具有直接、有效和速度快等特點。該設計使 CPU對 TFT-LCD的控制極其簡單化
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TFT-LCD 接口 設計 Nios CPU FPGA 嵌入式 基于
- 摘要：設計并實現了一種基于FPGA的真隨機數發(fā)生器，利用一對振蕩環(huán)路之間的相位漂移和抖動以及亞穩(wěn)態(tài)作為隨機源，使用線性反饋移位寄存器的輸出與原始序列運算作為后續(xù)處理。在Xilinx Virtex-5平臺的測試實驗中，探討
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FPGA 隨機數發(fā)生器
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