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FPGA的模糊控制交通燈控制方案設(shè)計(jì)
- 摘要：針對(duì)目前交叉路口交通控制信號(hào)燈的綠信比固定不變的問題，提出一種模糊控制的方案。根據(jù)當(dāng)前相位的車流量和當(dāng)前相位與下一相位車流量之差，實(shí)時(shí)控制相位綠信比，縮減車輛在交叉路口的排隊(duì)長(zhǎng)度。綠信比可在FPGA
- 關(guān)鍵字： FPGA 模糊控制 交通燈控制 方案設(shè)計(jì)
新型數(shù)據(jù)格式轉(zhuǎn)換的FPGA實(shí)現(xiàn)
- 新型數(shù)據(jù)格式轉(zhuǎn)換的FPGA實(shí)現(xiàn),引言 浮點(diǎn)運(yùn)算作為數(shù)字信號(hào)處理中最常見的運(yùn)算之一，各大EDA軟件都帶有免費(fèi)的浮點(diǎn)運(yùn)算IP核。通過對(duì)IP核的生成和例化來(lái)實(shí)現(xiàn)浮點(diǎn)運(yùn)算，把FPGA設(shè)計(jì)者從繁重的代碼編寫中解脫了出來(lái)，同時(shí)可以對(duì)IP核進(jìn)行功能剪裁以避免
- 關(guān)鍵字： FPGA 實(shí)現(xiàn) 轉(zhuǎn)換 格式 數(shù)據(jù) 新型
Xilinx助力有線電視運(yùn)營(yíng)商打造面向未來(lái)的前端系統(tǒng)
- 全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. )在 2011 年 SCTE 有線電視技術(shù)博覽會(huì) (SCTE Cable-Tec Expo 2011)上演示了有線電視行業(yè)第一個(gè)用單個(gè) RF 端口支持多達(dá) 160 個(gè)正交幅度調(diào)制 (QAM )信道的方案，該方案是在基于賽靈思 28nm 7 系列 FPGA上實(shí)現(xiàn)的。該技術(shù)對(duì)多系統(tǒng)運(yùn)營(yíng)商 (MSO) 通過現(xiàn)有有線電視前端系統(tǒng)提供更豐富的三重播放業(yè)務(wù)至關(guān)重要，同時(shí)也展示了基于 FPGA 的前端設(shè)備可以提供關(guān)鍵的器件和信號(hào)密度，滿足競(jìng)爭(zhēng)激烈的數(shù)據(jù)和內(nèi)容
- 關(guān)鍵字： Xilinx FPGA RF
Altera發(fā)布業(yè)界第一個(gè)面向FPGA的OpenCL計(jì)劃
- Altera公司(NASDAQ: ALTR)今天發(fā)布FPGA和SoC FPGA的開放計(jì)算語(yǔ)言(OpenCL?)標(biāo)準(zhǔn)開發(fā)計(jì)劃。OpenCL標(biāo)準(zhǔn)是基于C語(yǔ)言的開放標(biāo)準(zhǔn)，適用于并行編程。Altera的OpenCL計(jì)劃結(jié)合了FPGA的并行能力以及OpenCL標(biāo)準(zhǔn)，實(shí)現(xiàn)強(qiáng)大的系統(tǒng)加速功能。與使用Verilog或者VHDL等底層硬件描述語(yǔ)言(HDL)的傳統(tǒng)FPGA開發(fā)方法相比，這一混合系統(tǒng)(CPU + FPGA，使用OpenCL標(biāo)準(zhǔn))還具有明顯的產(chǎn)品及時(shí)面市優(yōu)勢(shì)。通過其OpenCL計(jì)劃，Altera與
- 關(guān)鍵字： Altera FPGA
基于51單片機(jī)和FPGA 的人機(jī)交互系統(tǒng)的設(shè)計(jì)
- 摘要： 在儀器儀表電路中，人機(jī)交互界面是必不可少的環(huán)節(jié)。為了解決單純采用單片機(jī)制作的系統(tǒng)功耗高、速度慢、 ...
- 關(guān)鍵字： 51單片機(jī) FPGA 人機(jī)交互系統(tǒng)
Altera發(fā)布業(yè)界第一個(gè)面向FPGA的OpenCL計(jì)劃
- Altera公司今天發(fā)布FPGA和SoC FPGA的開放計(jì)算語(yǔ)言(OpenCL?)標(biāo)準(zhǔn)開發(fā)計(jì)劃。OpenCL標(biāo)準(zhǔn)是基于C語(yǔ)言的開放標(biāo)準(zhǔn)，適用于并行編程。Altera的OpenCL計(jì)劃結(jié)合了FPGA的并行能力以及OpenCL標(biāo)準(zhǔn)，實(shí)現(xiàn)強(qiáng)大的系統(tǒng)加速功能。與使用Verilog或者VHDL等底層硬件描述語(yǔ)言(HDL)的傳統(tǒng)FPGA開發(fā)方法相比，這一混合系統(tǒng)(CPU + FPGA，使用OpenCL標(biāo)準(zhǔn))還具有明顯的產(chǎn)品及時(shí)面市優(yōu)勢(shì)。
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基于FPGA的WALLACE TREE乘法器設(shè)計(jì)
- 摘要：為了使基于FPGA設(shè)計(jì)的信號(hào)處理系統(tǒng)具有更高運(yùn)行速度和具有更優(yōu)化的電路版圖布局布線，提出了一種適用于FPGA結(jié)構(gòu)的改進(jìn)型WALLACE TREE架構(gòu)乘法器。首先討論了基于標(biāo)準(zhǔn)單元3：2壓縮器的改進(jìn)型6：4壓縮器，根據(jù)FP
- 關(guān)鍵字： WALLACE FPGA TREE 乘法器設(shè)計(jì)
一種新的基于FPGA的數(shù)據(jù)格式轉(zhuǎn)換方法
- 摘要：針對(duì)目前多數(shù)的FPGA都支持浮點(diǎn)IP核，卻較少關(guān)注數(shù)據(jù)源獲取的問題，提出了一種數(shù)據(jù)格式轉(zhuǎn)換方法。使用VHDL語(yǔ)言，采用流水線處理方式將ASCII碼所表示的一定范圍內(nèi)的實(shí)數(shù)轉(zhuǎn)換為單精度浮點(diǎn)數(shù)。經(jīng)過ModelSim功能仿真
- 關(guān)鍵字： FPGA 數(shù)據(jù)格式 方法 轉(zhuǎn)換
基于FPGA與ARM的遙測(cè)數(shù)據(jù)網(wǎng)絡(luò)化采集
- 摘要：現(xiàn)有的遙測(cè)接收機(jī)為PCI接口，需安裝在工控機(jī)上使用，為實(shí)現(xiàn)設(shè)備小型化、便攜化，設(shè)計(jì)實(shí)現(xiàn)了小型網(wǎng)絡(luò)接口遙測(cè)解調(diào)模塊，可配合帶有網(wǎng)口的計(jì)算機(jī)使用。采用FPGA進(jìn)行遙測(cè)數(shù)據(jù)的幀同步與IRIG—B時(shí)碼解調(diào)，將接
- 關(guān)鍵字： FPGA ARM 遙測(cè)數(shù)據(jù) 網(wǎng)絡(luò)
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