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Altera Stratix IV FPGA繼續(xù)廣受全球媒體好評

  • 　　Altera公司今天宣布，40-nm Stratix® IV FPGA系列最近榮獲電子編輯媒體的多個(gè)獎(jiǎng)項(xiàng)。Stratix IV系列因其在密度、性能和功耗上的優(yōu)勢，以及在前沿工藝技術(shù)上的領(lǐng)先地位獲得《電子技術(shù)應(yīng)用》、中國電子報(bào)以及《VME和關(guān)鍵系統(tǒng)雜志》(VME and Critical Systems)的編輯的認(rèn)可。Stratix IV FPGA器件自2008年12月開始發(fā)售起，已有10家電子行業(yè)媒體授予它12項(xiàng)產(chǎn)品和技術(shù)獎(jiǎng)。最新的獎(jiǎng)項(xiàng)包括： 《電子技術(shù)應(yīng)用》雜志授予Strati
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利用串行RapidIO實(shí)現(xiàn)FPGA協(xié)處理

  • 為了支持“三重播放”應(yīng)用，人們對高速通信和超快速計(jì)算的需求日益增大，這向系統(tǒng)開發(fā)師、算法開發(fā)師和硬件工程師等人員提出了新的挑戰(zhàn)，要求他們將各種標(biāo)準(zhǔn)、組件和聯(lián)網(wǎng)設(shè)備融合成一個(gè)整體
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將MicroTCA導(dǎo)入無線基帶設(shè)計(jì)

  • MicroTCA正在成為嵌入信號處理應(yīng)用，尤其是高性能的多處理器系統(tǒng)中日益普及的標(biāo)準(zhǔn)。這些標(biāo)準(zhǔn)采用了可滿足“運(yùn)營商級”電信設(shè)備需求的先進(jìn)中間卡（AdvancedMC），從而找到了進(jìn)入電信應(yīng)用的途徑，如無線基帶處理。
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如何有效地管理FPGA設(shè)計(jì)中的時(shí)序問題

  • 一、摘要 從簡單SRAM接口到高速同步接口，TimingDesigner軟件允許設(shè)計(jì)者在設(shè)計(jì)流程的初期就判斷出潛在的時(shí)序問題，盡最大可能在第一時(shí)間解決時(shí)序問題。在設(shè)計(jì)過程的早期檢測到時(shí)序問題，不僅節(jié)省時(shí)間，而且可以更
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DSP和FPGA在汽車電子中的廣泛應(yīng)用

  • 1 　引言　　20世紀(jì)末，全球范圍內(nèi)興起的信息革命浪潮，為汽車工業(yè)的突破性發(fā)展提供了千載難逢的機(jī)遇，信息技術(shù)的廣泛應(yīng)用是解決汽車帶來的諸如交通擁擠、交通安全、環(huán)境污染、能源枯竭等問題的最佳途徑。同時(shí)，隨著
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基于Nios II DTMB單頻網(wǎng)適配器設(shè)計(jì)

  • 1 引言 作為地面數(shù)字電視的組網(wǎng)方式之一，單頻網(wǎng)(SingleFrequendy Network，SFN)具有節(jié)省頻率資源和能實(shí)現(xiàn)大范圍無線覆蓋的特點(diǎn)，在世界各地得到廣泛應(yīng)用。組建單頻網(wǎng)要解決的一個(gè)難題是發(fā)射機(jī)的同步問題，為
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理解FPGA中的壓穩(wěn)態(tài)及計(jì)算壓穩(wěn)態(tài)的方法

  • 本白皮書介紹FPGA中的壓穩(wěn)態(tài)，為什么會出現(xiàn)這一現(xiàn)象，它是怎樣導(dǎo)致設(shè)計(jì)失敗的。介紹怎樣計(jì)算壓穩(wěn)態(tài)MTBF，重...
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基于FPGA的高速定點(diǎn)FFT算法的設(shè)計(jì)方案

  • 基于FPGA的高速定點(diǎn)FFT算法的設(shè)計(jì)方案,引 言
    快速傅里葉變換(FFT)作為計(jì)算和分析工具，在眾多學(xué)科領(lǐng)域(如信號處理、圖像處理、生物信息學(xué)、計(jì)算物理、應(yīng)用數(shù)學(xué)等)有著廣泛的應(yīng)用。在高速數(shù)字信號處理領(lǐng)域，如雷達(dá)信號處理，F(xiàn)FT的處理速度往往是整個(gè)系
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基于Nios II的多媒體廣告系統(tǒng)原理設(shè)計(jì)

  • 基于Nios II的多媒體廣告系統(tǒng)原理設(shè)計(jì), 引言
    多媒體廣告是當(dāng)今企業(yè)與消費(fèi)者交流、展示自我形象的一個(gè)平臺，傳統(tǒng)形式的廣告業(yè)務(wù)制作成本高，周期長，內(nèi)容模式固化僵硬，相對于市場變化有很大滯后性。電子屏的出現(xiàn)，不僅可以使企業(yè)更全面的展示產(chǎn)品，推
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基于FPGA的光電抗干擾電路設(shè)計(jì)方案

  • 基于FPGA的光電抗干擾電路設(shè)計(jì)方案,光電靶的基本原理是：當(dāng)光幕內(nèi)的光通量發(fā)生足夠大的變化時(shí)，光電傳感器會響應(yīng)這種變化而產(chǎn)生電信號。這就是說，一些非彈丸物體在穿過光幕時(shí)也會使得光幕內(nèi)光通量發(fā)生變化以至光電傳感器產(chǎn)生電信號。從原理上，這種現(xiàn)
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基于FPGA和DDS的信號源研究與設(shè)計(jì)

  • 1引言直接數(shù)字頻率合成DDS(DirectDigitalSynthesizer)是基于奈奎斯特抽樣定理理論和現(xiàn)代器件生...
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高速流水線浮點(diǎn)加法器的FPGA實(shí)現(xiàn)

  • 0引言現(xiàn)代信號處理技術(shù)通常都需要進(jìn)行大量高速浮點(diǎn)運(yùn)算。由于浮點(diǎn)數(shù)系統(tǒng)操作比較復(fù)雜，需要專用硬...
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FPGA硬件系統(tǒng)的調(diào)試方法

  • FPGA硬件系統(tǒng)的調(diào)試方法,在調(diào)試FPGA電路時(shí)要遵循一定的原則和技巧，才能減少調(diào)試時(shí)間，避免誤操作損壞電路。一般情況下，可以參考以下步驟進(jìn)行FPGA硬件系統(tǒng)的調(diào)試。
    （1）首先在焊接硬件電路時(shí)，只焊接電源部分。使用萬用表進(jìn)行測試，排除電
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FC-AL系統(tǒng)中FPGA的彈性緩存設(shè)計(jì)

  • 引 言一個(gè)簡化的異步數(shù)據(jù)通信系統(tǒng)如圖1所示。接收機(jī)端從接收到的來自串行鏈路的比特流中提取時(shí)鐘信號Clk1，作為其工作時(shí)鐘源；而發(fā)送機(jī)端采用本地晶振和鎖相環(huán)產(chǎn)生的時(shí)鐘Clk2，作為其工作時(shí)鐘源。接收機(jī)在時(shí)鐘Clk1的
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