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基于ARM＋FPGA的重構(gòu)控制器設(shè)計(jì)

  • 基于ARM＋FPGA的重構(gòu)控制器設(shè)計(jì), 可重構(gòu)技術(shù)是指利用可重用的軟硬件資源，根據(jù)不同的應(yīng)用需求，靈活地改變自身體系結(jié)構(gòu)的設(shè)計(jì)方法。常規(guī)SRAM工藝的FPGA都可以實(shí)現(xiàn)重構(gòu)，利用硬件復(fù)用原理，本文設(shè)計(jì)的可重構(gòu)控制器采用ARM核微控制器作為主控制器
  • 關(guān)鍵字： 控制器  重構(gòu)  設(shè)計(jì)  需求  不同  作為  FPGA  可以  靈活  系統(tǒng)  

基于FPGA的可編程衰減器設(shè)計(jì)

  • 引言可編程衰減器位于基站和終端之間，通過對(duì)射頻信號(hào)的衰減控制，實(shí)現(xiàn)對(duì)無線信號(hào)的模擬，從而實(shí)現(xiàn)對(duì)測(cè)試場(chǎng)景的模擬?？删幊趟p器提供多個(gè)數(shù)控接口，從小到大可以構(gòu)建各個(gè)層次的測(cè)試網(wǎng)絡(luò)。所構(gòu)成的衰減矩陣通過模擬
  • 關(guān)鍵字： FPGA  可編程  衰減器    

基于DSP的PWM整流技術(shù)方案

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： DSP  PWM  整流技術(shù)  

X-fest研討會(huì)將于7月登陸亞洲

  • 安富利公司 (NYSE: AVT) 旗下安富利電子元件亞洲 (Avnet Electronics Marketing Asia)與賽靈思公司 (NASDAQ: XLX) 日前宣布啟動(dòng)亞洲區(qū)X-fest 研討會(huì)注冊(cè)。X-fest 是深受 FPGA、DSP 和嵌入式系統(tǒng)開發(fā)人員歡迎的、為期一天的培訓(xùn)活動(dòng)。
  • 關(guān)鍵字： 賽靈思  FPGA  X-fest  

基于FPGA技術(shù)的存儲(chǔ)器設(shè)計(jì)及其應(yīng)用

  • 基于FPGA技術(shù)的存儲(chǔ)器設(shè)計(jì)及其應(yīng)用,復(fù)雜可編程邏輯器件—FPGA技術(shù)在近幾年的電子設(shè)計(jì)中應(yīng)用越來越廣泛。FPGA具有的硬件邏輯可編程性、大容量、高速、內(nèi)嵌存儲(chǔ)陣列等特點(diǎn)使其特別適合于高速數(shù)據(jù)采集、復(fù)雜控制邏輯、精確時(shí)序邏輯等場(chǎng)合的應(yīng)用。而應(yīng)
  • 關(guān)鍵字： 及其  應(yīng)用  設(shè)計(jì)  存儲(chǔ)器  FPGA  技術(shù)  基于  

基于FPGA的圖像采集模塊設(shè)計(jì)

  • 基于FPGA的圖像采集模塊設(shè)計(jì),1 引言　　圖像采集是圖像處理的前提。圖像采集卡是常用的圖像輸入設(shè)備，通常占用PC機(jī)總線的一個(gè)插槽。它主要包括圖像存儲(chǔ)器單元、CCD或CMOS攝像頭接口、PC機(jī)總線接口等。傳統(tǒng)的圖像采集卡大多數(shù)采用 PCI接口，這種圖
  • 關(guān)鍵字： 模塊  設(shè)計(jì)  采集  圖像  FPGA  基于  

基于SH69P42 PWM的10位D／A轉(zhuǎn)換器

  • 基于SH69P42 PWM的10位D／A轉(zhuǎn)換器,1引言提高單片機(jī)片內(nèi)資源的利用率；縮小最終產(chǎn)品的體積，降低功耗，減輕重量，提高集成度，提高可靠性，是單片機(jī)應(yīng)用系統(tǒng)設(shè)計(jì)的基本原則。在單片機(jī)選型時(shí)，由于內(nèi)部資源針對(duì)不同應(yīng)用有多種組合，從而形成了單片機(jī)系列
  • 關(guān)鍵字： 轉(zhuǎn)換器  10位  PWM  SH69P42  基于  

MAX1846/MAX1847高效率PWM反相控制器

  • MAX1846/MAX1847高效率PWM反相控制器能幫助設(shè)計(jì)者在電信及網(wǎng)絡(luò)應(yīng)用中實(shí)現(xiàn)小尺寸、低噪聲、負(fù)電壓輸出的DC-D ...
  • 關(guān)鍵字： MAX1846  MAX1847  高效率  PWM  

FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì)

  • FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì),隨著可編程邏輯器件的不斷進(jìn)步和發(fā)展，F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測(cè)系統(tǒng)中信號(hào)采集模塊控制器的 IP核，是采用硬件描述語言來實(shí)現(xiàn)的。首先它是以ADS8364芯片為控制對(duì)象，結(jié)合
  • 關(guān)鍵字： IP  設(shè)計(jì)  控制器  數(shù)據(jù)采集  高速  通道  FPGA  

采用FPGA解決通信接口問題

  • 采用FPGA解決通信接口問題,引言

    在過去兩年里,用于消除IC、電路板和系統(tǒng)之間數(shù)據(jù)傳輸瓶頸的接口標(biāo)準(zhǔn)層出不窮,本文將考評(píng)通信應(yīng)用標(biāo)準(zhǔn)部件的某些最流行的標(biāo)準(zhǔn),并研究眾多新標(biāo)準(zhǔn)出現(xiàn)的原因,此外還探討設(shè)計(jì)者可如何解決互用性的難題。

    新興
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基于FPGA的中文字符顯示的VHDL程序

  • 基于FPGA的中文字符顯示的VHDL程序,--文件名：lcd_driver.vhd?！　?-功能：FGAD驅(qū)動(dòng)LCD顯示中文字符“年”?！　?-最后修改日期：2004.3.24。　　library IEEE;　　use IEEE.STD_LOGIC_1164.ALL;　　use IEEE.STD_LOGIC_ARITH.ALL;　　use
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用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程

  • 用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程,用VHDL/VerilogHD語言開發(fā)PLD/FPGA的完整流程為：　　1.文本編輯：用任何文本編輯器都可以進(jìn)行，也可以用專用的HDL編輯環(huán)境。通常VHDL文件保存為.vhd文件，Verilog文件保存為.v文件　　2.功能仿真：將文件調(diào)入HDL仿真
  • 關(guān)鍵字： 完整  流程  PLD/FPGA  開發(fā)  語言  VHDL/VerilogHD  

基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì)

  • 基于FPGA的LED電視動(dòng)態(tài)背光系統(tǒng)設(shè)計(jì),本文設(shè)計(jì)一款基于FPGA(現(xiàn)場(chǎng)可編程門陣列)的液晶電視動(dòng)態(tài)背光系統(tǒng)，采用LED側(cè)背光方式，符合當(dāng)前液晶電視LED背光應(yīng)用主流?！　‰娨晞?dòng)態(tài)背光　　以往的電視機(jī)主板將圖像信號(hào)通過LVDS(LowVoltageDifferentialSignal，低
  • 關(guān)鍵字： 背光  系統(tǒng)  設(shè)計(jì)  動(dòng)態(tài)  電視  FPGA  LED  基于  

基于FPGA的IPV6數(shù)字包的分離與封裝的實(shí)現(xiàn)

  • 基于FPGA的IPV6數(shù)字包的分離與封裝的實(shí)現(xiàn),筆者在參加國家“863”重大專題項(xiàng)目“高速密碼芯片及驗(yàn)證平臺(tái)系統(tǒng)”的過程中，遇到了將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分拆開，然后在數(shù)據(jù)部分送密碼芯片進(jìn)行加/解密處理，最后再將處理后的數(shù)據(jù)部分與
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基于FPGA的LVDS高速數(shù)據(jù)通信卡設(shè)計(jì)

  • 摘要 基于FPGA、PCI9054、SDRAM和DDS設(shè)計(jì)了用于某遙測(cè)信號(hào)模擬源的專用板卡。PCI9054實(shí)現(xiàn)與上位機(jī)的數(shù)據(jù)交互，F(xiàn)PGA實(shí)現(xiàn)PCI本地接口轉(zhuǎn)換、數(shù)據(jù)接收發(fā)送控制及DDS芯片的配置。通過WDM驅(qū)動(dòng)程序設(shè)計(jì)及MFC交互界面設(shè)計(jì)，最
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fpga-pwm介紹

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