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EEPW首頁 >> 主題列表 >> fpga-pwm

滿足嵌入式系統(tǒng)應(yīng)用的多核處理器SoC設(shè)計

智能車速度控制系統(tǒng)設(shè)計與實現(xiàn)

  • 　　引言 　　在智能車競賽中，速度控制不能采用單純的PID，而要采用能夠在全加速、緊急制動和閉環(huán)控制等多種模式中平穩(wěn)切換的“多模式”速度控制算法，才能根據(jù)不同的道路狀況迅速準(zhǔn)確地改變車速，實現(xiàn)穩(wěn)定過彎。 　　系統(tǒng)硬件設(shè)計 　　按照競賽要求，本文設(shè)計的智能車速度控制系統(tǒng)，以飛思卡爾MC9S12DG128 單片機(jī)為核心，與車速檢測模塊、直流電機(jī)驅(qū)動模塊、電源模塊等一起構(gòu)成了智能車速度閉環(huán)控制系統(tǒng)。單片機(jī)根據(jù)賽道信息采用合理的控制算法實現(xiàn)對車速的控制，車速檢測采用安裝于車模后軸上的
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德州儀器推出新型 FPGA 擴(kuò)展板

  • 　　日前，德州儀器 (TI) 宣布推出專用于 DK-LM3S9B96 開發(fā)套件的新型 Stellaris FPGA 擴(kuò)展板，可顯著加速開發(fā)低成本安全接入控制系統(tǒng)及其它需要高速外部處理單元接口的應(yīng)用。這款全新電路板使開發(fā)人員能夠輕松評估 Stellaris 微處理器 (MCU) 高靈活性外設(shè)接口 (EPI) 的高帶寬機(jī)器對機(jī)器 (M2M) 并行接口功能。EPI 的 M2M 模式可支持高達(dá) 32 位的數(shù)據(jù)寬度以及高達(dá)每秒 150 MB 的數(shù)據(jù)速率，專用于幫助低成本安全接入控制應(yīng)用的開發(fā)人員將攝像系統(tǒng)或低分辨率
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DNLMS濾波器的FPGA實現(xiàn)

  • 自適應(yīng)濾波器的研究是近年來研究的熱門方向，在PFGA中實現(xiàn)高速的自適應(yīng)濾波器的設(shè)計更是一個熱點，在此采用DSP Builder系統(tǒng)建模的方法，在FPGA中實現(xiàn)了歸一化LMS算法，實驗結(jié)果表明：用DSPBuilder設(shè)計的8階DNLMS算法比用底層的VHDL代碼設(shè)計效率更高，靈活性更大，速度更快。同樣比通用的DSP芯片設(shè)計的8階NLMS濾波器處理速度快了20多倍。如果將8階NLMS濾波器擴(kuò)展到512階或者1 024階，可以很好地應(yīng)用于自適應(yīng)回聲消除等很多自適應(yīng)濾波的領(lǐng)域。
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一種基于FPGA的NoC驗證平臺的構(gòu)建

  • 半導(dǎo)體工藝技術(shù)進(jìn)入深亞微米時代后，基于總線系統(tǒng)芯片SoC(SvstemonChip)的體系結(jié)構(gòu)在物理設(shè)計、通信帶...
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一種基于FPGA的新型數(shù)字電壓表研究與設(shè)計

  • 數(shù)字電壓表是大學(xué)物理教學(xué)和實驗中的重要儀表，其數(shù)字化是指將連續(xù)的模擬電壓量轉(zhuǎn)換成不連續(xù)、離散的數(shù)字...
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AES算法中S-box和列混合單元的優(yōu)化及FPGA技術(shù)實現(xiàn)

  • AES算法中S-box和列混合單元的優(yōu)化及FPGA技術(shù)實現(xiàn),1 S-box的優(yōu)化設(shè)計

    在AES標(biāo)準(zhǔn)算法中定義了兩個較大的列表。S-box和逆S-box。將S-box用于兩個應(yīng)用：字節(jié)替代和密鑰擴(kuò)展。而逆S-box則用于逆字節(jié)替代。這兩個列表是不相同的，因此必須建立兩個不同的ROM(256×8 b)，
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Virtex-6 FPGA ML605開發(fā)評估技術(shù)方案

  • Virtex-6 FPGA ML605開發(fā)評估技術(shù)方案,Virtex-6 FPGA適合用有線通信,無線基礎(chǔ)設(shè)備和廣播設(shè)備等領(lǐng)域.本文介紹了Virtex-6 FPGA主要特性,以及骨干網(wǎng)OTU-4成幀與EFEC框圖, LTE 2x2無線電設(shè)計框圖和支持SD/HD/3G-SDI接口的新一代交換框圖, Virtex®-6 FPGA
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基于FPGA的多路正弦波信號發(fā)生器專用芯片設(shè)計

  • 基于開源思想與SOPC技術(shù)，采用32位開源軟核處理器OR1200和開源軟核DDS，在FPGA上實現(xiàn)了頻率、相位可預(yù)置并且可調(diào)的3路正弦波信號發(fā)生器專用芯片的設(shè)計。該專用芯片基于OR1200固化專用程序?qū)崿F(xiàn)，通過UART傳輸控制數(shù)據(jù)，可同時控制3路正弦波的產(chǎn)生，其頻率范圍為1 Hz~100 MHz，步進(jìn)頻率為1 Hz，相位范圍為0°~359°。設(shè)計方案在DE2-70開發(fā)板上進(jìn)行了實際驗證，證明了設(shè)計的正確性和可行性。
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一種新型光伏控制器PWM控制方法

  • 針對現(xiàn)有光伏控制器控制模式的不足，提出一種精粗調(diào)組合實現(xiàn)的新型PWM精確控制方法，將太陽能電池分成N個獨立的太陽能子陣，只令一路子陣采用PWM控制作為精調(diào)，其余子陣采用普通開關(guān)控制作為粗調(diào)，具有控制電流精度高、穩(wěn)壓效果好、動態(tài)熱損耗小、體積和重量小、成本低、易于實現(xiàn)等優(yōu)點，特別適合大功率應(yīng)用。
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基于CPLD的IEEE1149.1 USB下載電纜設(shè)計

  • 引言隨著片上系統(tǒng)(SoC，SystemonChip)時代的到來，包括復(fù)雜可編程邏輯器件(CPLD，ComplexProgrammab...
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賽靈思ISE 12設(shè)計套件用智能時鐘門控技術(shù)降低動態(tài)功耗30%

  • 　　全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc.)日前推出 ISE 12軟件設(shè)計套件，實現(xiàn)了具有更高設(shè)計生產(chǎn)力的功耗和成本的突破性優(yōu)化。ISE 設(shè)計套件首次利用“智能”時鐘門控技術(shù)，將動態(tài)功耗降低多達(dá) 30%。此外，該新型套件還提供了基于時序的高級設(shè)計保存功能、為即插即用設(shè)計提供符合 AMBA 4 AXI4 規(guī)范的IP支持，同時具備第四代部分重配置功能的直觀設(shè)計流程，可降低多種高性能應(yīng)用的系統(tǒng)成本。 　　在為所有 Xilinx Virtex-6 和 Spartan-
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醫(yī)療電子市場成像設(shè)備占比重最大 FPGA廠商忙于開拓疆土

  • 　　中國國際醫(yī)療器械博覽會的熱度一年勝過一年，今年規(guī)模再創(chuàng)紀(jì)錄。而同期舉辦的第三屆中國國際醫(yī)療電子技術(shù)大會(CMET)則更是吸引了眾多國際半導(dǎo)體公司參加，會議也由以前的一天變?yōu)閮商臁? 　　“醫(yī)療電子市場的年復(fù)合增長率在所在領(lǐng)域中最高，達(dá)14.6%，超過目前也是很火的汽車電子、無線通信等領(lǐng)域，所以大家可以想象它為什么吸引眾多觀眾。”iSuppli資深分析師王仁震解釋，“而中國醫(yī)療電子市場占全球的比例也是逐年增長，2006年只占到4%，但2013年可達(dá)到9%的比重。&rd
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基于FPGA的可調(diào)信號源設(shè)計

  • 針對航天檢測設(shè)備中信號源單一、不可調(diào)等缺點，提出并實現(xiàn)了一種以FPGA 、高速D／A、繼電器AQY210為核心，結(jié)構(gòu)簡單，控制靈活，信號質(zhì)量高的多功能信號源生成系統(tǒng)。該系統(tǒng)可提供各種頻率、幅值、偏置等參數(shù)可調(diào)的模擬信號，成功應(yīng)用于工業(yè)控制開關(guān)量輸出性能檢測。同時，上位機(jī)與硬件通信的接口使用了USB-單片機(jī)（CY7C68013）和USB-FIFO(FT245)兩種方案，并進(jìn)行實際對比，提出其適用條件和范圍。
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基于FPGA的高速HIL仿真器實現(xiàn)電機(jī)控制器測試

  • 電機(jī)在現(xiàn)代生活中扮演著重要角色。出于對安全、成本及效率的考慮，工程師——尤其是混合電動力汽車(HEV)...
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fpga-pwm介紹

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