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一種基于FPGA并行流水線的FIR濾波器設(shè)計方案

  • 1 Fir濾波器原理
    有限沖激響應(yīng)(FIR)數(shù)字濾波器和無限沖激響應(yīng)(IIR)數(shù)字濾波器廣泛應(yīng)用于數(shù)字信號處理系統(tǒng)中。IIR數(shù)字濾波器方便簡單，但它相位的非線性，要求采用全通網(wǎng)絡(luò)進行相位校正，且穩(wěn)定性難以保障。FIR濾
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基于Matlab和FPGA的FIR數(shù)字濾波器設(shè)計及實現(xiàn)

  • 摘要：基于FIR數(shù)字濾波器的原理和層次化、模塊化設(shè)計思想，結(jié)合Altera公司的CycloneII系列FPGA芯片，提出了FIR數(shù)字濾波器的實現(xiàn)硬件方案，給出了采用Matlab、QuartusⅡ設(shè)計及實現(xiàn)32階低通FIR濾波器的方法步驟，仿真及
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2009年3月30日，Altera在天津大學(xué)成立國內(nèi)第60所EDA/SOPC聯(lián)合實驗室

  • 　　Altera公司今天宣布，Altera公司于2009年3月10日在天津大學(xué)成立EDA/SOPC聯(lián)合實驗室。這是Altera自2004年3月在中國電子科技大學(xué)成立首個EDA/SOPC聯(lián)合實驗室以來的國內(nèi)第60所聯(lián)合實驗室和培訓(xùn)中心。該實驗室將為數(shù)字邏輯電路、硬件描述語言、微機原理、電視原理、現(xiàn)代數(shù)字系統(tǒng)設(shè)計等本科或研究生課程的實驗教學(xué)以及電子類課程設(shè)計提供支持，Altera®公司的FPGA開發(fā)環(huán)境將成為貫穿天津大學(xué)電子工程類專業(yè)本科和研究生教育階段的實驗平臺。 　　作為全球領(lǐng)先的可編程邏輯器件
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基于FPGA的高速圖像采集系統(tǒng)設(shè)計

  • 在高速圖像采集系統(tǒng)中，CPU時鐘資源、I／O端口資源、傳輸單元等都成為系統(tǒng)的瓶頸。本系統(tǒng)采用FPGA+RAM+USB的設(shè)計：FPGA硬件采樣模塊，有效降低采樣時延和CPU時鐘資源；獨特的RAM時序控制與讀寫控制分離設(shè)計，增加了模塊之間的獨立性，降低了控制的復(fù)雜度；USB設(shè)計在實現(xiàn)高速率數(shù)據(jù)傳輸?shù)耐瑫r又具有低成本、易安裝等優(yōu)點。
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基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設(shè)

  • 基于ARM和FPGA的聲納波形產(chǎn)生系統(tǒng)設(shè),1、引言　　最佳聲納系統(tǒng)的設(shè)計需要從聲納波形、聲納信道和聲納接收機三方面進行綜合考慮[1]。在聲納信道一定的假設(shè)下，需要設(shè)計最佳聲納波形和最佳接收機，使聲納系統(tǒng)能在給定的聲納環(huán)境中對目標(biāo)有最佳的檢測效果。
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基于DSP Builder的正弦信號源優(yōu)化設(shè)計及其FPGA實現(xiàn)

  • 實現(xiàn)信號源常用的方法是頻率合成法，其中直接數(shù)字頻率合成法是繼直接頻率合成法和間接頻率合成法之后，隨著電子技術(shù)迅速發(fā)展的第三代頻率合成技術(shù)。DDS是一種全數(shù)字技術(shù)，它從相位概念出發(fā)直接合成所需頻率，它具有頻
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USB OTG的IP Core設(shè)計與FPGA驗證

  • 為了實現(xiàn)USB設(shè)備之間的直接通信，介紹一款USB 0TG IP核的設(shè)計與FPGA驗證。在分析OTG補充規(guī)范的基礎(chǔ)上，重點描述了USB OTG IP核的設(shè)計原理、模塊劃分以及每個模塊的功能，然后對USBOTG的部分特性進行詳細的闡述，最后給出該IP核在ModelSim中的功能仿真及FPGA驗證結(jié)果。結(jié)果表明，該IP核具備主機功能和設(shè)備功能，可作為一個獨立的IP模塊應(yīng)用到SoC系統(tǒng)中。
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用 FPGA 產(chǎn)生高斯白噪聲序列的一種快速方法

  • 0 引言 短波信道存在多徑時延、多普勒頻移和擴散、高斯白噪聲干擾等復(fù)雜現(xiàn)象。為了測試短波通信設(shè)備的性能，通常需要進行大量的外場實驗。相比之下，信道模擬器能夠在實驗室環(huán)境下進行類似的性能測試，而且測試費用
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無線基站中的FPGA和DSP組合

  • FPGA和DSP之間的“智能配分”可使無線系統(tǒng)設(shè)計師獲得最佳性能組合和成本――效能。應(yīng)用DSP和FPGA組合可使成本降低。對于無線基站，組合有DSP可編程邏輯的系統(tǒng)配分，可促使更大的產(chǎn)品設(shè)計和市場成功率。更高數(shù)據(jù)率的需
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用FPGA實現(xiàn)數(shù)字電視條件接收系統(tǒng)

  • 摘　要：根據(jù)數(shù)字電視條件接收系統(tǒng)的原理，提出一種ECM在 TS層加入、復(fù)接和條件接收相互獨立的CAS實現(xiàn)方法。ECM在TS層加入，對于TS層加擾來說，易于實現(xiàn)加擾和解擾同步；復(fù)接和條件接收相互分離使條件接收系統(tǒng)實現(xiàn)比
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UWB模塊Wisair DV9110M 配置的FPGA實現(xiàn)

  • 本方法在實際應(yīng)用過程中得到了驗證，能夠穩(wěn)定地代替軟件行使UWB模塊的配置管理功能，并顯著提高了系統(tǒng)性能，極大方便了Wisair DV9110M的研發(fā)應(yīng)用。
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基于SRAM的FPGA連線資源的一種可測性設(shè)計

  • 本文提出在FPGA芯片內(nèi)插入多條移位寄存器鏈的方法，可使測試開關(guān)盒連線資源的時問比傳統(tǒng)的測試方法和已有的一種方法時間上減少了99％以上，大大降低了測試的時間，降低了測試成本，并且消耗的硬件面積比大約在5％左右，在可接受的范圍內(nèi)。
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可編程應(yīng)用的引爆點即將到來

  • 　　25年前，賽靈思(Xilinx)公司發(fā)明了FPGA(現(xiàn)場可編程門陣列)。如今，以FPGA為代表的可編程芯片應(yīng)用已經(jīng)成為勢不可擋的發(fā)展趨勢，尤其在ASSP和傳統(tǒng)ASIC之間出現(xiàn)的市場缺口上，F(xiàn)PGA將開辟出新的領(lǐng)域,而目前席卷全球的金融危機更是成為FPGA迅速發(fā)展的催化劑。
  • 關(guān)鍵字： Xilinx  FPGA  200903  

NI推出新型原型設(shè)計硬件開發(fā)套件

  • 　　美國國家儀器有限公司（National Instruments，簡稱NI）近日宣布推出新款原型設(shè)計硬件開發(fā)套件，方便工程師和科學(xué)家們更快地開展工業(yè)和嵌入式項目的原型開發(fā)，縮短產(chǎn)品的上市時間并且減少開發(fā)成本。最新5款NI CompactRIO可重新配置機箱配備Xilinx Virtex-5現(xiàn)場可編程門陣列（FPGA），它是目前NI硬件中容量最大、運行最快的FPGA。此外，新款NI cRIO-9022控制器配備了飛思卡爾（Freescale） 533 MHz工業(yè)實時處理器，為對時間要求極高的控制應(yīng)用提供更
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Xilinx “可編程之星”征文圓滿落幕反響積極

  • 　　日前，在國內(nèi)嵌入式系統(tǒng)工程師、高校相關(guān)專業(yè)師生以及所有可編程器件設(shè)計愛好者讀者的熱情參與下，由《電子產(chǎn)品世界》雜志社承辦的“賽靈思（Xilinx）‘可編程之星’產(chǎn)品設(shè)計應(yīng)用有獎?wù)魑摹被顒勇湎铝酸∧?，活動取得了極大的成功。經(jīng)過賽靈思公司專家的評審，共在參賽論文中評出6篇最終獲獎?wù)撐?，具體結(jié)果如下。 ?
  • 關(guān)鍵字： Xilinx  FPGA  可編程之星  
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fpga-pwm介紹

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