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基于FPGA的人工神經(jīng)網(wǎng)絡(luò)實現(xiàn)方法的研究
- 基于FPGA的神經(jīng)網(wǎng)絡(luò)實現(xiàn)方法已成為實際實時應(yīng)用神經(jīng)網(wǎng)絡(luò)的一種途徑。本文就十多年來基于FPGA的ANN實現(xiàn)作一個系統(tǒng)的總結(jié),例舉關(guān)鍵的技術(shù)問題,給出詳細的數(shù)據(jù)分析,引用相關(guān)的最新研究成果,對不同的實現(xiàn)方法和思想進行討論分析,并說明存在的問題以及改善方法,強調(diào)神經(jīng)網(wǎng)絡(luò)FPGA實現(xiàn)的發(fā)展方向和潛力及提出自己的想法。另外,還指出基于FPGA實現(xiàn)神經(jīng)網(wǎng)絡(luò)存在的瓶頸制約,最后對今后的研究趨勢作出估計。
- 關(guān)鍵字: FPGA 人工神經(jīng)網(wǎng)絡(luò) 實現(xiàn)方法
TI推出業(yè)界首款帶電池充電功能的無源低頻接口
- 為了提高醫(yī)療、工業(yè)以及消費類電子產(chǎn)品的便捷性,開發(fā)人員不斷致力于提升應(yīng)用的無線功能。日前,德州儀器 (TI) 宣布推出業(yè)界首款無源低頻接口 (PaLFI) 器件,作為新產(chǎn)品系列的第一款解決方案,其能夠以無線方式為超低功耗 MSP430 微處理器 (MCU) 提供能量,使 MCU 即便在備選電池電量都耗盡的情況下也能正常運行。例如,PaLFI 不僅能夠與植入式醫(yī)療設(shè)備進行遠程通信,并且還能為其供電,從而使整個過程盡量實現(xiàn)非介入式治療。除了還適用于眾多其他潛在應(yīng)用外,該器件還適用于流水線作業(yè)或集裝箱跟蹤以
- 關(guān)鍵字: TI 接口 PaLFI MCU MSP430
ARM逐步蠶食工業(yè)市場 專有核心MCU固守優(yōu)勢
- 嵌入式應(yīng)用MCU業(yè)務(wù)被證明是半導(dǎo)體產(chǎn)品市場上一項賺錢的業(yè)務(wù)。根據(jù)市場調(diào)研公司iSuppli的統(tǒng)計,僅僅在中國,目前嵌入式應(yīng)用MCU市場每年都有20億美元左右的規(guī)模。因此,在半導(dǎo)體業(yè)務(wù)增速放緩,經(jīng)濟大環(huán)境并不樂觀的情況下,大多數(shù)擁有MCU業(yè)務(wù)的公司都在加強該項業(yè)務(wù)。而在此過程中,MCU廠商的策略各有不同。 CortexM3拓展消費和工業(yè)市場或?qū)⑿纬扇愣α⒕置? 毫無疑問,基于ARMCortex-M3的MCU產(chǎn)品目前在嵌入式MCU市場掀起了一股熱潮。多家MCU企業(yè)已經(jīng)推出或計劃推出基于該核心的
- 關(guān)鍵字: ARM Cortex MCU
BP神經(jīng)網(wǎng)絡(luò)圖像壓縮算法乘累加單元的FPGA設(shè)計
- 0 引 言
神經(jīng)網(wǎng)絡(luò)(Neural Networks)是人工神經(jīng)網(wǎng)絡(luò)(Ar-tificial Neural Networks)的簡稱,是當(dāng)前的研究熱點之一。人腦在接受視覺感官傳來的大量圖像信息后,能迅速做出反應(yīng),并能在腦海中重現(xiàn)這些圖像信息,這 - 關(guān)鍵字: FPGA BP神經(jīng)網(wǎng)絡(luò) 圖像壓縮 算法
飛思卡爾推出新的S08系列微控制器產(chǎn)品
- 為了滿足家電及其他電器產(chǎn)品對于低功耗微控制器的不斷增長的需求,飛思卡爾半導(dǎo)體公司又進一步擴大了其廣受歡迎的低端8位HCS08微控制器(MCU)系列,推出高性能的MC9S08SV16/8、MC9S08FL16/8系列MCU。這些高度集成微控制器產(chǎn)品采用了8位 HCS08 中央處理單元(CPU),利用小型封裝、低管腳數(shù)的設(shè)計來提高器件的靈活性。 MC9S08SV16/8 8 位 MC9S08SV16/8 (SV16/8) MCU系列提供一流的性能、系統(tǒng)可靠性和設(shè)計靈活性,滿足工業(yè)應(yīng)用的苛刻設(shè)計
- 關(guān)鍵字: 飛思卡爾 MCU S08系列 200911
基于AD7543和FPGA的數(shù)/模轉(zhuǎn)換電路設(shè)計
- 設(shè)計基于AD7543和FPGA的數(shù)/模轉(zhuǎn)換電路,介紹AD7543的主要特點、封裝形式、引腳功能和工作原理,設(shè)計基于AD7543轉(zhuǎn)換芯片的具體的數(shù)/模轉(zhuǎn)換硬件電路,利用Verilog HDL語言描述AD7543的控制時序,并給出具體的Veril-og HDL代碼及其仿真結(jié)果。實踐結(jié)果表明,該設(shè)計可行,可取代傳統(tǒng)的“CPU+專用的數(shù)/模轉(zhuǎn)換(D/A)芯片”設(shè)計結(jié)構(gòu),可進一步提高系統(tǒng)的可靠性和抗干擾能力。
- 關(guān)鍵字: 7543 FPGA AD 模
基于FPGA玻璃缺陷圖像采集處理系統(tǒng)
- 在進行圖像采集過程中,重點需要解決采集系統(tǒng)的實時性問題。而這里選用的多線陣CCD拼接圖像的采集方法勢必導(dǎo)致在低級算法階段會產(chǎn)生極大的數(shù)據(jù)流,應(yīng)用一個高速的嵌入式處理模塊則能很好地完成圖像處理的低級算法部分。在此分析了玻璃缺陷采集處理系統(tǒng)的工作過程,對系統(tǒng)內(nèi)存控制做了詳細的描述,并在FPGA內(nèi)實現(xiàn)了圖像的低級處理,從而使計算機從低級處理的大量數(shù)據(jù)中解脫出來。
- 關(guān)鍵字: FPGA 玻璃 缺陷 處理系統(tǒng)
FIR帶通濾波器的FPGA實現(xiàn)
- 為設(shè)計一個項目可用的FIR數(shù)字帶通濾波器,采用Matlab/Simulink軟件中DSPBulider強大的算法模塊設(shè)計工具,結(jié)合Altera公司的FPGA開發(fā)板實現(xiàn)FIR數(shù)字帶通濾波器的系統(tǒng)集成、RTL級仿真、綜合編譯、下載等設(shè)計流程,并對正弦信號進行濾波,結(jié)果下載到開發(fā)板上用示波器觀測,達到了預(yù)期的濾波效果和目的。基于DSPBuilder完成系統(tǒng)建模,省去了復(fù)雜的VHDL編程,還可針對具體模塊進行參數(shù)設(shè)置從而適應(yīng)不同的濾波需求。該方法實現(xiàn)簡單、可靠,還可類推實現(xiàn)其他復(fù)雜的嵌入式系統(tǒng)設(shè)計。
- 關(guān)鍵字: FPGA FIR 帶通濾波器
基于FPGA嵌入式的多比特自相關(guān)器設(shè)計
- 該設(shè)計利用FPGA的嵌入式軟核NiosⅡ處理器,通過嵌入式操作系統(tǒng)μC/OS-Ⅱ,實現(xiàn)了在FPGA內(nèi)的自相關(guān)計算器;利用FPGA強大的并行運算功能和自帶存儲器實現(xiàn)的“乒乓”RAM,通過軟核NiosⅡ輸出控制字實時切換調(diào)用兩個“乒乓”RAM的存儲和讀取功能,使之同時完成對采集數(shù)據(jù)的緩沖存儲和向乘法器提供計算數(shù)據(jù)的功能,使芯片的整個數(shù)字處理鏈路連續(xù)化。另外,采用多比特進行自相關(guān)運算較之于現(xiàn)在天文臺使用的1 b量化自相關(guān)器,能有效地提高SNR退化比。
- 關(guān)鍵字: FPGA 嵌入式 比特
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