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使用ARM的TrustZone技術(shù)，針對安全和非安全應(yīng)用劃分系統(tǒng)

  • 摘要：隨著ARM Cortex-A9多處理器和FPGA SoC的推出，可把現(xiàn)有的分立微控制器和數(shù)字邏輯功能集成到一個(gè)多核器件中。這減小了功耗和體積，而主要難點(diǎn)之一是在一個(gè)器件中同時(shí)實(shí)現(xiàn)安全關(guān)鍵和非安全關(guān)鍵軟件單元。
  • 關(guān)鍵字： ARM  TrustZone  安全  FPGA  HPS  201309  

了解LabVIEW FPGA和軟件設(shè)計(jì)射頻儀器的優(yōu)勢所在

  • 無線設(shè)備的數(shù)量、通信標(biāo)準(zhǔn)的多樣性，以及調(diào)制方案的復(fù)雜度，每一年都在不斷增加。而隨著每一代新技術(shù)的誕生，由于使用傳統(tǒng)技術(shù)測試無線設(shè)備，需要大量更復(fù)雜的測試設(shè)備，其成本也在不斷提高。
  • 關(guān)鍵字： NI  LabVIEW  FPGA  射頻儀器  CPU  

為汽車無線電和 GPS 提供測試系統(tǒng)

  • 開發(fā)一個(gè)針對汽車無線電和全球定位系統(tǒng)(GPS)接收器的射頻(RF)信號(hào)測試解決方案，減少耗時(shí)且昂貴的現(xiàn)場測試，同時(shí)進(jìn)一步提高設(shè)備的質(zhì)量。
  • 關(guān)鍵字： NI  GPS  IAV  RF  PXI  

基于FPGA的電機(jī)測速系統(tǒng)設(shè)計(jì)

  • 研究的是基于FPGA的電機(jī)測速系統(tǒng)設(shè)計(jì)。該設(shè)計(jì)以有源晶振來產(chǎn)生時(shí)基信號(hào)，利用歐姆龍光電編碼器E682-CWZ6C360P／R將轉(zhuǎn)速信號(hào)轉(zhuǎn)變?yōu)轭l率信號(hào)，采用數(shù)碼管動(dòng)態(tài)顯示來顯示測量所得的數(shù)值。FPGA模塊的編寫是基于Altera公司的Quartus II軟件進(jìn)行編寫的，采用的芯片型號(hào)為EP2C5T144C8N。FPGA模塊是利用VHDL語言進(jìn)行編寫，利用Quartus II軟件自帶的仿真軟件進(jìn)行仿真，通過觀察仿真波形來驗(yàn)證模塊是否正確。本設(shè)計(jì)可以實(shí)現(xiàn)小數(shù)值的方波頻率測量和電機(jī)轉(zhuǎn)速測量。
  • 關(guān)鍵字： FPGA  電機(jī)測速  系統(tǒng)設(shè)計(jì)    

基于FPGA的ASI／SDI碼流播放器的設(shè)計(jì)與實(shí)現(xiàn)

  • 隨著數(shù)字技術(shù)的發(fā)展，數(shù)字產(chǎn)品的普及，各種數(shù)字電視工作人員專用測試工具不斷被開發(fā)。針對碼流播放器的市場需要的目的，采用基于FPGA的系統(tǒng)架構(gòu)的方法，結(jié)合硬件及軟件設(shè)計(jì)等方面內(nèi)容，文中詳細(xì)介紹了一個(gè)包含碼流錄制、碼流播放、碼流分析等多種功能的ASI／SDI碼流播放器的設(shè)計(jì)與實(shí)現(xiàn)的過程。
  • 關(guān)鍵字： FPGA  ASI  SDI  碼流播放器    

基于FPGA的PCI數(shù)據(jù)采集卡設(shè)計(jì)

  • 摘要 論述了基于FPGA的PCI數(shù)據(jù)采集卡設(shè)計(jì)，板卡實(shí)現(xiàn)了查詢、中斷和DMA等多種方式讀取數(shù)據(jù)，可以實(shí)時(shí)采集數(shù)據(jù)、實(shí)現(xiàn)大容量數(shù)據(jù)的緩存，還有效地解決了對數(shù)據(jù)高速采集、傳輸?shù)男枨螅O(shè)計(jì)采用FPGA實(shí)現(xiàn)數(shù)據(jù)采集控制邏輯，
  • 關(guān)鍵字： FPGA  PCI  數(shù)據(jù)采集卡    

基于FPGA的實(shí)時(shí)視頻信號(hào)處理平臺(tái)的設(shè)計(jì)

  • 提出一種基于FPGA的實(shí)時(shí)視頻信號(hào)處理平臺(tái)的設(shè)計(jì)方法，該系統(tǒng)接收低幀率數(shù)字YCbCr視頻信號(hào)，對接收的視頻信號(hào)進(jìn)行格式和彩色空間轉(zhuǎn)換、像素和，利用片外SDRAM存儲(chǔ)器作為幀緩存且通過時(shí)序控制器進(jìn)行幀率提高，最后通過VGA控制模塊對圖像信號(hào)進(jìn)行像素放大并在VGA顯示器上實(shí)時(shí)顯示。整個(gè)設(shè)計(jì)使用Verilog HDL語言實(shí)現(xiàn)，采用Altera公司的EP2S60F1020C3N芯片作為核心器件并對功能進(jìn)行了驗(yàn)證。
  • 關(guān)鍵字： FPGA  實(shí)時(shí)視頻  信號(hào)處理平臺(tái)    

認(rèn)清CPLD和FPGA

  • CPLD和FPGA都是我們經(jīng)常會(huì)用到的器件。有的說有配置芯片的是FPGA，沒有的是CPLD;有的說邏輯資源多的是FPGA，少的是CPLD;有的直接就不做區(qū)分，把他們都叫做FPGA。那么兩者到底有什么區(qū)別呢?下面我們就以Altera公司的CPLD和FPGA為例來說說兩者的區(qū)別。
  • 關(guān)鍵字： CPLD  FPGA  邏輯陣列  LAB單元  Altera  Xilinx  

FPGA最小系統(tǒng)電路分析：高速SDRAM存儲(chǔ)器接口電路設(shè)

  • 高速SDRAM存儲(chǔ)器接口電路設(shè)計(jì)SDRAM可作為軟嵌入式系統(tǒng)的(NIOS II)的程序運(yùn)行空間，或者作為大量數(shù)據(jù)的緩沖區(qū)。SDRAM是通用的存儲(chǔ)設(shè)備，只要容量和數(shù)據(jù)位寬相同，不同公司生產(chǎn)的芯片都是兼容的。一般比較常用的SDRAM
  • 關(guān)鍵字： SDRAM  FPGA  最小系統(tǒng)  電路分析    

FPGA最小系統(tǒng)電路分析：下載配置與調(diào)試接口電路設(shè)

  • 下載配置與調(diào)試接口電路設(shè)計(jì)FPGA是SRAM型結(jié)構(gòu)，本身并不能固化程序。因此FPGA需要一片F(xiàn)lash結(jié)構(gòu)的配置芯片來存儲(chǔ)邏輯配置信息，用于進(jìn)行上電配置。以Altera公司的FPGA為例，配置芯片分為串行(EPCSx系列)和并行(EPCx系
  • 關(guān)鍵字： FPGA  最小系統(tǒng)  電路分析  下載    

FPGA最小系統(tǒng)電路分析之FPGA管腳設(shè)計(jì)

  • FPGA管腳設(shè)計(jì)FPGA的管腳主要包括：用戶I/O(User I/O)、配置管腳、電源、時(shí)鐘及特殊應(yīng)用管腳等。其中有些管腳可有多種用途，所以在設(shè)計(jì)FPGA電路之前，需要認(rèn)真的閱讀相應(yīng)FPGA的芯片手冊。下面以Altera公司的Cyclone系
  • 關(guān)鍵字： FPGA  最小系統(tǒng)  電路分析  管腳    

什么是FPGA最小系統(tǒng)？FPGA最小系統(tǒng)的概念

  • FPGA最小系統(tǒng)是可以使FPGA正常工作的最簡單的系統(tǒng)。它的外圍電路盡量最少，只包括FPGA必要的控制電路。一般所說的FPGA的最小系統(tǒng)主要包括：FPGA芯片、下載電路、外部時(shí)鐘、復(fù)位電路和電源。如果需要使用NIOS II軟嵌
  • 關(guān)鍵字： FPGA  最小系統(tǒng)  概念    

FPGA技術(shù)的發(fā)展歷史和動(dòng)向

  • 1.1 FPGA技術(shù)的發(fā)展歷史和動(dòng)向1.1.1 FPGA技術(shù)的發(fā)展歷史縱觀數(shù)字集成電路的發(fā)展歷史，經(jīng)歷了從電子管、晶體管、小規(guī)模集成電路到大規(guī)模以及超大規(guī)模集成電路等不同的階段。發(fā)展到現(xiàn)在，主要有3類電子器件：存儲(chǔ)器、
  • 關(guān)鍵字： FPGA  發(fā)展    

FPGA最小系統(tǒng)之：實(shí)例2 在Xilinx的FPGA開發(fā)板上運(yùn)行第一個(gè)FPGA程序

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： ISE7.1i  FPGA  Xilinx  FPGA最小系統(tǒng)  

FPGA設(shè)計(jì)經(jīng)驗(yàn)談

  • 從大學(xué)時(shí)代第一次接觸FPGA至今已有10多年的時(shí)間。至今記得當(dāng)初第一次在EDA實(shí)驗(yàn)平臺(tái)上完成數(shù)字秒表，搶答器，密碼鎖等實(shí)驗(yàn)時(shí)，那個(gè)興奮勁。當(dāng)時(shí)由于沒有接觸到HDL硬件描述語言，設(shè)計(jì)都是在MAX+plus II原理圖環(huán)境下用74系列邏輯器件搭建起來的。
  • 關(guān)鍵字： FPGA  EDA  VHDL  Verilog  時(shí)鐘  IP核  
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