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Altera公布第二季度業(yè)績，季度股利增長

  • 　　Altera公司今天宣布，第二季度銷售達到4.693億美元，比2010年第一季度增長17%，比2009年第二季度增長68%。新產(chǎn)品銷售持續(xù)增長36%。2010年第二季度凈收入為1.806億美元，每股攤薄后收益0.58美元，與之相比，2010年第一季度凈收入為1.532億美元，每股攤薄后收益0.50美元，2009年第二季度凈收入達到0.474億美元，每股攤薄后收益為0.16美元。 　　本年度到目前為止，運營現(xiàn)金流為3.786億美元。Altera本季度末流動資金和短期投入達到21億美元。 　　Alte
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賽靈思28納米FPGA明年量產(chǎn)　強攻ASIC陣地

  • 　　現(xiàn)場可編程邏輯閘陣列芯片(FPGA)近年來加速取代特殊應用芯片(ASIC)市場，F(xiàn)PGA雙雄賽靈思(Xilinx)與阿爾特拉(Altera)先后推出28納米FPGA產(chǎn)品，可望加速FPGA取代ASIC市場，賽靈思亞太區(qū)營銷及應用總監(jiān)張宇清指出，28納米FPGA可大幅提升效能，并降低功耗與價格，拓展以往FPGA無法取代的ASIC市場，加速FPGA 市場的成長力道。 　　張宇清指出，F(xiàn)PGA要取代ASIC市場有4大障礙，包括需要提高更大的容量、更高的系統(tǒng)效能、更低的功耗與更低的成本，過去在40納米雖然已有
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FPGA與DSP信號處理系統(tǒng)的散熱設計

  • FPGA與DSP信號處理系統(tǒng)的散熱設計,引言
    隨著系統(tǒng)性能的不斷提升，系統(tǒng)功耗也隨之增大，如何對系統(tǒng)進行有效的散熱，控制系統(tǒng)溫度滿足芯片的正常工作條件變成了一個十分棘手的問題。通常使用風冷技術(shù)對系統(tǒng)進行散熱。采用風冷技術(shù)時要重點考慮散熱
  • 關(guān)鍵字： 散熱  設計  理系  處理  DSP  信號  FPGA  

高速突發(fā)模式誤碼測試儀的FPGA實現(xiàn)方案

  • 摘要：突發(fā)模式誤碼測試儀與一般連續(xù)誤碼測試儀不同，其接收端在誤碼比對前要實現(xiàn)在十幾位內(nèi)，對具有相位跳變特點的信號進行時鐘提取和數(shù)據(jù)恢復，并且在誤碼比對時須濾除前導碼和定界符，僅對有效數(shù)據(jù)進行誤碼統(tǒng)計。
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基于FPGA的UART設計與實現(xiàn)

  • 介紹了應用現(xiàn)場可編程門陣列(FPGA)設計和實現(xiàn)通用異步收發(fā)器UART的方法。采用有限狀態(tài)機模型形式化描述了UART的功能，在此基礎上用硬件描述語言VHDL編程實現(xiàn)了UART，并使用QuartusⅡ軟件中的嵌入式邏輯分析儀SignalTapⅡ?qū)?shù)據(jù)傳輸進行了檢測，驗證了設計的正確性。
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基于FPGA的短波發(fā)射機自動調(diào)諧系統(tǒng)的設計

基于WCDMA速率適配算法的FPGA設計

  • 基于WCDMA速率適配算法的FPGA設計,隨著因特網(wǎng)爆炸性的增長以及各種無線業(yè)務需求的增加，傳統(tǒng)的無線通信網(wǎng)已經(jīng)越來越無法適應人們的需要。因此，以大容量、高數(shù)據(jù)率和承載多媒體業(yè)務為目的的第三代移動通信系統(tǒng)(IMT-2000)應運而生。碼分多址(CDMA)由于
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基于FPGA的8B／10B編解碼設計

  • 摘要：為提高8B／10B編解碼的工作速度和簡化邏輯方法，提出一種基于FPGA的8B／10B編解碼系統(tǒng)設計方案。與現(xiàn)有的8B／10B編解碼方案相比，該方案是一種利用FPGA實現(xiàn)8B／lOB編解碼的模塊方法，接收模塊在收到外部發(fā)送的
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Altera Stratix V FPGA提供RLDRAM 3存儲器支持

  • 　　Altera公司今天發(fā)布Stratix® V系列FPGA，適用于支持Micron技術(shù)公司的下一代低延時DRAM (RLDRAM® 3存儲器)。Stratix V FPGA采用新的存儲器體系結(jié)構(gòu)，降低延時，高效實現(xiàn)FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網(wǎng)絡設備生產(chǎn)商提供存儲器接口解決方案，支持在互聯(lián)網(wǎng)上迅速有效的傳送視頻、語音和數(shù)據(jù)。 　　Micron公司業(yè)務開發(fā)高級經(jīng)理Bruce Franklin表示：“Micron的下一代RLDRAM 3存儲器專門設
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基于FPGA的IRIG-B(DC)碼產(chǎn)生電路設計

  • 摘要：提出了一種IRIG-B(DC)碼產(chǎn)生電路的設計方法。采用Altera公司低功耗Cyclone FPGA系列中的EPlC6T144、8段數(shù)碼管、晶體振蕩器和MAX3232E等器件構(gòu)成硬件電路、使用VHDL語言設計IRIG-B直流時間碼的軟件。為了設置和
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基于FPGA的PCI硬件加解密卡設計

  • 摘要：提出一種基于FPGA的PCI硬件加解密卡的設計方案，用硬件加解密取代了傳統(tǒng)的軟件加解密，將加解密模塊和PCI接口模塊集成在一個FPGA芯片內(nèi)實現(xiàn)。分析了PCI加解密卡的軟硬件的結(jié)構(gòu)和原理，詳細介紹了DESX加解密算法
  • 關(guān)鍵字： FPGA  PCI  硬件  加解密    

基于CPLD／FPGA的CMI編碼設計與實現(xiàn)

  • 根據(jù)CMI碼的特性，介紹了一種新的編程思路實現(xiàn)CMI編碼，在Max+PlusⅡ開發(fā)平臺上使用VHDL編程實現(xiàn)CMI編碼，并得到仿真波形。實驗結(jié)果表明，這種編程思路簡單、清晰。在產(chǎn)生7位偽隨機序列的前提下，分別對“O”，“1”進行編碼。這種思路為其他碼型設計提供了參考。
  • 關(guān)鍵字： CPLD  FPGA  CMI  編碼    

高速移動下OFDM均衡器的FPGA實現(xiàn)

  • 在高速移動下，OFDM系統(tǒng)載波間正交性被破壞，出現(xiàn)載波間干擾(ICI)，嚴重影響系統(tǒng)性能，必須采用適當?shù)木饧夹g(shù)以補償ICI。為了保證通信的有效性和實時性要求，使用FPGA實現(xiàn)了一種低復雜度的最小均方誤差(MMSE)OFDM均衡器算法。在ISE軟件平臺上使用Verilog語言編寫程序，并在Xilinx公司Virtex-2實驗板(XC2V930芯片)上對設計進行了驗證。
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基于FPGA芯片控制全彩LED大屏幕圖像顯示系統(tǒng)系統(tǒng)設計

  • 隨著數(shù)字技術(shù)的飛速發(fā)展，各種數(shù)字顯示屏也隨即涌現(xiàn)出來有l(wèi)ed、LCD、DLP等，各種數(shù)字大屏幕的控制系統(tǒng)多種多樣，有用ARM+FPGA脫機控制系統(tǒng)，也有用PC+DVI接口解碼芯片+FPGA芯片聯(lián)機控制系統(tǒng)，在這里我們講述一種不僅
  • 關(guān)鍵字： 圖像  顯示系統(tǒng)  系統(tǒng)  設計  大屏幕  LED  FPGA  芯片  控制  
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