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EEPW首頁 >> 主題列表 >> rf-fpga

基于FPGA的CCD驅(qū)動設(shè)計

  • 以Atmel公司的面陣CCD-TH7888A圖像傳感器為例，在研究了CCD結(jié)構(gòu)和驅(qū)動時序圖的基礎(chǔ)上提出基于FPGA的驅(qū)動脈沖設(shè)計方法和硬件電路實現(xiàn)。使用VHDL語言對驅(qū)動時序發(fā)生器進(jìn)行了硬件描述，并采用Quartus 5．O對設(shè)計的驅(qū)動時序發(fā)生器進(jìn)行仿真。試驗結(jié)果表明，涉及的驅(qū)動電路可以滿足面陣CCD-TH7888A的各項驅(qū)動要求。
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FPGA易測試性分析

  • FPGA易測試性分析,現(xiàn)代科技對系統(tǒng)的可靠性提出了更高的要求，而FPGA技術(shù)在電子系統(tǒng)中應(yīng)用已經(jīng)非常廣泛，因此FPGA易測試性就變得很重要。要獲得的FPGA內(nèi)部信號十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲，這一切使得設(shè)計調(diào)試和檢驗變
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基于射頻功率放大器的GSM/DCS雙頻段RF射頻前端設(shè)計

  • 本文提出一種新穎的射頻功率放大器電路結(jié)構(gòu)，使用一個射頻功率放大器實現(xiàn)GSM/DCS雙頻段功率放大功能，銳迪科的RDA6218就是采用這種結(jié)構(gòu)。射頻功率放大器管芯由原來的兩個減少為一個，同時此結(jié)構(gòu)射頻功率放大器及輸
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基于FPGA及DSP Builder的VGA接口設(shè)計

  • 基于FPGA及DSP Builder的VGA接口設(shè)計,本文基于DSP Builder的VGA接口設(shè)計方法，對VGA接口時序和系統(tǒng)設(shè)計需求進(jìn)行了介紹，并在硬件平臺下實現(xiàn)一維與二維信號的顯示。

    VGA接口標(biāo)準(zhǔn)

    VGA顯像原理

    顯示器通過光柵掃描的方式，電子束在顯示屏幕上
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基于CPLD的壓電生物傳感器檢測電路設(shè)計

  • 介紹了一種基于復(fù)雜可編程邏輯器件(CPLD)的壓電生物傳感器檢測電路。該檢測電路以高性能CPLD(MAX7128)...
  • 關(guān)鍵字： FPGA  CPLD  生物傳感器  檢測電路  

基于SRAM工藝FPGA的保密性問題

  • 在現(xiàn)代電子系統(tǒng)設(shè)計中，由于可編程邏輯器件的卓越性能、靈活方便的可升級特性，而得到了廣泛的應(yīng)用。由于大規(guī)模高密度可編程邏輯器件多采用SRAM工藝，要求每次上電，對FPGA器件進(jìn)行重配置，這就使得可以通過監(jiān)視配置
  • 關(guān)鍵字： 保密性  問題  FPGA  工藝  SRAM  基于  

基于FPGA的快速9／7整形離散小波變換系統(tǒng)

  • 美國空間數(shù)據(jù)系統(tǒng)咨詢委員會(簡稱CCSDS)于2005年推出一套適用于空間領(lǐng)域的圖像壓縮標(biāo)準(zhǔn)，標(biāo)準(zhǔn)使用了離散...
  • 關(guān)鍵字： 小波變換  FPGA  CCSDS圖像壓縮  

Modbus通信協(xié)議的FPGA實現(xiàn)

  • Modbus協(xié)議是一個應(yīng)用廣泛的工業(yè)現(xiàn)場總線協(xié)議，鑒于其簡單、開放、幀格式緊湊等優(yōu)點，于2008年正式成為我國國家標(biāo)準(zhǔn)。介紹一種通過Cyclone系列FPGA實現(xiàn)Modbus RTU模式的方法，首先給出一個可以通用于Modbus主設(shè)備和從設(shè)備的協(xié)議接口單元，然后基于該接口設(shè)計了一個通用的Modbus從設(shè)備協(xié)處理器。實踐證明該方法能夠滿足工業(yè)環(huán)境的通訊要求，此外，該方法在其他FPGA上也具有一定通用性和推廣價值。
  • 關(guān)鍵字： 實現(xiàn)  FPGA  協(xié)議  通信  Modbus  功率模塊  

軟件無線電設(shè)計中ASIC、FPGA和DSP的選擇

  • ASIC、FPGA和DSP的應(yīng)用領(lǐng)域呈現(xiàn)相互覆蓋的趨勢，使設(shè)計人員必須在軟件無線電結(jié)構(gòu)設(shè)計中重新考慮器件選擇...
  • 關(guān)鍵字： FPGA  ASIC  DSP  軟件無線電  

Altera Stratix V FPGA提供RLDRAM 3存儲器支持

  • 　　Altera公司今天發(fā)布Stratix® V系列FPGA，適用于支持Micron技術(shù)公司的下一代低延時DRAM (RLDRAM® 3存儲器)。Stratix V FPGA采用新的存儲器體系結(jié)構(gòu)，降低延時，高效實現(xiàn)FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網(wǎng)絡(luò)設(shè)備生產(chǎn)商提供存儲器接口解決方案，支持在互聯(lián)網(wǎng)上迅速有效的傳送視頻、語音和數(shù)據(jù)。 　　Micron公司業(yè)務(wù)開發(fā)高級經(jīng)理Bruce Franklin表示：“Micron的下一代RLDRAM 3存儲器專門設(shè)
  • 關(guān)鍵字： Altera  FPGA  Stratix  

ARM920T基于Linux平臺下的FPGA驅(qū)動開發(fā)

  • ARM920T基于Linux平臺下的FPGA驅(qū)動開發(fā),Linux操作系統(tǒng)的全稱是GNU／Linux，它是由GNU工程和Linux內(nèi)核兩個部分共同組成的一個操作系統(tǒng)。該系統(tǒng)中所有組件的源代碼都是自由的，可以有效保護(hù)學(xué)習(xí)成果，因而在嵌入式領(lǐng)域得到了廣泛的應(yīng)用。

    FPGA是英文Field
  • 關(guān)鍵字： 驅(qū)動  開發(fā)  FPGA  平臺  基于  Linux  ARM920T  

基于FPGA的線性卷積的實時實現(xiàn)

  • 摘要：從實際工程應(yīng)用出發(fā)，研究了在基于FPGA上快速傅里葉變換實現(xiàn)線性卷積的方法，并搭建了一個基于Altera的EP2S60硬件處理平臺，利用Altera提供的FFT IP核，在100 MHz系統(tǒng)時鐘下，數(shù)據(jù)吞吐率可達(dá)100 Ms／s，
    關(guān)鍵
  • 關(guān)鍵字： FPGA  線性卷積    

基于FPGA的快速9／7整形離散小波變換系統(tǒng)設(shè)計

  • 摘要：CCSDS圖像數(shù)據(jù)壓縮標(biāo)準(zhǔn)中采用9／7整形離散小波變換為核心算法，該算法結(jié)構(gòu)簡單，易于硬件設(shè)計實現(xiàn)。文中基于FPGA設(shè)計實現(xiàn)了9／7整數(shù)離散小波變換系統(tǒng)，設(shè)計中使用內(nèi)部RAM存儲方式，減小了對存儲器的需求量，同
  • 關(guān)鍵字： FPGA  離散小  波變換  系統(tǒng)設(shè)計    

如何選用軟件無線電結(jié)構(gòu)設(shè)計器件

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： 軟件無線電  ASIC  FPGA  
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