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基于FPGA的多路模擬信號源設(shè)計與實現(xiàn)
- 0引言隨著遙測系統(tǒng)的不斷發(fā)展,系統(tǒng)復(fù)雜程度也隨之提高,因此在終端設(shè)計中,對信號源的頻率穩(wěn)定度、幅...
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展訊連續(xù)四季虧損:靜待TD市場爆發(fā)式增長
- “隨著MTK(聯(lián)發(fā)科)市場份額的進一步擴大,包括展訊在內(nèi)的其他手機芯片廠商的市場被進一步蠶食。” 這是iSuppli中國研究部總監(jiān)王陽對展訊通信二季度虧損千萬美元的解讀。 8月19日,展訊通信發(fā)布了2009年第二季度未經(jīng)審計財務(wù)報告。報告顯示,今年二季度實現(xiàn)總營收1620萬美元,同比下降60%;期內(nèi)凈虧損1310萬美元,而去年同期盈利為260萬美元。 自去年三季度開始,這已經(jīng)是展訊連續(xù)四個季度出現(xiàn)虧損。最為嚴重的去年四季度,展訊一度虧損達5230萬美元。 而前
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用FPGA技術(shù)實現(xiàn)模擬雷達信號
- 前言FPGA(現(xiàn)場可編程門陣列)是由掩膜可編程門陣列和PLD(可編程邏輯器件)演變而來的,并將二者的特性結(jié)合在一起,使FPGA既有掩膜可編程門陣列的高邏輯密度和通用性,又有PLD的可編程特性。FPAG技術(shù)的發(fā)展使得單個
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基于FPGA的AES算法芯片設(shè)計實現(xiàn)
- 引言密碼模塊作為安全保密系統(tǒng)的重要組成部分,其核心任務(wù)就是加密數(shù)據(jù)。分組密碼算法AES以其高效率、低開銷、實現(xiàn)簡單等特點目前被廣泛應(yīng)用于密碼模塊的研制中。密碼模塊一般被設(shè)計成外接在主機串口或并口的一個硬件
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2009年8月20日,Altera與駿龍簽署6個東南亞國家分銷協(xié)議
- Altera公司今天宣布,與駿龍環(huán)球有限公司簽署了6個東南亞國家的分銷協(xié)議。駿龍環(huán)球有限公司現(xiàn)在是Altera在新加坡、馬來西亞、泰國、菲律賓、印度尼西亞和越南的授權(quán)代理商。這一擴展協(xié)議完善了Altera在亞太地區(qū)現(xiàn)有的分銷網(wǎng)絡(luò)。 Altera公司亞太區(qū)副總裁兼董事總經(jīng)理Erhaan Shaikh表示:“我們看到東南亞地區(qū)有強勁的增長,設(shè)計工作也越來越多,相信與駿龍公司簽署擴展協(xié)議會進一步增強對客戶的服務(wù)和技術(shù)支持。駿龍公司優(yōu)秀的銷售和現(xiàn)場應(yīng)用團隊與Altera在中國合作了多年,我相
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FPGA:65nm器件上量低功耗市場興起
- 隨著65nm工藝的應(yīng)用以及更多低功耗技術(shù)的采用,F(xiàn)PGA擁有了更低的成本、更高的性能以及突破性的低耗電量,具備進入更廣泛市場的條件。FPGA從業(yè)者表示,今年FPGA快速增長,而預(yù)計明年仍將是一個增長年。 比拼65nm器件加快45nm研發(fā) 就像兩三年前,可編程邏輯器件領(lǐng)域的兩大廠商在90nm器件上進行大比拼一樣,2007年,這兩家企業(yè)Xilinx和Altera又在新一代技術(shù)節(jié)點65nm器件上開始了競賽。一方面Xilinx宣稱他們比競爭對手領(lǐng)先推出了65nm器件,另一方面Altera則在宣布推
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流水線技術(shù)在基于FPGA的DSP運算中的應(yīng)用研究
- 流水線技術(shù)是FPGA設(shè)計速度優(yōu)化的有效方法之一。通過不同流水線級數(shù)和不同位寬的加法器和乘法器綜合數(shù)據(jù)的對比,說明在用FPGA實現(xiàn)數(shù)字信號處理硬件化運算中流水線技術(shù)的有效性和選擇方法。對流水線應(yīng)用中設(shè)計方法的選擇、流水線首次延時和寄存器觸發(fā)時間、嵌入式存儲器塊的使用、控制流水線和數(shù)據(jù)流水線的劃分等需要注意的關(guān)鍵問題進行了簡要分析。
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基于EDA技術(shù)的FPGA設(shè)計計算機應(yīng)用
- 對傳統(tǒng)電子系統(tǒng)設(shè)計方法與現(xiàn)代電子系統(tǒng)設(shè)計方法進行了比較,引出了基于EDA技術(shù)的現(xiàn)場可編程門陣列(FPGA)電路,提出現(xiàn)場可編程門陣列(FPGA) 是近年來迅速發(fā)展的大規(guī)??删幊虒S眉呻娐?ASIC),在數(shù)字系統(tǒng)設(shè)計和控制電路
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Altera在中國成立第66家聯(lián)合實驗室和培訓(xùn)中心
- Altera公司今天宣布,在北京大學(xué)軟件與微電子學(xué)院無錫產(chǎn)學(xué)院成立新的聯(lián)合實驗室 (EDA/SOPC)。這是Altera與中國大學(xué)一起建立的第66家聯(lián)合實驗室和培訓(xùn)中心。作為Altera全球大學(xué)計劃的一部分,該聯(lián)合實驗室配備了最新的Altera? Quartus? II設(shè)計軟件和40套Altera DE2-70開發(fā)套件,以幫助教師指導(dǎo)學(xué)生進行實踐練習(xí)。 學(xué)院將利用聯(lián)合實驗室完成相關(guān)課程的培訓(xùn),包括數(shù)字邏輯電路、HDL語言、計算機原理、電視原理以及Altera FPGA開發(fā)環(huán)境下的
- 關(guān)鍵字: Altera Quartus 數(shù)字邏輯電路 HDL語言 FPGA
基于FPGA的多路模擬信號源設(shè)計
- 提出了一種基于FPGA的多路模擬量信號源設(shè)計方法。該系統(tǒng)以Altera公司的Cyclone系列EP2C8為核心。它包括多路數(shù)模轉(zhuǎn)換單元、電源隔離、穩(wěn)壓單元及運算放大單元等,實現(xiàn)了電源獨立的不同頻率、不同波形的多路模擬量信號源。主要模塊采用VHDL實現(xiàn),通過合理利用路選通信號對各路模擬量信號進行鎖存,實現(xiàn)了各路數(shù)據(jù)的正確分路,各路模擬量波形輸出,并通過USB接口上傳數(shù)據(jù)并實時顯示,經(jīng)多次測試表明,該系統(tǒng)穩(wěn)定可靠,每路輸出電壓紋波小于30 mV。
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