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基于FPGA的64點(diǎn)FFT處理器設(shè)計(jì)

作者: 時(shí)間:2009-08-25 來(lái)源:網(wǎng)絡(luò) 收藏

0 引 言
DFT作為DSP領(lǐng)域中時(shí)域和頻域轉(zhuǎn)換的基本運(yùn)算,存在運(yùn)算量太大的缺點(diǎn),導(dǎo)致其應(yīng)用受到局限。 DFT快速算法的提出,簡(jiǎn)化了DFT的運(yùn)算過(guò)程,使其在實(shí)時(shí)信號(hào)處理領(lǐng)域中得到廣泛應(yīng)用。實(shí)現(xiàn)的方法包括軟件實(shí)現(xiàn)和硬件實(shí)現(xiàn)兩種。采用軟件實(shí)現(xiàn)的方法存在計(jì)算慢,實(shí)現(xiàn)過(guò)程復(fù)雜等缺點(diǎn),所以目前比較流行的方式是采用硬件實(shí)現(xiàn)FFT。硬件實(shí)現(xiàn)的具體方法可以分為ASIC方法、方法、 DSP方法和通用處理機(jī)方法等。
是20世紀(jì)80年代中期出現(xiàn)的一種新的電子設(shè)計(jì)自動(dòng)化技術(shù),具有集成度高,邏輯實(shí)現(xiàn)能力強(qiáng),設(shè)計(jì)靈活等優(yōu)勢(shì)。在上實(shí)現(xiàn)數(shù)字信號(hào)處理,即用純數(shù)字邏輯進(jìn)行DSP模塊設(shè)計(jì),為高速數(shù)字信號(hào)處理算法提供了實(shí)現(xiàn)途徑。在此,采用FPGA方法設(shè)計(jì)64點(diǎn)FFT。
現(xiàn)有的FFT模塊可以對(duì)多點(diǎn)數(shù)據(jù)進(jìn)行運(yùn)算,但是存在運(yùn)算周期長(zhǎng)。結(jié)構(gòu)復(fù)雜,硬件資源耗費(fèi)大等缺陷。采用64點(diǎn)FFT可以通過(guò)優(yōu)化結(jié)構(gòu)來(lái)快速處理多點(diǎn)數(shù)數(shù)據(jù)。目前設(shè)計(jì)的64點(diǎn)FFT主要采用以專用處理單元取代常規(guī)FFT處理單元的方法,或者按照固定幾何結(jié)構(gòu)設(shè)計(jì)FFT的方法。這里所介紹的64 點(diǎn)FFT處理器是在固定幾何結(jié)構(gòu)設(shè)計(jì)方法的基礎(chǔ)上加以改進(jìn),將輸入的64點(diǎn)數(shù)據(jù)均勻分成8組,并行輸入給FFT運(yùn)算單元,進(jìn)行FFT運(yùn)算。通過(guò)對(duì)蝶形運(yùn)算單元進(jìn)行優(yōu)化設(shè)計(jì),所設(shè)計(jì)的64點(diǎn)FFT處理器模塊較之以往的FFT模塊,節(jié)省了硬件資源,提高了運(yùn)算效率。通過(guò)ModelSim仿真實(shí)驗(yàn)證明,在外部工作時(shí)鐘頻率為40 MHz下,對(duì)隨機(jī)生成的序列進(jìn)行64點(diǎn)FFT運(yùn)算處理,運(yùn)算時(shí)間為10μs,縮短了現(xiàn)有FFT模塊的運(yùn)算時(shí)間。

本文引用地址:http://m.butianyuan.cn/article/191949.htm

1 按頻率抽取的基――4FFT算法原理
對(duì)于序列長(zhǎng)度為N(N為2的整數(shù)次冪)的FFT算法主要有基-2 FFT和基-4 FFT兩種。計(jì)算一次基-2FFT需要二次復(fù)乘和兩次復(fù)加;計(jì)算一次基-4 FFT需要三次復(fù)乘和八次復(fù)加。從運(yùn)算次數(shù)上看,基-2 FFT較為簡(jiǎn)單,但是因?yàn)榛?2 FFT的復(fù)數(shù)運(yùn)算較為復(fù)雜,所以在硬件實(shí)現(xiàn)上反而要比基-4 FFT占用的資源更多。為了滿足對(duì)數(shù)據(jù)高速處理的要求,在此選擇在FP-GA上實(shí)現(xiàn)基-4 FFT的算法。
根據(jù)定義,對(duì)于長(zhǎng)度為N的序列x(N)(0≤N≤N-1),它的DFT可表示為:


式中:WnkN=e-J2π/Nnk稱為旋轉(zhuǎn)因子。直接計(jì)算DFT,需要的計(jì)算量為N2次復(fù)乘和N(N-1)次復(fù)加。當(dāng)N很大時(shí),運(yùn)算量相當(dāng)大,無(wú)法滿足實(shí)時(shí)處理的要求。因此利用旋轉(zhuǎn)因子的對(duì)稱性、周期性和可約性,把長(zhǎng)序列分解成為短序列來(lái)進(jìn)行快速傅里葉變換。
由式(1)可以得到4個(gè)子序列:


利用旋轉(zhuǎn)因子WnkN的特性,如:將A,B,C,D作為復(fù)數(shù)操作數(shù)進(jìn)行運(yùn)算,由式(2)可得簡(jiǎn)化計(jì)算式:


式(3)就是在FPGA上實(shí)現(xiàn)基-4 FFT算法的基本運(yùn)算法則。


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