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CPLD芯片選型（二）

Xilinx CPLD 器件可使用 Foundation 或 ISE 開(kāi)發(fā)軟件進(jìn)行開(kāi)發(fā)設(shè)計(jì)，也可使用專門(mén)針對(duì) CPLD 器件的 Webpack 開(kāi)發(fā)軟件進(jìn)行設(shè)計(jì)。XC9500系列器件分XC9500 5V器件、XC9500XL 3.3V器件和XC9500XV 2.5V器件3種類型，XC9500系列可提供從最簡(jiǎn)單的PAL綜合設(shè)計(jì)到最先進(jìn)的實(shí)時(shí)硬件現(xiàn)場(chǎng)升級(jí)的全套解決方案。
關(guān)鍵字： Xilinx XC9500 CPLD

CPLD芯片選型（一）

經(jīng)過(guò)幾十年的發(fā)展，全球各大開(kāi)發(fā)商和供貨商都開(kāi)發(fā)出了多種可編程邏輯器件 . 比較典型的就是 Xilinx 公司的 FPGA 器件和 Altera 公司的 CPLD 器件系列，他們開(kāi)發(fā)較早，占有大部分市場(chǎng)?在歐洲用 Xilinx 的人多，而 Altera 公司占有日本和亞太地區(qū)的大部分市場(chǎng)，在美國(guó)則是平分秋色。
關(guān)鍵字： Xilinx Altera 芯片選型 CPLD

ISE 12設(shè)計(jì)套件開(kāi)啟FPGA生產(chǎn)力新時(shí)代

賽靈思公司(Xilinx)最新推出的ISE 12軟件設(shè)計(jì)套件，實(shí)現(xiàn)了具有更高設(shè)計(jì)生產(chǎn)力的功耗和成本的突破性優(yōu)化。ISE設(shè)計(jì)套件首次利用“智能”時(shí)鐘門(mén)控技術(shù)，將動(dòng)態(tài)功耗降低多達(dá)30%。此外，該新型套件還提供了基于時(shí)序的高級(jí)設(shè)計(jì)保存功能、為即插即用設(shè)計(jì)提供符合AMBA 4 AXI4 規(guī)范的IP支持，同時(shí)具備第四代部分重配置功能的直觀設(shè)計(jì)流程，可降低多種高性能應(yīng)用的系統(tǒng)成本。
關(guān)鍵字： Xilinx 設(shè)計(jì)套件 FPGA

電子齒輪比在FPGA中的實(shí)現(xiàn)

伺服系統(tǒng)中采用電子齒輪來(lái)匹配指令脈沖當(dāng)量和位置反饋脈沖當(dāng)量。本文分析了電子齒輪的工作原理,提出了一種位置指令脈沖處理電路來(lái)把三種可能的脈沖輸入形式轉(zhuǎn)換成統(tǒng)一的可被接受的形式,并在Xilinx ISE開(kāi)發(fā)環(huán)境下進(jìn)行VHDL編程,用數(shù)字方法實(shí)現(xiàn)了電子齒輪比,最后利用Modelsim軟件仿真驗(yàn)證了該設(shè)計(jì)的正確性和可行性。
關(guān)鍵字：電子齒輪 Xilinx 位置反饋脈沖

數(shù)字WCDMA系統(tǒng)數(shù)字頻域干擾抵消器方案設(shè)計(jì)，硬件架構(gòu)

用FPGA設(shè)計(jì)完成一個(gè)適用于WCDMA系統(tǒng)的干擾抵消器。目前的進(jìn)展情況：有完備的算法資源和測(cè)試數(shù)據(jù)，已經(jīng)開(kāi)始相關(guān)模塊的實(shí)現(xiàn)。
關(guān)鍵字： WCDMA Xilinx 頻域干擾抵消器 VirtexII

生成有效的板支持包

具有嵌入式處理器的平臺(tái) FPGA 為您提供前所未有的靈活性、集成度和高性能。目前，在單個(gè)可編程邏輯設(shè)備中開(kāi)發(fā)極其復(fù)雜且高度定制化的嵌入式系統(tǒng)已成為可能。
關(guān)鍵字： Xilinx BSP Mac FPGA EDK UART MLD

全新EDK8.1簡(jiǎn)化嵌入式設(shè)計(jì)

Platform Studio增強(qiáng)功能使處理器系統(tǒng)開(kāi)發(fā)變得更輕松
關(guān)鍵字： Xilinx PlatformStudio EDK IDE PowerPC FPGA OPB PLB MicroBlaze

【E問(wèn)E答】FPGA門(mén)檻高國(guó)內(nèi)外哪些廠商能玩得轉(zhuǎn)？

　　近幾年，全球半導(dǎo)體行業(yè)的關(guān)鍵詞就是：收購(gòu)、兼并、重組，F(xiàn)PGA領(lǐng)域也發(fā)生了不小的變化。　　三大FPGA(Field-Programmable Gate Array)廠商的收購(gòu)關(guān)閉案：　　Altera(阿爾特拉)：2015年12月，全球第二大FPGA制造商Altera被芯片巨頭英特爾以167億美元完成收購(gòu)，這也是英特爾歷史上最大的一起收購(gòu)。　　Lattice(萊迪思)：2016年4月紫光宣布在公開(kāi)市場(chǎng)收購(gòu)Lattice 6.07%股權(quán)，致使Lattice的股票股價(jià)大漲18%;2016年11月
關(guān)鍵字： FPGA Xilinx

收購(gòu)狂潮過(guò)后的FPGA市場(chǎng)格局

隨著深度學(xué)習(xí)的崛起，F(xiàn)PGA 市場(chǎng)再次風(fēng)起云涌。2015 年掀起了收購(gòu)狂潮，2016 年至今的市場(chǎng)格局有沒(méi)有隨之變化?
關(guān)鍵字： FPGA Xilinx

Xilinx 廣泛部署動(dòng)態(tài)重配置技術(shù)

　　All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx, Inc.)宣布，在今天發(fā)布的Vivado? Design Suite HLx 2017.1版中廣泛納入部分重配置技術(shù)，為有線和無(wú)線網(wǎng)絡(luò)、測(cè)試測(cè)量、航空航天與軍用、汽車以及數(shù)據(jù)中心等豐富應(yīng)用，提供動(dòng)態(tài)的現(xiàn)場(chǎng)升級(jí)優(yōu)勢(shì)和更高的系統(tǒng)集成度。　　動(dòng)態(tài)現(xiàn)場(chǎng)升級(jí)　　利用賽靈思部分重配置技術(shù)，設(shè)計(jì)人員能夠即時(shí)變更器件的功能，無(wú)需全部重配置或重建鏈接，從而大幅提高了All&nb
關(guān)鍵字： Xilinx Vivado

Xilinx用reVISION向視覺(jué)學(xué)習(xí)亮劍

在人工智能、機(jī)器學(xué)習(xí)興起的今天，All Programmable技術(shù)和器件廠商Xilinx也帶來(lái)了爆品，發(fā)布了全新的reVISION堆棧，劍指視覺(jué)導(dǎo)向的機(jī)器學(xué)習(xí)應(yīng)用。該解決方案無(wú)需額外花費(fèi)，搭載Xilinx的Zynq和處理器平臺(tái)即可加速設(shè)計(jì)?？梢钥吹剑ㄟ^(guò)“芯片+軟件堆?！钡牟呗裕琗ilinx把競(jìng)爭(zhēng)矛頭直指圖形芯片廠商——英偉達(dá)的Tegra GPU和ADAS廠商Mobileye等。
關(guān)鍵字： Xilinx reVISION 視覺(jué)導(dǎo)向機(jī)器學(xué)習(xí)

Xilinx 發(fā)布reVISIONTM堆棧的背景資料

　　reVISION: 將全可編程技術(shù)擴(kuò)展至廣泛的視覺(jué)導(dǎo)向機(jī)器學(xué)習(xí)應(yīng)用　　機(jī)器學(xué)習(xí)的應(yīng)用正迅速地?cái)U(kuò)展至越來(lái)越多的終端市場(chǎng)，在用戶端、在云端或者在那些基于端處理與基于云的數(shù)據(jù)分析相結(jié)合的混合解決方案中。面向云應(yīng)用，賽靈思最近推出了可重配置加速堆棧(2016年11月推出)，目標(biāo)直指包括機(jī)器學(xué)習(xí)推斷在內(nèi)的各種計(jì)算加速應(yīng)用。面向端應(yīng)用，賽靈思現(xiàn)在宣布憑借Xilinx? reVISION? 堆棧大幅擴(kuò)展至廣泛的視覺(jué)導(dǎo)向機(jī)器學(xué)習(xí)應(yīng)用。全新的reVISION堆棧能夠支持更廣泛的很少或沒(méi)有硬件
關(guān)鍵字： Xilinx reVISION

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xilinx介紹

Xilinx ZYNQ技術(shù)中心一、Xilinx公司介紹　　Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP（Intellectual Property）核。客戶使用Xilinx及其合作伙伴的自動(dòng)化軟件工具和IP核對(duì)器件進(jìn)行編程，從而完成特定的邏輯操作。Xilinx公司成立于 1984年，Xilinx首創(chuàng)了現(xiàn)場(chǎng)可編程邏輯陣列 [ 查看詳細(xì) ]