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EEPW首頁 >> 主題列表 >> asic-to-fpga

一種使用USB對ADSP_TS101S進(jìn)行鏈路口加載的方案

  • 在DSP系統(tǒng)上運行的程序，系統(tǒng)上電復(fù)位后需要加載程序到DSP的程序存儲器內(nèi)。這是使用外部加載模式時的系統(tǒng)開發(fā)不可缺少的環(huán)節(jié)。針對實際需求，提出了一種使用USB對ADSP_TS101S進(jìn)行鏈路口加載的方案，并介紹了設(shè)計思想和實現(xiàn)過程。實際應(yīng)用的試驗證明，提出的加載方案有效且簡單易行。
  • 關(guān)鍵字： FIFO  程序固化  FPGA  

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：PCI卡的驅(qū)動程序設(shè)計

  • 設(shè)計完成的信號采集設(shè)備在插入計算機(jī)后，在對其進(jìn)行控制之前，需要編寫基于操作系統(tǒng)平臺上的驅(qū)動程序。設(shè)備驅(qū)動程序是一個包含了許多操作系統(tǒng)可調(diào)用例程的容器，這些例程可以使硬件設(shè)備執(zhí)行相應(yīng)的動作，它是硬件與上層軟件之間溝通的橋梁。
  • 關(guān)鍵字： 高速PCI信號采集卡  驅(qū)動程序  WDM驅(qū)動程序  過濾驅(qū)動程序  FPGA  

高速PCI信號采集卡設(shè)計與實現(xiàn)綜合實例之：系統(tǒng)工作原理分析

  • 如前所述，一個完整的信號采集系統(tǒng)，除了具備信號輸入單元、信號處理單元和信號輸出單元外，還需要緩沖區(qū)、時鐘以及電源等相關(guān)系統(tǒng)。如圖13.2所示是本案例信號采集系統(tǒng)的結(jié)構(gòu)框圖。
  • 關(guān)鍵字： 高速PCI信號采集卡  數(shù)據(jù)總線  控制總線  地址總線  FPGA  

利用FPGA實現(xiàn)外設(shè)通信接口之：利用FPGA實現(xiàn)RS-232C串行接口

  • RS-232C標(biāo)準(zhǔn)最初是為遠(yuǎn)程通信連接數(shù)據(jù)終端設(shè)備DTE（Data Terminal Equipment）與數(shù)據(jù)通信設(shè)備DCE（Data Communication Equipment）而制定的。因此這個標(biāo)準(zhǔn)的制定，并未考慮計算機(jī)系統(tǒng)的應(yīng)用要求。
  • 關(guān)鍵字： RS-232C串行接口  UART  FPGA  

數(shù)字圖像倍焦系統(tǒng)設(shè)計與實現(xiàn)綜合實例之：FPGA在其他視頻和圖像處理系統(tǒng)中的應(yīng)用

一種混沌組合序列密碼電路設(shè)計與復(fù)雜度分析方法

  • 在密碼學(xué)領(lǐng)域，利用密碼技術(shù)對傳輸信息進(jìn)行加密發(fā)送、解密接收，是一種行之有效的方法。密碼學(xué)發(fā)展至今已有許多優(yōu)秀的算法發(fā)明并得到應(yīng)用，例如私鑰密碼體制中的DES密碼、IDEA密碼、序列密碼；公鑰密碼體制中的RSA密碼、橢圓曲線密碼等，他們各有設(shè)計特點和對應(yīng)的應(yīng)用領(lǐng)域，其中序列密碼一直是密碼學(xué)中最重要的加密方式之一。利用組合LFSR序列作為序列密碼的前饋電路，可充分利用m序列的良好統(tǒng)計特性和加大輸出序列周期和線性復(fù)雜度的優(yōu)勢，但如何在保證前饋電路輸出統(tǒng)計特性不被破壞的基礎(chǔ)上，置換與混亂輸出關(guān)系，增強(qiáng)密碼的保密性
  • 關(guān)鍵字： 混沌組合序列  密碼電路  復(fù)雜度  密碼技術(shù)  FPGA  

低價位嵌入式處理開發(fā)套件--Spartan-3E 1600E

  • Spartan-3E 1600E 開發(fā)套件支持靈活的 MicroBlaze 軟處理設(shè)計
  • 關(guān)鍵字： LED  DAC  ADC  FPGA  RISC  

PCI Express 的市場、趨勢和應(yīng)用

  • Virtex-5 LXT 器件中內(nèi)置的 PCI Express 解決方案能夠顯著降低功耗和面積。
  • 關(guān)鍵字： PCIExpress  FPGA  

生成有效的板支持包

  • 具有嵌入式處理器的 平臺 FPGA 為您提供前所未有的靈活性、集成度和高性能。目前，在單個可編程邏輯設(shè)備中開發(fā)極其復(fù)雜且高度定制化的嵌入式系統(tǒng)已成為可能。
  • 關(guān)鍵字： Xilinx  BSP  Mac  FPGA  EDK  UART  MLD  

基于ARM+FPGA的食用花生油質(zhì)量快速檢測儀的設(shè)計

  • 采用ARM＋FPGA結(jié)構(gòu)給出一種高性能的便攜式食用花生油質(zhì)量快速分析儀的設(shè)計。將可編程片上系統(tǒng)應(yīng)用到儀器開發(fā)中，簡化系統(tǒng)硬件電路，提高系統(tǒng)設(shè)計靈活性。充分利用ARM芯片的高效控制功能結(jié)合FPGA靈活的多硬件接口模擬特性，便于攜帶，適合現(xiàn)場免化學(xué)試劑快速檢測。
  • 關(guān)鍵字： ARM  檢測儀  FPGA  

全新EDK8.1簡化嵌入式設(shè)計

面向 FPGA 的 ESL 工具

  • 幫助軟件開發(fā)者進(jìn)行可編程硬件設(shè)計
  • 關(guān)鍵字： ESL  FPGA  

MATLAB 算法面向 FPGA 的浮點定點轉(zhuǎn)換

基于CCD16點數(shù)學(xué)模型的全自動焦度計光學(xué)圖像系統(tǒng)的設(shè)計

  • 全自動焦度儀光學(xué)系統(tǒng)是產(chǎn)品設(shè)計的核心，為了提高自動焦度計的測量精度，提出一種新的測量圖像。該圖像在建立了16點數(shù)學(xué)模型并推導(dǎo)了鏡片相關(guān)參數(shù)的計算方法。該算法將16個點分為四組進(jìn)行計算，并取各組計算結(jié)果
  • 關(guān)鍵字： 自動焦度計  16點數(shù)學(xué)模型  FPGA  面陣CCD  

在選用FPGA進(jìn)行設(shè)計時如何降低功耗

  • 傳統(tǒng)意義上，ASIC和CPLD是低功耗競爭中當(dāng)仁不讓的贏家。但是由于相對成本較高，且用戶對高端性能和額外邏輯的要求也越來越多，在低功耗應(yīng)用中使用CPLD正在失去優(yōu)勢。ASIC也面臨相同的風(fēng)險。而例如FPGA這樣日益增長的可編程半導(dǎo)體器件正逐步成為備受青睞的解決方案。
  • 關(guān)鍵字： 低功耗  ASIC  CPLD  可編程半導(dǎo)體器件  
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