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Verilog HDL與VHDL及FPGA的比較分析

  • Verilog HDL與VHDL及FPGA的比較分析,　Verilog HDL　　優(yōu)點(diǎn)：類似C語言，上手容易，靈活。大小寫敏感。在寫激勵(lì)和建模方面有優(yōu)勢(shì)?！　∪秉c(diǎn)：很多錯(cuò)誤在編譯的時(shí)候不能被發(fā)現(xiàn)。　　VHDL　　優(yōu)點(diǎn)：語法嚴(yán)謹(jǐn)，層次結(jié)構(gòu)清晰?！　∪秉c(diǎn)：熟悉時(shí)間長，不夠靈
  • 關(guān)鍵字： 比較  分析  FPGA  VHDL  HDL  Verilog  

基于Altera FPGA的千兆以太網(wǎng)實(shí)現(xiàn)方案

  • 1 引言　　在系統(tǒng)設(shè)備不斷向小型化、集成化、網(wǎng)絡(luò)化發(fā)展的今天，嵌入式開發(fā)成為新技術(shù)發(fā)展的最前沿，改變著系統(tǒng)的整體結(jié)構(gòu)。FPGA由于其自身特點(diǎn)，成為嵌入式開發(fā)的最佳平臺(tái)。Altera公司結(jié)合其最新一代高端器件推出了
  • 關(guān)鍵字： 實(shí)現(xiàn)  方案  以太網(wǎng)  千兆  Altera  FPGA  基于  

FPGA與GPS-OEM板的串行通訊系統(tǒng)設(shè)計(jì)

  • 0 引言　　全球定位系統(tǒng)(Global Positioning System簡(jiǎn)稱GPS)是美國第二代衛(wèi)星導(dǎo)航系統(tǒng)。它是在子午儀衛(wèi)星導(dǎo)航系統(tǒng)的基礎(chǔ)上發(fā)展起來的，GPS能提供全天候、連續(xù)、實(shí)時(shí)高精度導(dǎo)航參數(shù)，可實(shí)現(xiàn)三維定位，并可提供精確的時(shí)
  • 關(guān)鍵字： 設(shè)計(jì)  通訊系統(tǒng)  串行  GPS-OEM  FPGA  

基于PowerPC的光纖通道接口卡設(shè)計(jì)

  • 摘要：介紹了模塊化光纖通道協(xié)議功能。采用新一代嵌入式處理器PowerPC440，搭建光纖通道接口卡的SOPC系統(tǒng)，實(shí)現(xiàn)了光纖通道協(xié)議的基本功能，為基于PowerPC的嵌入式系統(tǒng)設(shè)計(jì)應(yīng)用提供了參考。
    關(guān)鍵詞：PowerPC440；
  • 關(guān)鍵字： FPGA  

一種基于FPGA 的驅(qū)動(dòng)接口電路的設(shè)計(jì)

  • 摘要: 針對(duì)在自動(dòng)控制系統(tǒng)設(shè)計(jì)領(lǐng)域和通信領(lǐng)域中有著廣泛運(yùn)用的AD7862芯片, 介紹了一種基于FPGA 的驅(qū)動(dòng)接口電路的設(shè)計(jì)。闡述了AD7862的特點(diǎn)及基本功能, 以及基于這些功能特點(diǎn)的驅(qū)動(dòng)時(shí)序, 并以此時(shí)序?yàn)榛A(chǔ)在FPGA 芯
  • 關(guān)鍵字： FPGA  驅(qū)動(dòng)  接口電路    

基于USB2_0和DDR2的數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)與FPGA實(shí)現(xiàn)

  • 摘要： 采用DDR2 SDRAM作為被采集數(shù)據(jù)的緩存技術(shù)， 給出了USB2.0與DDR2相結(jié)合的實(shí)時(shí)、高速數(shù)據(jù)采集系統(tǒng)的解決方案， 同時(shí)提出了對(duì)數(shù)據(jù)采集系統(tǒng)的改進(jìn)思路以及在Xilinx的Virtex5 LX30 FPGA上的實(shí)現(xiàn)方法。

    0 引
  • 關(guān)鍵字： DDR2  FPGA  USB  數(shù)據(jù)采集    

在嵌入式設(shè)計(jì)中降低CPLD的功耗

  • 在嵌入式設(shè)計(jì)中降低CPLD的功耗,從事便攜式或手持產(chǎn)品設(shè)計(jì)的工程師都明白對(duì)于如今的設(shè)計(jì)，最大限度地降低功耗是必不可少的要求。但是，只有經(jīng)驗(yàn)豐富的工程師理解盡可能地延長系統(tǒng)的電池壽命的那些微妙但又重要的細(xì)節(jié)。本文中我們將重點(diǎn)放在這些經(jīng)驗(yàn)
  • 關(guān)鍵字： 功耗  CPLD  降低  設(shè)計(jì)  嵌入式  

基于FPGA的RS232異步串行口IP核設(shè)計(jì)

  • 基于FPGA的RS232異步串行口IP核設(shè)計(jì),1 引言　　數(shù)據(jù)采集系統(tǒng)常需要進(jìn)行異步串行數(shù)據(jù)傳輸。目前廣泛使用的RS232異步串行接口，如8250、 NS16450等專用集成器件，雖然使用簡(jiǎn)單，卻占用電路板面積、布線復(fù)雜等缺點(diǎn)。片上系統(tǒng)SoC(System on Chip)是以嵌入式
  • 關(guān)鍵字： IP  設(shè)計(jì)  串行  異步  FPGA  RS232  基于  

CPLD應(yīng)用于嵌入式系統(tǒng)與CAN總線網(wǎng)絡(luò)通信

  • CPLD應(yīng)用于嵌入式系統(tǒng)與CAN總線網(wǎng)絡(luò)通信,1.引言可編程邏輯器件PLD（Programmable logic Device）就是由用戶進(jìn)行編程實(shí)現(xiàn)所需邏輯功能的數(shù)字專用集成電路ASIC?？删幊踢壿嬈骷诂F(xiàn)代電子工程設(shè)計(jì)中得到了廣泛應(yīng)用。它是在PAL，GAL等邏輯器件的基礎(chǔ)上發(fā)展起來
  • 關(guān)鍵字： 總線  網(wǎng)絡(luò)通信  CAN  系統(tǒng)  應(yīng)用  嵌入式  CPLD  

TI評(píng)估用于系統(tǒng)級(jí)芯片集成的各種處理技術(shù)方案

  • 帶有多個(gè)處理單元的SoC器件目前是產(chǎn)品設(shè)計(jì)鏈上的重要一環(huán)。本文綜合各種因素評(píng)估了不同處理單元的優(yōu)缺...
  • 關(guān)鍵字： SoC  TI  FPGA  DSP  系統(tǒng)級(jí)芯片集成  

基于VHDL的2FSK調(diào)制解調(diào)器設(shè)計(jì)

  • 摘要：在數(shù)字通信系統(tǒng)中，數(shù)字調(diào)制與解調(diào)技術(shù)占有非常重要的地位。文中介紹了FSK調(diào)制解調(diào)的基本原理，用VHDL語言實(shí)現(xiàn)了2FSK調(diào)制解調(diào)器的設(shè)計(jì)，整個(gè)系統(tǒng)設(shè)計(jì)在MAX+plusII開發(fā)平臺(tái)上進(jìn)行編譯仿真，最后在EPM7032LC44-1
  • 關(guān)鍵字： FPGA  

基于FPGA的可編程電阻的設(shè)計(jì)

  • 摘要：現(xiàn)在市場(chǎng)上的各種電阻和電阻箱有不足之處，不能滿足一些研發(fā)場(chǎng)所的要求，為了解決這一問題，本文介紹一種基于FPGA的可直接輸入阻值提供不同電阻的設(shè)計(jì)方法。FPGA通過控制繼電器的吸合，從而確定與其并聯(lián)的電阻
  • 關(guān)鍵字： FPGA  可編程  阻的設(shè)計(jì)    

基于FPGA的MSK調(diào)制解調(diào)器設(shè)計(jì)與應(yīng)用

  • 基于FPGA的MSK調(diào)制解調(diào)器設(shè)計(jì)與應(yīng)用,計(jì)和時(shí)序仿真。硬件部分在Altera 公司 EP2C15AF256C8N FPGA 上實(shí)現(xiàn)。結(jié)果表明，數(shù)字MSK
    調(diào)制解調(diào)器具有相位連續(xù)，頻帶利用率高的優(yōu)點(diǎn)。
    關(guān)鍵詞：現(xiàn)場(chǎng)可編程邏輯陣列，最小頻移鍵控，調(diào)制，時(shí)序仿真

    Abstract:
  • 關(guān)鍵字： 設(shè)計(jì)  應(yīng)用  調(diào)制解調(diào)器  MSK  FPGA  基于  

基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

  • 基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn),介紹一種基于CPLD和嵌入式系統(tǒng)的高速數(shù)據(jù)采集系統(tǒng)，并詳細(xì)闡述了系統(tǒng)的結(jié)構(gòu)和軟硬件的實(shí)現(xiàn)方案。
    　　關(guān)鍵詞：高速數(shù)據(jù)采集；CPLD；嵌入式系統(tǒng)Design and Implementation of Highspeed Data Sampling System Ba s
  • 關(guān)鍵字： 系統(tǒng)  設(shè)計(jì)  實(shí)現(xiàn)  數(shù)據(jù)采集  高速  嵌入式  基于  CPLD  

采用混合信號(hào)FPGA實(shí)現(xiàn)智能化熱管理

  • 采用混合信號(hào)FPGA實(shí)現(xiàn)智能化熱管理,引言　　傳統(tǒng)上，人們一直采用熱敏電阻、熱耦或分離式溫度測(cè)量芯片來測(cè)量系統(tǒng)溫度。而且，隨著系統(tǒng)速度越來越快，系統(tǒng)的相對(duì)尺寸越來越小，溫度測(cè)量也變得越來越重要?！　∪欢粜枰獪y(cè)量板卡上多個(gè)測(cè)試點(diǎn)的溫度，
  • 關(guān)鍵字： 智能化  管理  實(shí)現(xiàn)  FPGA  混合  信號(hào)  采用  
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