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EEPW首頁 >> 主題列表 >> dsp+fpga

詳解FPGA電源設(shè)計的基本方法和步驟

  • 詳解FPGA電源設(shè)計的基本方法和步驟-現(xiàn)場可編程門陣列（FPGA）被發(fā)現(xiàn)在眾多的原型和低到中等批量產(chǎn)品的心臟。 FPGA的主要優(yōu)點是在開發(fā)過程中的靈活性，簡單的升級路徑，更快地將產(chǎn)品推向市場，并且成本相對較低。一個主要缺點是復(fù)雜，用FPGA往往結(jié)合了先進的系統(tǒng)級芯片（SoC）。
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無線鏈路方案提升醫(yī)療應(yīng)用的效率

  • 無線鏈路方案提升醫(yī)療應(yīng)用的效率-要想充分發(fā)揮集成的無線系統(tǒng)優(yōu)勢，要求在更長距離內(nèi)有足夠的可靠性，以便讀取的任何數(shù)據(jù)都能直接發(fā)送到護理站的中心控制系統(tǒng)中，這涉及到信號穿過幾個中間病房墻體并且仍能在100-150米遠（300至500英尺）的地方檢測到。更低的射頻頻率，比如低于1GHz，可以提供更好的建筑材料穿透性能。
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電源管理IC三大趨勢的深度解析

  • 電源管理IC三大趨勢的深度解析-在所有的電子設(shè)備和產(chǎn)品中，都不乏電源管理IC的“身影”。隨著數(shù)字高速IC技術(shù)和芯片制造工藝技術(shù)的共同高速發(fā)展，高性能電源IC“助陣”的作用顯得愈加重要。
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基于FPGA的數(shù)字密碼鎖

  • 基于FPGA的數(shù)字密碼鎖-本文介紹了一種以FPGA 為基礎(chǔ)的數(shù)字密碼鎖。采用自頂向下的數(shù)字系統(tǒng)設(shè)計方法， 將數(shù)字密碼鎖系統(tǒng)分解為若干子系統(tǒng)， 并且進一步細劃為若干模塊， 然后用硬件描述語言VHDL 來設(shè)計這些模塊， 同時進行硬件測試。
  • 關(guān)鍵字： VHDL  FPGA  液晶顯示驅(qū)動  QuartusII  

工程師須知：FPGA 的演進、優(yōu)勢、設(shè)計、改進

  • 工程師須知：FPGA 的演進、優(yōu)勢、設(shè)計、改進-1989年我第一次接觸到電路板的時候，上面密布著一系列的TTL、CMOS芯片，一顆14～20只管腳的芯片中一般只有4-6個簡單的“門”，十幾個芯片的大板子也就完成尋址、譯碼之類的功能，使用起來是非常的痛苦，如果要修改邏輯，只能用手術(shù)刀切割電路板并進行飛線。
  • 關(guān)鍵字： FPGA  數(shù)字信號處理  

詳析單片機、ARM、FPGA嵌入式的特點及區(qū)別

  • 詳析單片機、ARM、FPGA嵌入式的特點及區(qū)別-本文詳細解析單片機、ARM、FPGA嵌入式的特點及區(qū)別。
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DSP硬件設(shè)計需要注意的幾個Tips

  • DSP硬件設(shè)計需要注意的幾個Tips-數(shù)字信號處理芯片（DSP） 具有高性能的CPU（時鐘性能超過100MHZ）和高速先進外圍設(shè)備，通過CMOS處理技術(shù)，DSP芯片的功耗越來越低。這些巨大的進步增加了DSP電路板設(shè)計的復(fù)雜性，并且同簡單的數(shù)字電路設(shè)計相比較，面臨更多相似的問題。
  • 關(guān)鍵字： DSP  硬件設(shè)計  CPU  

輸出跟蹤和時序控制幫助提高FPGA可靠性

  • 輸出跟蹤和時序控制幫助提高FPGA可靠性-本文討論如何針對FPGA或微處理器配置各種電壓輸出跟蹤和時序控制選項，來幫助實現(xiàn)靈敏多電源軌系統(tǒng)的正確啟動和關(guān)斷。
  • 關(guān)鍵字： FPGA  時序控制  

基于FPGA的系統(tǒng)促進提高電機控制性能

  • 基于FPGA的系統(tǒng)促進提高電機控制性能-電機在各種工業(yè)、汽車和商業(yè)領(lǐng)域應(yīng)用廣泛。電機由驅(qū)動器控制，驅(qū)動器通過改變輸入功率來控制其轉(zhuǎn)矩、速度和位置。高性能電機驅(qū)動器可以提高效率，實現(xiàn)更快速、更精確的控制。高級電機控制系統(tǒng)集控制算法、工業(yè)網(wǎng)絡(luò)和用戶接口于一體，因此需要更多處理能力來實時執(zhí)行所有任務(wù)?，F(xiàn)代電機控制系統(tǒng)通常利用多芯片架構(gòu)來實現(xiàn)：數(shù)字信號處理器（DSP）執(zhí)行電機控制算法，F(xiàn)PGA 實現(xiàn)高速I/O 和網(wǎng)絡(luò)協(xié)議，微處理器處理執(zhí)行控制。
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Achronix的Speedcore? Custom Blocks定制單元塊為數(shù)據(jù)加速系統(tǒng)再添動力

  • 　　Achronix今日宣布為其eFPGA IP解決方案推出Speedcore custom blocks定制單元塊。Achronix Speedcore eFGPA嵌入式FPGA可加速數(shù)據(jù)密集的人工智能(AI)/機器學(xué)習(xí)、5G移動通信、汽車先進駕駛員輔助系統(tǒng)(ADAS)、數(shù)據(jù)中心和網(wǎng)絡(luò)應(yīng)用; Speedcore custom blocks定制單元塊可以大幅度地提升性能、功耗和面積效率，并支持以前在FPGA獨立芯片上無法實現(xiàn)的
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英特爾FPGA 支持阿里云的加速即服務(wù)

  • 　　今天，英特爾?宣布英特爾現(xiàn)場可編程門陣列 (FPGA) 為阿里巴巴集團的云計算部門—阿里云的加速即服務(wù)(Acceleration-as-a-Service)提供支持。加速服務(wù)可通過阿里云網(wǎng)站提供，支持客戶在云中開發(fā)與部署加速器解決方案，以便應(yīng)用到人工智能推理、視頻流分析、數(shù)據(jù)庫加速和需要密集型計算的其他領(lǐng)域?！　∮⑻貭?nbsp;FPGA 支持的加速即服務(wù)也被稱作阿里云 F1 實例，支持用戶通過即購即用的模式獲得云加速服務(wù)，從而節(jié)省前期的硬件投資。　　
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EDA技術(shù)與FPGA設(shè)計應(yīng)用詳解

  • 　　摘 要：eda技術(shù)是現(xiàn)代電子設(shè)計技術(shù)的核心，它在現(xiàn)代集成電路設(shè)計中占據(jù)重要地位。隨著深亞微米與超深亞微米技術(shù)的迅速發(fā)展，fpga設(shè)計越來越多地采用基于vhdl的設(shè)計方法及先進的eda工具。本文詳細闡述了eda技術(shù)與fpga設(shè)計應(yīng)用?！　￡P(guān)鍵詞：電子設(shè)計自動化;現(xiàn)場可編程門陣列;復(fù)雜可編程邏輯器件;專用集成電路;知識產(chǎn)權(quán);甚高速集成電路硬件描述語言　　引言　　---21世紀是電子信息產(chǎn)業(yè)主導(dǎo)的知識經(jīng)濟時代，信息領(lǐng)域正在發(fā)生一場巨大變革，其先導(dǎo)力量和決定性因素正是微電子集成電路。硅片技術(shù)的日益成
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DSP芯片選型須知

  • DSP芯片選型須知-在DSP系統(tǒng)的設(shè)計流程中，選擇合適的器件非常重要，在確定了系統(tǒng)功能需求之后，通過先期的算法確定及性能模擬，我們要選擇性價比最高的DSP芯片器件才能夠為下一步開發(fā)提供便利。
  • 關(guān)鍵字： DSP  DSP芯片  

相比GPU和GPP，F(xiàn)PGA是深度學(xué)習(xí)的未來？

  • 相比GPU和GPP，F(xiàn)PGA是深度學(xué)習(xí)的未來？-相比GPU和GPP，F(xiàn)PGA在滿足深度學(xué)習(xí)的硬件需求上提供了具有吸引力的替代方案。憑借流水線并行計算的能力和高效的能耗，F(xiàn)PGA將在一般的深度學(xué)習(xí)應(yīng)用中展現(xiàn)GPU和GPP所沒有的獨特優(yōu)勢。同時，算法設(shè)計工具日漸成熟，如今將FPGA集成到常用的深度學(xué)習(xí)框架已成為可能。未來，F(xiàn)PGA將有效地適應(yīng)深度學(xué)習(xí)的發(fā)展趨勢，從架構(gòu)上確保相關(guān)應(yīng)用和研究能夠自由實現(xiàn)。
  • 關(guān)鍵字： 機器學(xué)習(xí)  FPGA  GPU  GPP  

基于FPGA加速機器學(xué)習(xí)算法

  • 基于FPGA加速機器學(xué)習(xí)算法-AI因為其CNN（卷積神經(jīng)網(wǎng)絡(luò)）算法出色的表現(xiàn)在圖像識別領(lǐng)域占有舉足輕重的地位?；镜腃NN算法需要大量的計算和數(shù)據(jù)重用，非常適合使用FPGA來實現(xiàn)。上個月，Ralph Wittig（Xilinx CTO Office的卓越工程師） 在2016年OpenPower峰會上發(fā)表了約20分鐘時長的演講并討論了包括清華大學(xué)在內(nèi)的中國各大學(xué)研究CNN的一些成果。
  • 關(guān)鍵字： 機器學(xué)習(xí)  FPGA  
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