- 7 50T 入門級FPGA評估套件上手評測-FPGA即現場可編程門陣列，屬于可編程邏輯器件的一種。隨著工藝的進步和EDA設計工具的不斷發(fā)展，FPGA的門檻（學習成本和價格成本）也越來越低，目前已經成為實現數字系統的主流平臺之一。
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FPGA 可編程邏輯 Xilinx
- FPGA的快速入門經驗談（part1）-有很多年輕人，被割裂了歷史，被荒廢了未來，迷茫， 迷茫到幾乎絕望，不過，他們還年輕，青春尚存，還有創(chuàng)造力，還有奮斗的資本，其中不乏不甘心被拋棄，被覆蓋之人。
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FPGA 單片機
- FPGA開發(fā)技巧之同步復位與異步復位的理解-前兩天和師兄討論了一下design rule其中提到了同步異步復位的比較這個常見問題，據說也是IC公司經常問到的一面試題。
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FPGA 同步復位 異步復位
- 詳細圖解在NetFPGA上創(chuàng)建一個OpenFlow Switch的網絡-Author: KiKiCompany：Digilent ChinaEmail : Date: 2012.02.14 目的 如 圖所示，我們會創(chuàng)建一個基于OpenFlow Switch的網絡。
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FPGA NetFPGA
- 用FPGA實現MAC核所要完成的功能-MAC發(fā)送模塊可將上層協議提供的數據封裝之后通過MII接口發(fā)送給PHY。
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FPGA MAC MII
- FPGA verilog實現的1602時鐘計數器-網上很少用人公開這一類代碼，一搜FPGA 1602，都是寫一個靜態(tài)的顯示，在實際應用中，是沒有用的，因此這個簡單的例子，給大家拋磚引玉了！
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FPGA 1602時鐘計數器
- 如何使用PlanAhead/Adept加速管腳排布-在排布FPGA管腳生成ucf文件的過程中，當FPGA管腳較多的時候，手工排布管腳不僅效率低，而且很容易出錯。借助PlanAhead和Adept等工具，可以很方便快速的實現管腳排布。
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PlanAhead Adept FPGA
- 組合邏輯設計中的毛刺現象-和所有的數字電路一樣，毛刺也是FPGA電路中的棘手問題，它的出現會影響電路工作的穩(wěn)定性，可靠性，嚴重時會導致整個數字系統的誤動作和邏輯紊亂。
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毛刺 FPGA 電路
- FPGA管腳分配時需注意的一些事項-設計過FPGA的原理圖，看FPGA的手冊，說管腳的分配問題，如時鐘管腳要用GC類管腳，而且單端時鐘輸入時要用P類型的管腳，不能用N類型管腳等等。
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FPGA
- 學習FPGA需要注意的幾個重要問題-如何學好FPGA呢，很多人很困惑，多數停留在基礎位置徘徊，我就這方面問題給大家談幾點自己的看法。
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FPGA 數字電路 HDL語言
- FPGA專家教您如何在FPGA設計中使用HLS-Luke Miller并非一開始就是HLS（高層次綜合）的倡導者。在使用早期的工具版本的時候，他似乎有過一些糟糕的經歷。
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FPGA HLS
- 深度學習算法有望在FPGA和超級計算機上運行-由NSF資助的一個研究項目，目前正在研究如何使用RDMA高性能連接器將深度學習算法在FPGA和跨系統之間運行；另一個由Andrew Ng和兩個超算專家牽頭的項目，則希望把模型放在超級計算機上，給它們一個Python接口。
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FPGA 深度學習 人工智能
- 不可錯過的400Gbps以太網演示-在那里，毫無疑問你會駐足在賽靈思展位前（# 23）觀看一個基于賽靈思Virtex UltraScale VU095 FPGA評估板VCU109的Spirent 400G以太網測試系統，該系統連接四個100Gbps的住友電工 CFP4 LR4光模塊。
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賽靈思 FPGA 光模塊
- 一個FPGA中現在可集成多少32位RISC處理器？-Jan Gray是在FPGA中集成32位RISC處理器的專家，他寫了一篇博客叫作FPGA CPU 新聞，副標題為 “使用FPGA開發(fā)并行計算機體系架構”。
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FPGA RISC處理器
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