fpga ip 文章 進(jìn)入fpga ip技術(shù)社區(qū)
FPGA系統(tǒng)設(shè)計的仿真驗(yàn)證之： FPGA設(shè)計仿真驗(yàn)證的原理和方法
- 嚴(yán)格來講，F(xiàn)PGA設(shè)計驗(yàn)證包括功能與時序仿真和電路驗(yàn)證。仿真是指使用設(shè)計軟件包對已實(shí)現(xiàn)的設(shè)計進(jìn)行完整測試，模擬實(shí)際物理環(huán)境下的工作情況。
- 關(guān)鍵字： 仿真驗(yàn)證 ModelSim FPGA CompilerII FoundationSeries Quartus
基于FPGA的LVDS模塊在DAC系統(tǒng)中的應(yīng)用
- 介紹了LVDS技術(shù)的原理，對LVDS接口在高速數(shù)據(jù)傳輸系統(tǒng)中的應(yīng)用做了簡要的分析，著重介紹了基于FPGA的LVDS_TX模塊的應(yīng)用，并通過其在DAC系統(tǒng)中的應(yīng)用實(shí)驗(yàn)進(jìn)一步說明了LVDS接口的優(yōu)點(diǎn)。
- 關(guān)鍵字： LVDS接口 高速數(shù)據(jù)傳輸 FPGA
FPGA控制CLC5958型A/D轉(zhuǎn)換器高速PCI采集
- 隨著信息技術(shù)的發(fā)展，基于微處理器的數(shù)字信號處理在測控、通訊、雷達(dá)等各個領(lǐng)域得到廣泛的應(yīng)用。被處理的模擬信號也在向高頻、寬帶方面發(fā)展，但這需要高速、高分辨率的數(shù)字采集卡以將模擬信號數(shù)字化。美國國家半導(dǎo)體公司新推出的系列高速、高分辨率模/數(shù)轉(zhuǎn)換器（如CLC5958）就非常適用于需要高速、高分辨率的信號采集系統(tǒng)。
- 關(guān)鍵字： CLC5958型 A/D轉(zhuǎn)換器 FPGA PCI
基于EDMA的FPGA與DSP之間圖像高速穩(wěn)定數(shù)據(jù)傳輸?shù)牡脑O(shè)計與實(shí)現(xiàn)
- 設(shè)計了在FPGA與DSP之間進(jìn)行圖像數(shù)據(jù)傳輸?shù)挠布Y(jié)構(gòu)，介紹了EDMA的工作原理、傳輸參數(shù)配置和EDMA的傳輸流程。在開發(fā)的實(shí)驗(yàn)平臺上實(shí)現(xiàn)了這一傳輸過程。借助TI公司的DSP調(diào)試平臺CCS把接收到的圖像數(shù)據(jù)恢復(fù)成圖像，驗(yàn)證了傳輸過程的正確性和穩(wěn)定性。
- 關(guān)鍵字： EDMA 數(shù)據(jù)傳輸 FPGA
基于D類功率放大的高效率音頻功率放大器設(shè)計
- 為提高功放效率，以適應(yīng)現(xiàn)代社會高效、節(jié)能和小型化的發(fā)展趨勢，以D類功率放大器為核心，以單片機(jī)89C51和可編程邏輯器件（FPGA）進(jìn)行控制及時數(shù)據(jù)的處理，實(shí)現(xiàn)了對音頻信號的高效率放大。系統(tǒng)最大不失真輸出功率大于1 W,可實(shí)現(xiàn)電壓放大倍數(shù)1~20連續(xù)可調(diào)，并增加了短路保護(hù)斷電功能，輸出噪聲低。系統(tǒng)可對功率進(jìn)行計算顯示，具有4位數(shù)字顯示，精度優(yōu)于5%
- 關(guān)鍵字： 音頻放大器 D類功率放大 FPGA
FPGA設(shè)計開發(fā)軟件Quartus II的使用技巧之：Quartus II軟件基礎(chǔ)介紹
- Quartus II設(shè)計軟件是Altera提供的完整的多平臺設(shè)計環(huán)境，能夠直接滿足特定設(shè)計需要，為可編程芯片系統(tǒng)（SOPC）提供全面的設(shè)計環(huán)境。Quartus II軟件含有FPGA和CPLD設(shè)計所有階段的解決方案。
- 關(guān)鍵字： QuartusII Max+PlusII FPGA
硬件描述語言Verilog HDL設(shè)計進(jìn)階之：使用函數(shù)實(shí)現(xiàn)簡單的處理器
- 本實(shí)例使用Verilog HDL設(shè)計一個簡單8位處理器，可以實(shí)現(xiàn)兩個8位操作數(shù)的4種操作。在設(shè)計過程中，使用了函數(shù)調(diào)用的設(shè)計方法。
- 關(guān)鍵字： VerilogHDL 函數(shù) 處理器 FPGA
硬件描述語言Verilog HDL設(shè)計進(jìn)階之：自動轉(zhuǎn)換量程頻率計控制器
- 本實(shí)例使用Verilog HDL設(shè)計一個可自動轉(zhuǎn)換量程的頻率計控制器。在設(shè)計過程中，使用了狀態(tài)機(jī)的設(shè)計方法，讀者可根據(jù)綜合實(shí)例6的流程將本實(shí)例的語言設(shè)計模塊添加到自己的工程中。
- 關(guān)鍵字： VerilogHDL 頻率計控制器 FPGA
硬件描述語言Verilog HDL設(shè)計進(jìn)階之： 典型實(shí)例-狀態(tài)機(jī)應(yīng)用
- 狀態(tài)機(jī)設(shè)計是HDL設(shè)計里面的精華，幾乎所有的設(shè)計里面都或多或少地使用了狀態(tài)機(jī)的思想。狀態(tài)機(jī)，顧名思義，就是一系列狀態(tài)組成的一個循環(huán)機(jī)制，這樣的結(jié)構(gòu)使得編程人員能夠更好地使用HDL語言，同時具有特定風(fēng)格的狀態(tài)機(jī)也能提高程序的可讀性和調(diào)試性。
- 關(guān)鍵字： VerilogHDL 狀態(tài)機(jī) FPGA
硬件描述語言Verilog HDL設(shè)計進(jìn)階之： 邏輯綜合的原則以及可綜合的代碼設(shè)計風(fēng)格
- 用always塊設(shè)計純組合邏輯電路時，在生成組合邏輯的always塊中，參與賦值的所有信號都必須有明確的值，即在賦值表達(dá)式右端參與賦值的信號都必需在always @(敏感電平列表)中列出。
- 關(guān)鍵字： VerilogHDL 邏輯綜合 FPGA
基于FPGA的可配置判決反饋均衡器的設(shè)計
- 在移動通信和高速無線數(shù)據(jù)通信中，多徑效應(yīng)和信道帶寬的有限性以及信道特性的不完善性導(dǎo)致數(shù)據(jù)傳輸時不可避免的產(chǎn)生碼間干擾，成為影響通信質(zhì)量的主要因素，而信道的均衡技術(shù)可以消除碼間干擾和噪聲，并減少誤碼率。其中判決反饋均衡器（DFE）是一種非常有效且應(yīng)用廣泛得對付多徑干擾得措施。
- 關(guān)鍵字： 無線數(shù)據(jù)通訊 可配置均衡器 FPGA
fpga ip介紹
您好，目前還沒有人創(chuàng)建詞條fpga ip!
歡迎您創(chuàng)建該詞條，闡述對fpga ip的理解，并與今后在此搜索fpga ip的朋友們分享。 創(chuàng)建詞條
歡迎您創(chuàng)建該詞條，闡述對fpga ip的理解，并與今后在此搜索fpga ip的朋友們分享。 創(chuàng)建詞條
fpga ip電路
fpga ip相關(guān)帖子
fpga ip資料下載
fpga ip專欄文章
關(guān)于我們 -
廣告服務(wù) -
企業(yè)會員服務(wù) -
網(wǎng)站地圖 -
聯(lián)系我們 -
征稿 -
友情鏈接 -
手機(jī)EEPW
Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《電子產(chǎn)品世界》雜志社 版權(quán)所有 北京東曉國際技術(shù)信息咨詢有限公司
京ICP備12027778號-2 北京市公安局備案：1101082052 京公網(wǎng)安備11010802012473
Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《電子產(chǎn)品世界》雜志社 版權(quán)所有 北京東曉國際技術(shù)信息咨詢有限公司
京ICP備12027778號-2 北京市公安局備案：1101082052 京公網(wǎng)安備11010802012473