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串行A／D與FPGA在微型數(shù)據(jù)記錄儀中的應(yīng)用

  • 摘要：以ADS8341為例，介紹了基于FPGA使用串行輸出A／D轉(zhuǎn)換器實現(xiàn)對多通道準(zhǔn)同步采樣的方法，邏輯控制方式FPGA相比程序流程式的單片機(jī)而言，運(yùn)行更為可靠，通過時序仿真和試驗驗證了該控制方法的正確性，系統(tǒng)體積小、
  • 關(guān)鍵字： 記錄儀  應(yīng)用  數(shù)據(jù)  微型  FPGA  串行  

基于FPGA的出租車計費(fèi)系統(tǒng)設(shè)計

  • 摘要：出租車計費(fèi)系統(tǒng)大多利用單片機(jī)進(jìn)行控制，較易被改裝，且故障率較高。針對這一問題，設(shè)計了一種基于FPGA的出租車計費(fèi)系統(tǒng)，可模擬汽車行駛、暫停等待，停止等過程，并可同時顯示金額、乘車總路程。設(shè)計采用層次
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基于FPGA的IP核8051上實現(xiàn)TCP/IP的設(shè)計

  • 該便攜式接觸網(wǎng)故障信號分析儀采用圖形化程序設(shè)計語言LabVIEW開發(fā)設(shè)計, 可實現(xiàn)數(shù)據(jù)的高速實時采集、在線分析、自動存儲、顯示等功能。高速數(shù)字化儀NI PXI- 5112卡采樣速度高、性能穩(wěn)定可靠, 適宜對高速變化信號的實時監(jiān)測。將軟件安裝在PXI- 1042工控機(jī)上, 具有體積小、抗干擾能力強(qiáng)、攜帶方便等特點(diǎn), 同時具有故障性質(zhì)判斷、故障定位功能。該系統(tǒng)目前已經(jīng)在石家莊變電所現(xiàn)場運(yùn)行, 效果良好。

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基于FPGA的智能變送器的設(shè)計與實現(xiàn)

  • 摘要：根據(jù)工業(yè)應(yīng)用的實際需要以及網(wǎng)絡(luò)通信發(fā)展的功能要求，提出了基于FPGA智能變送器控制系統(tǒng)的總體方案，設(shè)計了以XILINX公司的Spartan3系列XC3S4005PO208C可編程邏輯器件為主控制器、DM9000A為以太網(wǎng)通信接口、SJA
  • 關(guān)鍵字： FPGA  智能變送器    

FPGA控制下面陣CCD時序發(fā)生器設(shè)計及硬件實現(xiàn)

  • 摘要 在分析Sony公司ICX098BQ面陣CCD圖像傳感器驅(qū)動時序的基礎(chǔ)上，對可調(diào)節(jié)曝光時間的CCD時序發(fā)生器及其硬件電路進(jìn)行設(shè)計。選用FPGA器件作為硬件設(shè)計平臺，使用VHDL語言對時序關(guān)系進(jìn)行了硬件描述。采用QuartusII 8.0
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符合中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中的HDLC協(xié)議的FPGA設(shè)計與實現(xiàn)

  • 隨著通信與網(wǎng)絡(luò)技術(shù)的不斷發(fā)展，使我國用現(xiàn)有的E1資源來傳輸以太網(wǎng)業(yè)務(wù)成為廣泛的應(yīng)用。以太網(wǎng)數(shù)據(jù)要通過E1線路傳輸就必須對以太網(wǎng)凈荷數(shù)據(jù)進(jìn)行幀封裝，才能從E1線路上恢復(fù)出以太網(wǎng)數(shù)據(jù)幀，完成以太網(wǎng)數(shù)據(jù)的交換。通常，以太網(wǎng)數(shù)據(jù)是通過HDLC協(xié)議或GFP協(xié)議來進(jìn)行封裝的。本文介紹了中國移動標(biāo)準(zhǔn)協(xié)議轉(zhuǎn)換器中以太網(wǎng)到單路E1轉(zhuǎn)換器HDLC協(xié)議封裝的FPGA（現(xiàn)場可編程邏輯陣列）設(shè)計與實現(xiàn)。
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基于FPGA的NAND Flash ECC校驗

  • 摘要 基于Flash存儲器的Hamming編碼原理，在Altera QuartusⅡ7．0開發(fā)環(huán)境下，實現(xiàn)ECC校驗功能。測試結(jié)果表明，該程序可實現(xiàn)每256 Byte數(shù)據(jù)生成3 Byte的ECC校驗數(shù)據(jù)，能夠檢測出1 bit錯誤和2 bit錯誤，對于1 bit錯誤
  • 關(guān)鍵字： Flash  FPGA  NAND  ECC    

一種基于ARM 的FPGA可重構(gòu)配置方法的實現(xiàn)及應(yīng)用

  • 隨著半導(dǎo)體工藝技術(shù)的迅猛發(fā)展，現(xiàn)場可編程邏輯器件FPGA的集成度迅速提高，已達(dá)到百萬門量級，與此同時，F(xiàn)PGA中的邏 ...
  • 關(guān)鍵字： ARM  FPGA  加載配置  

IIR數(shù)字濾波器的Matlab和FPGA實現(xiàn)

  • 摘要：提出一種通過兩個二階節(jié)級聯(lián)構(gòu)成四階IIR數(shù)字橢圓濾波器的設(shè)計方法，并利用Matlab仿真軟件設(shè)計了通帶內(nèi)波紋不大于0．1 dB，阻帶衰減不小于42 dB的IIR數(shù)字濾波器。論述了一種采用可編程邏輯器件，通過VHDL硬件描
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FPGA時鐘設(shè)計

  • 摘要：在FPGA設(shè)計中，為了成功地操作，可靠的時鐘是非常關(guān)鍵的。設(shè)計不良的時鐘在極限的溫度、電壓下將導(dǎo)致錯誤的行為。在設(shè)計PLD／FPGA時通常采用如下四種類型時鐘：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。
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基于FPGA的自適應(yīng)波束形成算法實現(xiàn)

  • 　1 引 言　　在雷達(dá)及聲納信號處理系統(tǒng)中，波束形成算法通常采用DSP軟件編程實現(xiàn)，控制邏輯電路采用CPLD來完成，這種方法具有軟件編程靈活、功能易于擴(kuò)展的優(yōu)點(diǎn)，但對于實時性能要求很高的系統(tǒng)，如雷達(dá)、聲納探測和
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基于FPGA的實時中值濾波器硬件實現(xiàn)

  • 針對高清圖像在中值濾波預(yù)處理過程中排序量多、速度慢的特點(diǎn)，提出適合鄰域圖像并行處理機(jī)的分塊存儲方法。在流水線結(jié)構(gòu)下，1個時鐘周期可以并行處理32個3×3鄰域的中值濾波運(yùn)算，實現(xiàn)了高速、實時的1 920×1 080灰度圖像中值濾波器。
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基于FPGA的多路數(shù)字信號復(fù)分接器的設(shè)計

  • 在現(xiàn)代數(shù)字通信中，對數(shù)據(jù)傳輸容量和傳輸效率的要求越來越高，因此經(jīng)常依據(jù)時分復(fù)用[1]的原理通過數(shù)字復(fù)接與分...
  • 關(guān)鍵字： 數(shù)字復(fù)接技術(shù)  FPGA  時分復(fù)用  

萊迪思宣布首個符合PCI Express 2.0規(guī)范的低成本FPGA

  • 　　萊迪思半導(dǎo)體公司日前宣布LatticeECP3TMFPGA系列符合PCI Express 2.0在2.5Gbps的規(guī)范。針對最近PCI – SIG研討會上涉及的1-通道和 4-通道配置，LatticeECP3 FPGA和其PCI Express(PCIe)IP核通過了符合PCI - SIGPCIe 2.0規(guī)范和互操作性的測試，確保萊迪思的解決方案與現(xiàn)有的支持系統(tǒng)的PCIe 2.0具有互操作性。
  • 關(guān)鍵字： 萊迪思  FPGA  

賽靈思榮膺“2011中國經(jīng)濟(jì)-最佳推動力企業(yè)”獎

  • 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）今天宣布榮膺中國經(jīng)濟(jì)CEO論壇“2011中國經(jīng)濟(jì)-最佳推動力企業(yè)”獎。賽靈思公司全球高級副總裁、亞太地區(qū)執(zhí)行總裁湯立人（Vincent Tong）和亞太地區(qū)銷售與市場副總裁楊飛先生，出席了由東方企業(yè)家、經(jīng)理人雜志、新民周刊、金融界、北京電視臺、香港科技大學(xué)商學(xué)院、中國企業(yè)國際發(fā)展協(xié)會聯(lián)合在北京發(fā)起主辦的 “中國經(jīng)濟(jì)CEO論壇暨中國經(jīng)濟(jì)成就獎評選頒獎盛典”。 商務(wù)部國際貿(mào)易經(jīng)濟(jì)合作研究院研究員白明代表中國經(jīng)濟(jì)CEO 論壇
  • 關(guān)鍵字： 賽靈思  FPGA  
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