- 雖然5V電源邏輯在很多應用中仍很常見,但大多數(shù)FPGA都支持3.3V以及更低的接口電平。FPGA應用說明通常建議,當把...
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FPGA 齊納二極管
- 圖像的二維提升小波變換的FPGA實現(xiàn),小波分析理論以其良好的時頻區(qū)域性和多分辨率分析能力,開辟了圖像處理的嶄新領域。小波變換是一種很好的圖像分解方法,非常適合于分析突變信號而用于靜止圖像邊緣的提取和壓縮。高階小波變化還可以用于實時處理視頻
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FPGA 實現(xiàn) 變換 小波 二維 提升 圖像
- 引言 人們生活中的家用電器種類日益增多,遙控器的種類也隨之增加,不同種類的遙控器之間一般不能相互替代,這給人們的生活帶來諸多不便?! 「黝愡b控器功能大致相同,大多都有數(shù)字鍵、啟動停止鍵、前進鍵、快
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遙控 家居 實現(xiàn) FPGA
- 摘要:文中分析了紅外線遙控器系統(tǒng)的數(shù)據(jù)編碼和傳輸機制,并用VerilogHDL語言設計了基于FPGA的紅外接收模塊硬件電路,在VCS和VirSim仿真工具中進行了仿真測試;用XilinxISE 10.1軟件進行了綜合、適配和FPGA器件下栽
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FPGA 紅外遙控 信號接收 模塊
- IIS接口的FPGA實現(xiàn),在嵌入式系統(tǒng)中經(jīng)常采用IIS(Inter-IC Sound)總線連接專用音頻器件以實現(xiàn)音頻輸入輸出。不少嵌入式處理器帶有專用的通過操作特殊功能寄存器實現(xiàn)對外接音頻器件的操作,但也有一些嵌入式處理器沒有擴展IIS總線,如ARM7
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實現(xiàn) FPGA 接口 IIS
- 摘要:為了解決高速數(shù)據(jù)采集以及數(shù)據(jù)傳輸問題,設計了基于USB通信的FPGA高速數(shù)據(jù)采集系統(tǒng)。方案以FPGA為控制核心,實現(xiàn)A/D控制、數(shù)據(jù)緩存雙口RAM和控制CY7C68013A三個功能。系統(tǒng)采用Verilog HDL語言,通過ISE軟件編
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數(shù)據(jù)采集 系統(tǒng) 高速 FPGA USB 通信 基于
- 摘要:電荷耦合器件(CCD)作為一種新型的光電器件,被廣泛地應用于非接觸測量。而CCD驅(qū)動設計是CCD應用的關鍵問題之一。為了克服早期CCD驅(qū)動電路體積大,設計周期長,調(diào)試困難等缺點,以線陣CCD圖像傳感器TCD1251UD為
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FPGA CCD 線陣 驅(qū)動設計
- 摘要:為實現(xiàn)線性調(diào)頻信號的數(shù)字脈沖壓縮,設計一個FPGA硬件平臺,并著重提出一種基于FPGA IP核的脈沖壓縮設計方法。針對脈沖壓縮進行了理論分析和Matlab仿真,設計完成后對系統(tǒng)軟、硬件進行了全面測試,并根據(jù)實測數(shù)
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FPGA 線性調(diào)頻信號 IP核 脈沖壓縮
- 摘要:針對分辨率為1 024times;768的LCoS屏編寫了Verilog HDL驅(qū)動代碼,在quartusⅡ9.1平臺上綜合編譯,并在Altera的FPGA芯片EP3C5E14 4C8上進行了功能驗證和實際輸出信號測量。采用異步FIFO結(jié)構(gòu)解決了跨異步時鐘域
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FPGA LCoS 驅(qū)動 圖像處理
- 引言
隨著計算機科技的發(fā)展,無紙辦公日益成為各單位日常辦公的主要形式。而隨著USB存儲設備日益廣泛的使用,數(shù)據(jù)泄漏的危害也越來越嚴重。因此在單位內(nèi)部對USB存儲設備的操作權(quán)限進行控制是很有必要的。
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CPLD FPGA USB 讀寫
- 在電力調(diào)度自動化系統(tǒng)中,測量電壓和頻率是最重要的功能。如何快速、準確地采集顯得尤為重要。目前根據(jù)采集信...
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FPGA 交流電測量儀
- 摘要:與通常采用外圍的CPLD器件和CPU來產(chǎn)生配置接口控制邏輯的方法不同,本文設計了采用嵌入到FPGA的Leon3開源CPU軟核來控制實現(xiàn)Virtex系列FPGA的SelectMap接口配置的方法,可將其應用于對FPGA芯片的在線配置。該方
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SelectMap Leon3 FPGA 軟核
- 存儲器是用來存儲程序和數(shù)據(jù)的部件,有了存儲器,計算機才有記憶功能,才能保證正常工作。它根據(jù)控制器指定的位置存進和取出信息。 引言 只要在現(xiàn)在的市場上走一圈就會發(fā)現(xiàn),大部分的中小規(guī)模 LED LED(L
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FPGA MCU LED 大屏幕
- 摘要:詳細分析了SVPWM的原理,介紹一種根據(jù)負載的功率因子來決定電壓空間零矢量的分配與作用時間的SVPWM算法,使得橋臂開關在通過其電流最大時的一段連續(xù)時間內(nèi)沒有開關動作。這樣在提高開關頻率的同時減小了開關電
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SVPWM FPGA 開關損耗 算法
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