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基于FPGA的UART設(shè)計(jì)與實(shí)現(xiàn)

  • 介紹了應(yīng)用現(xiàn)場可編程門陣列(FPGA)設(shè)計(jì)和實(shí)現(xiàn)通用異步收發(fā)器UART的方法。采用有限狀態(tài)機(jī)模型形式化描述了UART的功能，在此基礎(chǔ)上用硬件描述語言VHDL編程實(shí)現(xiàn)了UART，并使用QuartusⅡ軟件中的嵌入式邏輯分析儀SignalTapⅡ?qū)?shù)據(jù)傳輸進(jìn)行了檢測，驗(yàn)證了設(shè)計(jì)的正確性。
  • 關(guān)鍵字： FPGA  UART    

基于FPGA的短波發(fā)射機(jī)自動調(diào)諧系統(tǒng)的設(shè)計(jì)

基于WCDMA速率適配算法的FPGA設(shè)計(jì)

  • 基于WCDMA速率適配算法的FPGA設(shè)計(jì),隨著因特網(wǎng)爆炸性的增長以及各種無線業(yè)務(wù)需求的增加，傳統(tǒng)的無線通信網(wǎng)已經(jīng)越來越無法適應(yīng)人們的需要。因此，以大容量、高數(shù)據(jù)率和承載多媒體業(yè)務(wù)為目的的第三代移動通信系統(tǒng)(IMT-2000)應(yīng)運(yùn)而生。碼分多址(CDMA)由于
  • 關(guān)鍵字： FPGA  設(shè)計(jì)  算法  適配  WCDMA  速率  基于  

基于FPGA的8B／10B編解碼設(shè)計(jì)

  • 摘要：為提高8B／10B編解碼的工作速度和簡化邏輯方法，提出一種基于FPGA的8B／10B編解碼系統(tǒng)設(shè)計(jì)方案。與現(xiàn)有的8B／10B編解碼方案相比，該方案是一種利用FPGA實(shí)現(xiàn)8B／lOB編解碼的模塊方法，接收模塊在收到外部發(fā)送的
  • 關(guān)鍵字： FPGA  10B  編解碼    

Altera Stratix V FPGA提供RLDRAM 3存儲器支持

  • 　　Altera公司今天發(fā)布Stratix® V系列FPGA，適用于支持Micron技術(shù)公司的下一代低延時(shí)DRAM (RLDRAM® 3存儲器)。Stratix V FPGA采用新的存儲器體系結(jié)構(gòu)，降低延時(shí)，高效實(shí)現(xiàn)FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網(wǎng)絡(luò)設(shè)備生產(chǎn)商提供存儲器接口解決方案，支持在互聯(lián)網(wǎng)上迅速有效的傳送視頻、語音和數(shù)據(jù)。 　　Micron公司業(yè)務(wù)開發(fā)高級經(jīng)理Bruce Franklin表示：“Micron的下一代RLDRAM 3存儲器專門設(shè)
  • 關(guān)鍵字： Altera  Stratix  FPGA  

基于FPGA的IRIG-B(DC)碼產(chǎn)生電路設(shè)計(jì)

  • 摘要：提出了一種IRIG-B(DC)碼產(chǎn)生電路的設(shè)計(jì)方法。采用Altera公司低功耗Cyclone FPGA系列中的EPlC6T144、8段數(shù)碼管、晶體振蕩器和MAX3232E等器件構(gòu)成硬件電路、使用VHDL語言設(shè)計(jì)IRIG-B直流時(shí)間碼的軟件。為了設(shè)置和
  • 關(guān)鍵字： IRIG-B  FPGA  DC  產(chǎn)生電路    

基于FPGA的PCI硬件加解密卡設(shè)計(jì)

  • 摘要：提出一種基于FPGA的PCI硬件加解密卡的設(shè)計(jì)方案，用硬件加解密取代了傳統(tǒng)的軟件加解密，將加解密模塊和PCI接口模塊集成在一個(gè)FPGA芯片內(nèi)實(shí)現(xiàn)。分析了PCI加解密卡的軟硬件的結(jié)構(gòu)和原理，詳細(xì)介紹了DESX加解密算法
  • 關(guān)鍵字： FPGA  PCI  硬件  加解密    

基于CPLD／FPGA的CMI編碼設(shè)計(jì)與實(shí)現(xiàn)

  • 根據(jù)CMI碼的特性，介紹了一種新的編程思路實(shí)現(xiàn)CMI編碼，在Max+PlusⅡ開發(fā)平臺上使用VHDL編程實(shí)現(xiàn)CMI編碼，并得到仿真波形。實(shí)驗(yàn)結(jié)果表明，這種編程思路簡單、清晰。在產(chǎn)生7位偽隨機(jī)序列的前提下，分別對“O”，“1”進(jìn)行編碼。這種思路為其他碼型設(shè)計(jì)提供了參考。
  • 關(guān)鍵字： CPLD  FPGA  CMI  編碼    

高速移動下OFDM均衡器的FPGA實(shí)現(xiàn)

  • 在高速移動下，OFDM系統(tǒng)載波間正交性被破壞，出現(xiàn)載波間干擾(ICI)，嚴(yán)重影響系統(tǒng)性能，必須采用適當(dāng)?shù)木饧夹g(shù)以補(bǔ)償ICI。為了保證通信的有效性和實(shí)時(shí)性要求，使用FPGA實(shí)現(xiàn)了一種低復(fù)雜度的最小均方誤差(MMSE)OFDM均衡器算法。在ISE軟件平臺上使用Verilog語言編寫程序，并在Xilinx公司Virtex-2實(shí)驗(yàn)板(XC2V930芯片)上對設(shè)計(jì)進(jìn)行了驗(yàn)證。
  • 關(guān)鍵字： OFDM  FPGA  移動  均衡器    

Nios軟核在CT機(jī)掃描系統(tǒng)控制器設(shè)計(jì)中的應(yīng)用

  • Nios軟核在CT機(jī)掃描系統(tǒng)控制器設(shè)計(jì)中的應(yīng)用,1 引言近年來，可編程邏輯器件的發(fā)展，使得SOPC (System On A Programmable Chip，可編程片上系統(tǒng))成為可能, 即在一塊可編程芯片上實(shí)現(xiàn)整個(gè)系統(tǒng)。Nios是Altera公司研發(fā)的可用于SOPC設(shè)計(jì)的處理器軟核?；贜ios軟核的
  • 關(guān)鍵字： Nios  CT機(jī)  軟核  掃描系統(tǒng)    

基于FPGA芯片控制全彩LED大屏幕圖像顯示系統(tǒng)系統(tǒng)設(shè)計(jì)

  • 隨著數(shù)字技術(shù)的飛速發(fā)展，各種數(shù)字顯示屏也隨即涌現(xiàn)出來有l(wèi)ed、LCD、DLP等，各種數(shù)字大屏幕的控制系統(tǒng)多種多樣，有用ARM+FPGA脫機(jī)控制系統(tǒng)，也有用PC+DVI接口解碼芯片+FPGA芯片聯(lián)機(jī)控制系統(tǒng)，在這里我們講述一種不僅
  • 關(guān)鍵字： 圖像  顯示系統(tǒng)  系統(tǒng)  設(shè)計(jì)  大屏幕  LED  FPGA  芯片  控制  

基于FPGA的可調(diào)信號發(fā)生器

  • 摘要：基于FPGA的應(yīng)用技術(shù)，采用Altera公司DE2-70開發(fā)板的CycloneⅡ系列EP2C70作為核心器件，設(shè)計(jì)了一種基于FPGA的新型可調(diào)信號發(fā)生器。通過QuartusⅡ軟件及Vetilog HDL編程語言設(shè)計(jì)LPM_ROM模塊定制數(shù)據(jù)ROM，并通過地
  • 關(guān)鍵字： FPGA  信號發(fā)生器    

基于NiosⅡ的SD卡驅(qū)動程序開發(fā)

  • 基于NiosⅡ的SD卡驅(qū)動程序開發(fā),摘要：提出一種在FPGA NiosⅡ軟核處理器下SD卡驅(qū)動設(shè)計(jì)的方法。采用Altera公司的FPGA可編程邏輯器件，構(gòu)建了NiosⅡ軟核處理器平臺，并在此之上實(shí)現(xiàn)了SD卡的驅(qū)動設(shè)計(jì)。實(shí)驗(yàn)結(jié)果表明：設(shè)計(jì)提高了FPGA系統(tǒng)的設(shè)計(jì)靈活度，
  • 關(guān)鍵字： 程序開發(fā)  驅(qū)動  SD  Nios  基于  FPGA  ARM  

水下激光成像距離選通同步控制電路設(shè)計(jì)

  • 摘要：在水下激光成像系統(tǒng)中，由于復(fù)雜的水下環(huán)境對激光傳輸?shù)挠绊戄^大，為了更加有效地實(shí)現(xiàn)距離選通功能，該同步控制電路的設(shè)計(jì)選用高性能的Altera Stratix III系列的FPGA。電路分為距離延遲和門延遲2個(gè)模塊，創(chuàng)新地
  • 關(guān)鍵字： 控制  電路設(shè)計(jì)  同步  距離  激光  成像  FPGA  
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