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fpga-pwm 文章 進(jìn)入fpga-pwm技術(shù)社區(qū)
基于FPGA的線陣CCD驅(qū)動(dòng)時(shí)序及模擬信號(hào)處理的設(shè)計(jì)
- 基于FPGA設(shè)計(jì)的驅(qū)動(dòng)電路是可再編程的,與傳統(tǒng)的方法相比,其優(yōu)點(diǎn)是集成度高、速度快、可靠性好。若要改變驅(qū)動(dòng)電路的時(shí)序,增減某些功能,僅需要對(duì)器件重新編程即可,在不改變?nèi)魏斡布那闆r下,即可實(shí)現(xiàn)驅(qū)動(dòng)電路的更新?lián)Q代。通過對(duì)TCDl50lD輸出圖像信號(hào)特征的簡(jiǎn)要分析,分別闡述了內(nèi)、外2種除噪方法,并給出了相應(yīng)的時(shí)序,再利用Quartus II 7.2軟件平臺(tái)對(duì)TCDl501D CCD驅(qū)動(dòng)時(shí)序及AD9826的采樣時(shí)序進(jìn)行了設(shè)計(jì)及結(jié)果仿真,使CCD的驅(qū)動(dòng)變得簡(jiǎn)單且易于處理,這是傳統(tǒng)邏輯電路無法比擬的,對(duì)其他CCD時(shí)
- 關(guān)鍵字: CCD驅(qū)動(dòng)時(shí)序 模擬信號(hào)處理 FPGA
用FPGA在數(shù)字電視系統(tǒng)中進(jìn)行級(jí)聯(lián)編碼
- 本文介紹了串型級(jí)聯(lián)編碼的原理,以及它在數(shù)字電視地面?zhèn)鬏斚到y(tǒng)中的應(yīng)用,通過FPGA設(shè)計(jì)電路實(shí)現(xiàn)編碼過程,最后說明串型級(jí)聯(lián)編碼的應(yīng)用優(yōu)越性。
- 關(guān)鍵字: FPGA;編碼;串型級(jí)聯(lián)編碼;數(shù)字電視地面?zhèn)鬏斚到y(tǒng)
基于高速FPGA的PCB設(shè)計(jì)技術(shù)
- 本文只談及了一些基本的概念。這里所涉及的任何一個(gè)主題都可以用整本書的篇幅來討論。關(guān)鍵是要在為PCB版圖設(shè)計(jì)投入大量時(shí)間和精力之前搞清楚目標(biāo)是什么。一旦完成了版圖設(shè)計(jì),重新設(shè)計(jì)就會(huì)耗費(fèi)大量的時(shí)間和金錢,即便是對(duì)走線的寬度作略微的調(diào)整。不能依賴PCB版圖工程師做出能夠滿足實(shí)際需求的設(shè)計(jì)來。原理圖設(shè)計(jì)師要一直提供指導(dǎo),作出精明的選擇,并為解決方案的成功負(fù)起責(zé)任。
- 關(guān)鍵字: PCB 電容 SERDES FPGA
用FPGA實(shí)現(xiàn)FIR濾波器
- 你接到要求用FPGA實(shí)現(xiàn)FIR濾波器的任務(wù)時(shí),也許會(huì)想起在學(xué)校里所學(xué)的FIR基礎(chǔ)知識(shí),但是下一步該做什么呢?哪些參數(shù)是重要的?做這個(gè)設(shè)計(jì)的最佳方法是什么?還有這個(gè)設(shè)計(jì)應(yīng)該怎樣在FPGA中實(shí)現(xiàn)?現(xiàn)在有大量的低成本IP核和工具來幫助你進(jìn)行設(shè)計(jì),因?yàn)镕IR是用FPGA實(shí)現(xiàn)的最普通的功能。
- 關(guān)鍵字: FIR濾波器 DSP LUT FPGA
克服FPGA I/O引腳分配挑戰(zhàn)
- 賽靈思公司開發(fā)了一種規(guī)則驅(qū)動(dòng)的方法。首先根據(jù)PCB和FPGA設(shè)計(jì)要求定義一套初始引腳布局,這樣利用與最終版本非常接近的引腳布局設(shè)計(jì)小組就可以盡可能早地開始各自的設(shè)計(jì)流程。 如果在設(shè)計(jì)流程的后期由于PCB布線或內(nèi)部FPGA性能問題而需要進(jìn)行調(diào)整,在采用這一方法晨這些問題通常也已經(jīng)局部化了,只需要在PCB或FPGA設(shè)計(jì)中進(jìn)行很小的設(shè)計(jì)修改。
- 關(guān)鍵字: PCB IO引腳分配 FPGA
多種EDA工具的FPGA協(xié)同設(shè)計(jì)
- 在FPGA開發(fā)的各個(gè)階段,市場(chǎng)為我們提供了很多優(yōu)秀的EDA工具。面對(duì)眼花繚亂的EDA工具,如何充分利用各種工具的特點(diǎn),并規(guī)劃好各種工具的協(xié)同使用,對(duì)FPGA開發(fā)極其重要。本文將通過開發(fā)實(shí)例“帶順序選擇和奇偶檢驗(yàn)的串并數(shù)據(jù)轉(zhuǎn)換接口”來介紹基于多種EDA工具——QuartusII、FPGA CompilerII、Modelsim——的FPGA協(xié)同設(shè)計(jì)。
- 關(guān)鍵字: FPGA;EDA;協(xié)同設(shè)計(jì)
Verilog串口通訊設(shè)計(jì)
- FPGA(Field Pmgrammable Gate Array)現(xiàn)場(chǎng)可編程門陣列在數(shù)字電路的設(shè)計(jì)中已經(jīng)被廣泛使用。這種設(shè)計(jì)方式可以將以前需要多塊集成芯片的電路設(shè)計(jì)到一塊大模塊可編程邏輯器件中,大大減少了電路板的尺寸,增強(qiáng)了系統(tǒng)的可靠性和設(shè)計(jì)的靈活性。本文詳細(xì)介紹了已在實(shí)際項(xiàng)目中應(yīng)用的基于FPGA的串口通訊設(shè)計(jì)。本設(shè)計(jì)分為硬件電路設(shè)計(jì)和軟件設(shè)計(jì)兩部分,最后用仿真驗(yàn)證了程序設(shè)計(jì)的正確性。
- 關(guān)鍵字: Verilog 串口通訊 FPGA
基于FPGA的SoC/IP驗(yàn)證平臺(tái)的設(shè)計(jì)與應(yīng)用
- SoC是大規(guī)模集成電路的發(fā)展趨勢(shì)。SoC設(shè)計(jì)必須依靠完整的系統(tǒng)級(jí)驗(yàn)證來保證其正確性。基于FPGA的驗(yàn)證平臺(tái)能夠縮短SoC驗(yàn)證時(shí)間,并提高驗(yàn)證工作的可靠性,還具有可重用性。本文利用Altera公司的FPGA設(shè)計(jì)了一個(gè)基于片上總線的SoC原型驗(yàn)證平臺(tái),并將VxWorks嵌入式操作系統(tǒng)應(yīng)用于此平臺(tái),通過軟硬件協(xié)同驗(yàn)證的方法,驗(yàn)證了平臺(tái)的可靠性。該平臺(tái)在CF卡及通用智能卡SoC芯片驗(yàn)證中得以應(yīng)用。
- 關(guān)鍵字: SoC驗(yàn)證平臺(tái) 系統(tǒng)級(jí)驗(yàn)證 FPGA
以FPGA可編程邏輯器件為設(shè)計(jì)平臺(tái)的全彩led顯示屏設(shè)計(jì)方案
- 介紹了一種以FPGA 可編程邏輯器件為設(shè)計(jì)平臺(tái)的、采用大屏幕全彩led 顯示屏進(jìn)行全彩灰度圖像顯示的掃描控制器實(shí)現(xiàn)方案。經(jīng)過對(duì)“19 場(chǎng)掃描”理論灰度實(shí)現(xiàn)原理的分析,針對(duì)采用該方法實(shí)現(xiàn)的全彩LED
- 關(guān)鍵字: LED 顯示屏設(shè)計(jì) FPGA
采用FPGA部分動(dòng)態(tài)可重構(gòu)方法的信號(hào)解調(diào)系統(tǒng)設(shè)計(jì)
- 針對(duì)調(diào)制樣式在不同環(huán)境下的變化,采用了FPGA部分動(dòng)態(tài)可重構(gòu)的新方法,通過對(duì)不同調(diào)制樣式信號(hào)的解調(diào)模塊的動(dòng)態(tài)加載,來實(shí)現(xiàn)了不同環(huán)境下針對(duì)不同調(diào)制樣式的解調(diào)這種方式比傳統(tǒng)的設(shè)計(jì)方式具有更高的靈活性、可擴(kuò)展性,并減低了成本和功耗該設(shè)計(jì)方案同時(shí)也介紹了FPGA部分動(dòng)態(tài)可重構(gòu)的概念和特點(diǎn),可以對(duì)其它通信信號(hào)處理系統(tǒng)設(shè)計(jì)提供一定的參考。
- 關(guān)鍵字: 可重構(gòu)技術(shù) 解調(diào)模塊 FPGA
高性能DC/DC轉(zhuǎn)換器應(yīng)對(duì)FPGA應(yīng)用中的供電要求
- 最近FPGA供應(yīng)商推出的新型可編程器件進(jìn)一步縮小了FPGA和ASIC之間的性能差別。盡管這類器件的可配置性對(duì)設(shè)計(jì)工程師很有吸引力,但使用這 些器件所涉及的復(fù)雜設(shè)計(jì)規(guī)則和接口協(xié)議,要求設(shè)計(jì)工程師經(jīng)過全面的培訓(xùn),并需要進(jìn)行參考設(shè)計(jì)評(píng)估、設(shè)計(jì)仿真和驗(yàn)證工作。另一方面,F(xiàn)PGA應(yīng)用中非常復(fù)雜 的模擬設(shè)計(jì),例如用于內(nèi)核、I/O、存儲(chǔ)器、時(shí)鐘和其它電壓軌的DC/DC穩(wěn)壓器,也要求新的解決方案。本文討論的高性能DC/DC轉(zhuǎn)換器有助于系統(tǒng)設(shè)計(jì) 工程師克服這些挑戰(zhàn)。
- 關(guān)鍵字: 電壓軌 DC/DC FPGA
基于FPGA實(shí)現(xiàn)CPCI數(shù)據(jù)通信
- 本文設(shè)計(jì)的系統(tǒng)采用PLX公司生產(chǎn)的CPCI協(xié)議轉(zhuǎn)換芯片PCI9054,通過Verilog HDL語(yǔ)言在FPGA中產(chǎn)生相應(yīng)的控制信號(hào),完成對(duì)數(shù)據(jù)的快速讀寫,從而實(shí)現(xiàn)了與CPCI總線的高速數(shù)據(jù)通信。
- 關(guān)鍵字: CPCI協(xié)議轉(zhuǎn)換 Verilog FPGA
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