fpga-to-asic 文章 進(jìn)入fpga-to-asic技術(shù)社區(qū)
基于FPGA的線陣CCD驅(qū)動時序及模擬信號處理的設(shè)計
- 基于FPGA設(shè)計的驅(qū)動電路是可再編程的,與傳統(tǒng)的方法相比,其優(yōu)點是集成度高、速度快、可靠性好。若要改變驅(qū)動電路的時序,增減某些功能,僅需要對器件重新編程即可,在不改變?nèi)魏斡布那闆r下,即可實現(xiàn)驅(qū)動電路的更新?lián)Q代。通過對TCDl50lD輸出圖像信號特征的簡要分析,分別闡述了內(nèi)、外2種除噪方法,并給出了相應(yīng)的時序,再利用Quartus II 7.2軟件平臺對TCDl501D CCD驅(qū)動時序及AD9826的采樣時序進(jìn)行了設(shè)計及結(jié)果仿真,使CCD的驅(qū)動變得簡單且易于處理,這是傳統(tǒng)邏輯電路無法比擬的,對其他CCD時
- 關(guān)鍵字: CCD驅(qū)動時序 模擬信號處理 FPGA
用FPGA在數(shù)字電視系統(tǒng)中進(jìn)行級聯(lián)編碼
- 本文介紹了串型級聯(lián)編碼的原理,以及它在數(shù)字電視地面?zhèn)鬏斚到y(tǒng)中的應(yīng)用,通過FPGA設(shè)計電路實現(xiàn)編碼過程,最后說明串型級聯(lián)編碼的應(yīng)用優(yōu)越性。
- 關(guān)鍵字: FPGA;編碼;串型級聯(lián)編碼;數(shù)字電視地面?zhèn)鬏斚到y(tǒng)
多種EDA工具的FPGA協(xié)同設(shè)計
- 在FPGA開發(fā)的各個階段,市場為我們提供了很多優(yōu)秀的EDA工具。面對眼花繚亂的EDA工具,如何充分利用各種工具的特點,并規(guī)劃好各種工具的協(xié)同使用,對FPGA開發(fā)極其重要。本文將通過開發(fā)實例“帶順序選擇和奇偶檢驗的串并數(shù)據(jù)轉(zhuǎn)換接口”來介紹基于多種EDA工具——QuartusII、FPGA CompilerII、Modelsim——的FPGA協(xié)同設(shè)計。
- 關(guān)鍵字: FPGA;EDA;協(xié)同設(shè)計
Verilog串口通訊設(shè)計
- FPGA(Field Pmgrammable Gate Array)現(xiàn)場可編程門陣列在數(shù)字電路的設(shè)計中已經(jīng)被廣泛使用。這種設(shè)計方式可以將以前需要多塊集成芯片的電路設(shè)計到一塊大模塊可編程邏輯器件中,大大減少了電路板的尺寸,增強(qiáng)了系統(tǒng)的可靠性和設(shè)計的靈活性。本文詳細(xì)介紹了已在實際項目中應(yīng)用的基于FPGA的串口通訊設(shè)計。本設(shè)計分為硬件電路設(shè)計和軟件設(shè)計兩部分,最后用仿真驗證了程序設(shè)計的正確性。
- 關(guān)鍵字: Verilog 串口通訊 FPGA
基于FPGA的SoC/IP驗證平臺的設(shè)計與應(yīng)用
- SoC是大規(guī)模集成電路的發(fā)展趨勢。SoC設(shè)計必須依靠完整的系統(tǒng)級驗證來保證其正確性?;贔PGA的驗證平臺能夠縮短SoC驗證時間,并提高驗證工作的可靠性,還具有可重用性。本文利用Altera公司的FPGA設(shè)計了一個基于片上總線的SoC原型驗證平臺,并將VxWorks嵌入式操作系統(tǒng)應(yīng)用于此平臺,通過軟硬件協(xié)同驗證的方法,驗證了平臺的可靠性。該平臺在CF卡及通用智能卡SoC芯片驗證中得以應(yīng)用。
- 關(guān)鍵字: SoC驗證平臺 系統(tǒng)級驗證 FPGA
以FPGA可編程邏輯器件為設(shè)計平臺的全彩led顯示屏設(shè)計方案
- 介紹了一種以FPGA 可編程邏輯器件為設(shè)計平臺的、采用大屏幕全彩led 顯示屏進(jìn)行全彩灰度圖像顯示的掃描控制器實現(xiàn)方案。經(jīng)過對“19 場掃描”理論灰度實現(xiàn)原理的分析,針對采用該方法實現(xiàn)的全彩LED
- 關(guān)鍵字: LED 顯示屏設(shè)計 FPGA
采用FPGA部分動態(tài)可重構(gòu)方法的信號解調(diào)系統(tǒng)設(shè)計
- 針對調(diào)制樣式在不同環(huán)境下的變化,采用了FPGA部分動態(tài)可重構(gòu)的新方法,通過對不同調(diào)制樣式信號的解調(diào)模塊的動態(tài)加載,來實現(xiàn)了不同環(huán)境下針對不同調(diào)制樣式的解調(diào)這種方式比傳統(tǒng)的設(shè)計方式具有更高的靈活性、可擴(kuò)展性,并減低了成本和功耗該設(shè)計方案同時也介紹了FPGA部分動態(tài)可重構(gòu)的概念和特點,可以對其它通信信號處理系統(tǒng)設(shè)計提供一定的參考。
- 關(guān)鍵字: 可重構(gòu)技術(shù) 解調(diào)模塊 FPGA
fpga-to-asic介紹
您好,目前還沒有人創(chuàng)建詞條fpga-to-asic!
歡迎您創(chuàng)建該詞條,闡述對fpga-to-asic的理解,并與今后在此搜索fpga-to-asic的朋友們分享。 創(chuàng)建詞條
歡迎您創(chuàng)建該詞條,闡述對fpga-to-asic的理解,并與今后在此搜索fpga-to-asic的朋友們分享。 創(chuàng)建詞條
熱門主題
關(guān)于我們 -
廣告服務(wù) -
企業(yè)會員服務(wù) -
網(wǎng)站地圖 -
聯(lián)系我們 -
征稿 -
友情鏈接 -
手機(jī)EEPW
Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《電子產(chǎn)品世界》雜志社 版權(quán)所有 北京東曉國際技術(shù)信息咨詢有限公司
京ICP備12027778號-2 北京市公安局備案:1101082052 京公網(wǎng)安備11010802012473
Copyright ?2000-2015 ELECTRONIC ENGINEERING & PRODUCT WORLD. All rights reserved.
《電子產(chǎn)品世界》雜志社 版權(quán)所有 北京東曉國際技術(shù)信息咨詢有限公司
京ICP備12027778號-2 北京市公安局備案:1101082052 京公網(wǎng)安備11010802012473