- 用戶可輕松將這款高穩(wěn)健操作系統(tǒng)安裝到目標FPGA平臺上，以供嵌入式設計項目使用。從最初不起眼的膠合邏輯開始，F(xiàn)PGA已經歷了漫長的發(fā)展道路。當前FPGA的邏輯容量和靈活性已將其帶入了嵌入式設計的中心位置。目前，在
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PetaLinux FPGA 賽靈思
- 性能浮點處理一直與高性能CPU相關聯(lián)。在過去幾年中，GPU也成為功能強大的浮點處理平臺，超越了圖形，稱為GP-GPU(通用圖形處理單元)。新創(chuàng)新是在苛刻的應用中實現(xiàn)基于FPGA的浮點處理。本文的重點是FPGA及其浮點性能和
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FPGA 浮點計算
- 我們常常會發(fā)現(xiàn)，自己想當然的一些規(guī)則或道理往往會存在一些差錯。電子工程師在電路設計中也會有這樣的例子。下面是一位工程師總結的八大誤區(qū)點?，F(xiàn)象一：這板子的PCB設計要求不高，就用細一點的線，自動布吧點評：
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電路設計 PCB設計 FPGA 存儲器 降低功耗
- 基于FPGA實現(xiàn)USB2.0接口通信， USB2.0 PHY芯片是Cypress68013, 68013內部集成8051 內核，USB2.0芯片讀寫需要對8051核進行固件配置。一.FX2特性介紹1.1介紹Cypress Semiconductor公司的EZ-USB FX2是世界上第一款集
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FPGA USB
- 根據經驗法則，在高密度和高頻率的場合通常使用四層板，就EMC而言比二層板好20 DB以上。在四層板的條件下，往往可以使用一個完整的地平面和完整的電源平面，在這種條件下只需要進行分成幾組的電路的地線與地平面連
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PCB 接地方式
- 對于初學者而言,FPGA的設計流程是否顯的又臭又長呢?呵呵,如果真的有這樣的感覺,沒有關系,下面我就通過對軟件的使用來了解FPGA的設計流程。1)使用synplify pro對硬件描述語言編譯并生成netlist綜合前要注意對器件的
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EDA FPGA
- 高速電路設計領域，關于布線有一種幾乎是公理的認識，即“等長”走線，認為走線只要等長就一定滿足時序需求，就不會存在時序問題。本文對常用高速器件的互連時序建立模型，并給出一般性的時序分析公式。為
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PCB DDR SDRAM PHY芯片
- 引言本文以Xilinx公司的Kintex-7系列XC7K410T FPGA芯片和兩片Micron公司的MT41J128M16 DDR3 SDRAM芯片為硬件平臺，設計并實現(xiàn)了基于FPGA的視頻圖形顯示系統(tǒng)的DDR3多端口存儲管理。1 總體架構設計機載視頻圖形顯示系
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存儲器控制 多端口 幀地址 DDR3 FPGA
- 作為一個系統(tǒng)設計工程師，經常會遇到這個問題：是選用ASIC還是FPGA?讓我們來看一看這兩者有什么不同。所謂ASIC，是專用集成電路(Application Specific Integrated Circuit)的簡稱，電子產品中，應用非常廣泛。ASIC的
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FPGA ASIC 系統(tǒng)設計 成本因素
- 電子設計自動化(Electronic Design Automation，EDA)是以計算機為載體，在EDA軟件平臺上，用硬件描述語言VHDL完成設計文件，然后由計算機自動地完成邏輯編譯、化簡、分割、綜合、優(yōu)化、布局、布線和仿真，直至對于
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表決器 設計 FPGA 仿真
- 低密度奇偶校驗(Low Density Parity—Check，LDPC)碼最早于1962年由R.Gallager提出，其實質是一類具有稀疏校檢矩陣的線性分組碼。1996年，Mackay、Neal等人證明了LDPC碼是一種具有逼近Shannon極限性能的好碼，
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有限域乘群 QC-LDPC碼 分層譯碼器 FPGA
- 當前應用廣泛的串行通信接口標準主要有RS232，RS422和RS485，其中RS232串行通信方式采用單端輸入輸出，傳輸距離短、通信速率低、抗干擾性能差;RS485與RS422均采用差分串行輸入輸出，但RS485只有一對雙絞線，只能工作
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FPGA RS422 接口電路
- CAN總線是當前最流行的工業(yè)現(xiàn)場總線之一，PCI則是一種應用普遍的高速同步總線，具有32 bit帶寬，時鐘頻率為0～33 MHz，最大傳輸速率可達132 Mbitmiddot;s-1，廣泛應用于數(shù)字圖像、語音及數(shù)據實時采集與處理等領域
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PCI CAN FPGA PCI9054
- 在現(xiàn)代電子測量、通訊系統(tǒng)以及生物醫(yī)學等領域，經常涉及對寬帶模擬信號進行數(shù)據采集和存儲，以便計算機進一步進行數(shù)據處理。為了對高速模擬信號進行不失真采集，根據奈奎斯特定理，采樣頻率必須為信號頻率的2倍以上
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等效時間采樣 FPGA 數(shù)據采集 變頻
- 在衛(wèi)星通信系統(tǒng)中，發(fā)送端通常利用不同的分組時隙同步傳送處在同一傳輸頻帶內的各路信號，而接收端為了準確識別和分離出數(shù)據流中的各路信號，需要采用幀同步算法進行分組檢測和符號同步，其中分組檢測用來識別數(shù)據分
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幀同步 相關 FPGA 衛(wèi)星通信接收機
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