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基于PXI和PCI硬件的PCB測(cè)試系統(tǒng)方案設(shè)計(jì)

  • 　解決方案:　　結(jié)合NI PXI與PCI硬件，使用NI TestStand和LabVIEW軟件來(lái)開(kāi)發(fā)一個(gè)用于測(cè)試印刷電路板和太陽(yáng)能逆變器的標(biāo)準(zhǔn)測(cè)試系統(tǒng)?！　⊥ㄟ^(guò)使用全部來(lái)自National Instruments的開(kāi)發(fā)工具，我們開(kāi)發(fā)了一套個(gè)完整的解
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多節(jié)點(diǎn)大容量FPGA系統(tǒng)的遠(yuǎn)程升級(jí)方法

  • 引言　　多節(jié)點(diǎn)系統(tǒng)，在目前的很多電子系統(tǒng)應(yīng)用場(chǎng)合都可以看到。這種多節(jié)點(diǎn)系統(tǒng)由于具有結(jié)構(gòu)可擴(kuò)展性、功能配置的靈活性以及便于查找故障節(jié)點(diǎn)等良好的可維護(hù)性得到了越來(lái)越廣泛的應(yīng)用。通常，多節(jié)點(diǎn)系統(tǒng)各個(gè)節(jié)點(diǎn)的主
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基于FPGA的嵌入式系統(tǒng)USB接口設(shè)計(jì)

  • 基于FPGA的嵌入式系統(tǒng)USB接口設(shè)計(jì),摘要：設(shè)計(jì)基于FPGA的IP-BX電話應(yīng)用系統(tǒng)，用于傳統(tǒng)的電話網(wǎng)絡(luò)(PSTN)與PC機(jī)之間的接口連接。USB2．0接口器件EZ-USB FX2 CY7C68013A-56工作在slave FIFO模式，為基于FPGA的嵌入式系統(tǒng)與PC機(jī)之間提供數(shù)據(jù)和命令通道，從
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裝入CPLD/FPGA的步進(jìn)電機(jī)運(yùn)動(dòng)控制器與驅(qū)動(dòng)器

  • 本設(shè)計(jì)實(shí)例進(jìn)一步拓展了以前將步進(jìn)電機(jī)驅(qū)動(dòng)器集成到CPLD中的設(shè)計(jì)（參考文獻(xiàn)1）。本實(shí)例不僅集成了驅(qū)動(dòng)器，而且還集成了一個(gè)簡(jiǎn)單的單軸步進(jìn)電機(jī)運(yùn)動(dòng)控制器。根據(jù)CPLD大小，可以將多個(gè)運(yùn)動(dòng)控制器設(shè)計(jì)到單一設(shè)備中。例如
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PCB選擇性焊接技術(shù)分析

  • 選擇性焊接的工藝特點(diǎn)
    　　可通過(guò)與波峰焊的比較來(lái)了解選擇性焊接的工藝特點(diǎn)。兩者間最明顯的差異在于波峰焊中PCB的下部完全浸入液態(tài)焊料中，而在選擇性焊接中，僅有部分特定區(qū)域與焊錫波接觸。由于PCB本身就是一種
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PCB線路板清潔之道

  • 經(jīng)常通過(guò)我們的技術(shù)支持熱線詢問(wèn)的一個(gè)問(wèn)題是，“IPC關(guān)于清潔度的標(biāo)準(zhǔn)是什么？”。這是一個(gè)經(jīng)常被工業(yè)新手所問(wèn)的簡(jiǎn)單直率的問(wèn)題，因此簡(jiǎn)單直率的答案一般是他們所想要的?？墒牵诖蠖鄶?shù)情況中，這對(duì)他們個(gè)
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PCB表面處理工藝特點(diǎn)概述

  • 一. 引言
    隨著人類對(duì)于居住環(huán)境要求的不斷提高，目前PCB生產(chǎn)過(guò)程中涉及到的環(huán)境問(wèn)題顯得尤為突出。目前有關(guān)鉛和溴的話題是最熱門的；無(wú)鉛化和無(wú)鹵化將在很多方面影響著PCB的發(fā)展。雖然目前來(lái)看，PCB的表面處理工
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PCB設(shè)計(jì)時(shí)混合信號(hào)的分區(qū)

  • 如何降低數(shù)字信號(hào)和模擬信號(hào)間的相互干擾呢？在設(shè)計(jì)之前必須了解電磁兼容(EMC)的兩個(gè)基本原則：第一個(gè)原則是盡可能減小電流環(huán)路的面積；第二個(gè)原則是系統(tǒng)只采用一個(gè)參考面。相反，如果系統(tǒng)存在兩個(gè)參考面，就可能形
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POWER PCB內(nèi)電層分割及鋪銅分析

  • PCB新手看過(guò)來(lái)]POWER PCB內(nèi)層屬性設(shè)置與內(nèi)電層分割及鋪銅　　看到很多網(wǎng)友提出的關(guān)于POWER PCB內(nèi)層正負(fù)片設(shè)置和內(nèi)電層分割以及鋪銅方面的問(wèn)題，說(shuō)明的帖子很多，不過(guò)都沒(méi)有一個(gè)很系統(tǒng)的講解。今天抽空把這些東西聯(lián)系
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PCB板電路中的數(shù)字地和模擬地設(shè)計(jì)

  • 1 為什么要分?jǐn)?shù)字地和模擬地　　因?yàn)殡m然是相通的，但是距離長(zhǎng)了，就不一樣了。同一條導(dǎo)線，不同的點(diǎn)的電壓可能是不一樣的，特別是電流較大時(shí)。因?yàn)閷?dǎo)線存在著電阻，電流流過(guò)時(shí)就會(huì)產(chǎn)生壓降。另外，導(dǎo)線還有分布電感
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利用FPGA解決TMS320C54K與SDRAM的接口問(wèn)題

  • 在DSP應(yīng)用系統(tǒng)中，需要大量外擴(kuò)存儲(chǔ)器的情況經(jīng)常遇到。例如，在數(shù)碼相機(jī)和攝像機(jī)中，為了將現(xiàn)場(chǎng)拍攝的諸多圖...
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基于FPGA與外部SRAM的大容量數(shù)據(jù)存儲(chǔ)

  • 1引言我們將針對(duì)FPGA中內(nèi)部BlockRAM有限的缺點(diǎn)，提出了將FPGA與外部SRAM相結(jié)合來(lái)改進(jìn)設(shè)計(jì)的方法，并給出...
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MELP語(yǔ)音編碼的FPGA實(shí)現(xiàn)的系統(tǒng)框架

  • NiosII處理器是Intel公司為Altera公司推出的32位精簡(jiǎn)指令處理器軟核。在Altera公司推出的軟件SOPC中加載...
  • 關(guān)鍵字： MELP  FPGA  

基于AXI總線的MicroBlaze雙核SoPC系統(tǒng)設(shè)計(jì)

  • 目的是利用嵌入在Xilinx FPGA中的MicroBlaze核實(shí)現(xiàn)基于AXI總線的雙核嵌入式系統(tǒng)設(shè)計(jì)以及共享實(shí)現(xiàn)LED燈的時(shí)控。對(duì)于共享實(shí)現(xiàn)LED燈時(shí)控的方法是通過(guò)在兩個(gè)低速總線之間加入一個(gè)axi2axi_connector實(shí)現(xiàn)axilite總線上的slave共享。對(duì)于實(shí)現(xiàn)雙核之間的通信主要方法是利用mailbox和mutex完成核間通信。硬件平臺(tái)采用的是Xilinx FPGA Spartan -6 Atlys板，軟件平臺(tái)是Xilinx EDK，主要使用的是XPS(硬件設(shè)計(jì))和SDK(軟件設(shè)計(jì))，開(kāi)發(fā)出
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PCB電鍍電流的無(wú)線傳感器網(wǎng)絡(luò)監(jiān)測(cè)系統(tǒng)設(shè)計(jì)

  • 中心議題： PCB電鍍電流的無(wú)線傳感器絡(luò)監(jiān)測(cè)系統(tǒng)設(shè)計(jì)解決方案： NRF9E5單片機(jī)系統(tǒng) 無(wú)線通信單元設(shè)計(jì) 傳感器單元設(shè)計(jì) 指示燈報(bào)警電路設(shè)計(jì) 無(wú)線傳感器網(wǎng)絡(luò)的軟件設(shè)計(jì)
    利用計(jì)算機(jī)、傳感器技術(shù)和無(wú)線通
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