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EEPW首頁 >> 主題列表 >> fsp:fpga-pcb

內(nèi)嵌ARM核的FPGA芯片EPXA10及其在圖像驅(qū)動和處理方面的應用

  • 內(nèi)嵌ARM核的FPGA芯片EPXA10及其在圖像驅(qū)動和處理方面的應用 北京航空航天大學自動化科學與電氣工程學院(100083) 尹 娜 江 潔 張廣軍  　　摘　要：介紹了內(nèi)嵌 ARM核的FPGA芯片EPXA10的主要功能特點、內(nèi)部結(jié)構(gòu)及工作方式，通過其在圖像驅(qū)動和處理方面的應用，體現(xiàn)了EPXA10邏輯控制實現(xiàn)簡單、對大量數(shù)據(jù)做簡單處理速度快以及軟件編程靈活的特點。 　　關(guān)鍵詞：ARM FPGA EPXA10 圖像驅(qū)動 圖像處理 　　隨著亞微米技術(shù)的發(fā)展，F(xiàn)PGA芯片密度不斷增加，并以強大的
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高速數(shù)字串行加法器及其應用

  • 高速數(shù)字串行加法器及其應用 深圳南山區(qū)科技園中興通訊IC開發(fā)一部(518057)　鐘信潮上海盛立亞光網(wǎng)絡系統(tǒng)有限公司　薛小剛深圳南山區(qū)科技園中興通訊3G開發(fā)(518057)　王 誠   　　摘　要：與傳統(tǒng)加法器相比，數(shù)字串行加法器具有工作頻率高、占用資源少、設計靈活等優(yōu)點。介紹了數(shù)字串行加法器的原理，說明了該加法器在FPGA上的實現(xiàn)要點及其在匹配濾波器設計中的應用。 　　關(guān)鍵詞：加法器　位并行　數(shù)字串行　FPGA　匹配濾波器 　　與傳統(tǒng)DSP相比，定制DSP具有速度更高、設計靈活、易于更改
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利用Virtex-5 FPGA實現(xiàn)更高的性能

  • 在FPGA系統(tǒng)設計中，要達到性能最大化需要平衡具有混合性能效率的元器件，包括邏輯構(gòu)造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中，我將向你解釋怎樣能在追求更高系統(tǒng)級性能的過程中受益于Xilinx® 的Virtex™-5 FPGA構(gòu)建模塊，特別是新的ExpressFabric™技術(shù)。以針對邏輯和算術(shù)功能的量化預期性能改進為例，我將探究ExpressFabric架構(gòu)的主要功能?；趯嶋H客戶設計的基準將說明Virtex-5ExpressFabric技術(shù)性能平均比前一
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利用Xilinx Platform Studio工具套件，快速、便捷地生成 BSP

  • 具有嵌入式處理器的 平臺 FPGA 為您提供前所未有的靈活性、集成度和高性能。目前，在單個可編程邏輯設備中開發(fā)極其復雜且高度定制化的嵌入式系統(tǒng)已成為可能。 隨著芯片性能的不斷增加，如何使設計方法始終高效、多產(chǎn)，成為人們面臨的主要挑戰(zhàn)。嵌入式系統(tǒng)開發(fā)的關(guān)鍵活動之一是開發(fā)板支持包 (BSP)。利用 BSP，可以使嵌入式軟件應用程序成功地初始化，并與連接到處理器的硬件資源進行通信。典型的 BSP 組件包括引導代碼、設備驅(qū)動程序代碼和
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設計PCB時抗ESD的方法

  • 來自人體、環(huán)境甚至電子設備內(nèi)部的靜電對于精密的半導體芯片會造成各種損傷，例如穿透元器件內(nèi)部薄的絕緣層；損毀MOSFET和CMOS元器件的柵極；CMOS器件中的觸發(fā)器鎖死；短路反偏的PN結(jié)；短路正向偏置的PN結(jié)；熔化有源器件內(nèi)部的焊接線或鋁線。為了消除靜電釋放(ESD)對電子設備的干擾和破壞，需要采取多種技術(shù)手段進行防范?！　≡赑CB板的設計當中，可以通過分層、恰當?shù)牟季植季€和安裝實現(xiàn)PCB的抗ESD設計。在設計過程中，通過預測可以將絕大多數(shù)設計修改僅限于增減元器件。通過調(diào)整PCB布局布線，能夠很好地防范E
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SYNPLICITY CERTIFY軟件全面支持XILINX VIRTEX-5 FPGA簡化ASIC原型驗證過程

  • 　　Synplicity宣布其Certify® ASIC RTL 原型設計軟件增強了對 Xilinx Virtex™-5 系列的 65 納米 FPGA 的支持。Certify 軟件是業(yè)界首款支持多個 FPGA 進行 ASIC 原型設計的產(chǎn)品。Certify 工具將多芯片分組技術(shù)與業(yè)界一流的 FPGA 綜合技術(shù)
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利用Virtex-5 FPGA實現(xiàn)更高性能的方法

  • 在FPGA系統(tǒng)設計中，要達到性能最大化需要平衡具有混合性能效率的元器件，包括邏輯構(gòu)造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中，我將向你解釋怎樣能在追求更高系統(tǒng)級性能的過程中受益于Xilinx? 的Virtex?-5 FPGA構(gòu)建模塊，特別是新的ExpressFabric?技術(shù)。以針對邏輯和算術(shù)功能的量化預期性能改進為例，我將探究ExpressFabric架構(gòu)的主要功能?；趯嶋H客戶設計的基準將說明Virtex-5ExpressFabric技術(shù)性能平均比前一代Virtex-4 FPGA要高
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可重構(gòu)計算技術(shù)將漸入民用領(lǐng)域

  •     可重構(gòu)計算（Reconfigurable Computing） 技術(shù)是指在軟件的控制下，利用系統(tǒng)中的可重用資源（如FPGA等可重構(gòu)邏輯器件），根據(jù)應用的需要重新構(gòu)造一個新的計算平臺，達到接近專用硬件設計的高性能。它避免了微處理器計算模式因為取指、譯碼等步驟導致的性能損失，同時也消除了專用集成電路（ASIC）計算模式因為前期設計制造的復雜過程帶來的高代價和不可重用等缺陷。     從某種意義上來說，可重構(gòu)計算技術(shù)并不是什么新技術(shù)，
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專家分析：全求電子元件市場預測和發(fā)展趨勢

  •     按照我國電子元件15個大類產(chǎn)品統(tǒng)計，2005年世界電子元件市場銷售額將達到2200億美元，預計2010年世界電子元件市場將達到3614億美元，產(chǎn)品產(chǎn)量將達到38400億只。國際市場，據(jù)日本電子工業(yè)振興會對世界電子信息產(chǎn)業(yè)發(fā)展預測，2010年世界電子信息制造業(yè)市場將達19055億美元，其中，電子元件市場將達2800億美元，占14.7%。2005年至2010年年均增長5.4%。另據(jù)報道，全球片式元器件產(chǎn)量將從2005年15000億只，增至2010年25000億只
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元器件市場新賣點：PCB企業(yè)汽車市場掘金

  •     汽車電子產(chǎn)業(yè)的蓬勃發(fā)展為下游配套零組件提供了市場，也帶動了汽車用PCB的發(fā)展。據(jù)了解，2006年P(guān)CB產(chǎn)值為120億美元，其中汽車電子占5.5%，即汽車電子PCB產(chǎn)值達6.6億美元。     汽車用PCB要求更嚴格      汽車電子是繼電腦、通信之后PCB的第三大應用領(lǐng)域。隨著汽車從傳統(tǒng)意義上的機械產(chǎn)品，逐步演化、發(fā)展為機電一體化、智能化、信息化的高技術(shù)產(chǎn)品，電子技術(shù)在汽車上的
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FPGA實現(xiàn)的FIR算法在汽車動態(tài)稱重儀中的應用

  • 引言 車輛在動態(tài)稱重時，作用在平臺上的力除真實軸重外，還有許多因素產(chǎn)生的干擾力，如：車速、車輛自身諧振、路面激勵、輪胎驅(qū)動力等，給動態(tài)稱重實現(xiàn)高精度測量造成很大困難。若在消除干擾的過程中采用模擬方法濾波，參數(shù)則不能過大，否則將產(chǎn)生過大的延遲導致不能實現(xiàn)實時處理，從而造成濾波后的信號仍然含有相當一部分的噪聲。所以必須采用數(shù)字濾波消除干擾。 FIR濾波的原理及實現(xiàn) 本文采用FIR數(shù)字濾波，其原理如公式1所示。 Y(n)= (1) 其中h(k)為系統(tǒng)濾波參數(shù)，x(n)為采集的信號，
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印制電路板設計原則和抗干擾措施

  • 印制電路板(PCB)是電子產(chǎn)品中電路元件和器件的支撐件．它提供電路元件和器件之間的電氣連接。隨著電子技術(shù)的飛速發(fā)展，PGB的密度越來越高。PCB設計的好壞對抗干擾能力影響很大．因此，在進行PCB設計時．必須遵守PCB設計的一般原則，并應符合抗干擾設計的要求。 　　 　　 PCB設計的一般原則 　　要使電子電路獲得最佳性能，元器件的布且及導線的布設是很重要的。為了設計質(zhì)量好、造價低的PCB．應遵循以下一般原則： 　　 　　 1. 布局 首先，要考慮PCB尺寸大小。PCB尺寸過大時，印制線條長，阻抗增加，抗噪
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低功耗FPGA設計技術(shù)

  • 一、前言　　 　　 隨著系統(tǒng)功率預算的不斷緊縮，迫切需要新型低功率元器件。對通信基礎設施而言，電路板冷卻、機箱體積小型化以及系統(tǒng)可靠性在系統(tǒng)設計中都起著重要的作用。對e-應用，電池壽命、熱耗散和小體積尺寸是主要的設計難點。選用智能器件，輔以正確的設計技巧增加了符合功率預算的可能性。盡管可編程邏輯器件（PLD）有很好的性能，然而卻以犧牲功耗為代價。Actel公司的抗熔斷型FPGA提供低功耗且高性能應用的理想解決方案。本文涵蓋Actel eX系列以及SX/SX-A系列器件，詳細描述了器件的結(jié)構(gòu)特點與設計技巧。
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賽靈思推出系統(tǒng)性能最高、編譯時間最快的ISE WEBPACK 9.1i設計套件

  • 可免費下載并同時支持Windows和Linux平臺的設計套件，能降低平均10%的動態(tài)功耗并提供擴展的FPGA器件支持      2007年1月30日，北京 - 全球領(lǐng)先的可編程邏輯解決方案提供商賽靈思公司(Xilinx, Inc.) (NASDAQ:XLNX) 日前宣布推出最新版本、可免費下載的邏輯設計套件——集成軟件環(huán)境 (ISE™) WebPACK™ 9.1i，目前用戶可立即下載使用。這一新版本包含了使用廣泛的賽靈思 ISE Foundatio
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FPGA與CPLD的區(qū)別

  • 管ＦＰＧＡ和ＣＰＬＤ都是可編程ＡＳＩＣ器件,有很多共同特點,但由于ＣＰＬＤ和ＦＰＧＡ結(jié)構(gòu)上的差異,具有各自的特點:①ＣＰＬＤ更適合完成各種算法和組合邏輯,ＦＰ ＧＡ更適合于完成時序邏輯。換句話說,ＦＰＧＡ更適合于觸發(fā)器豐富的結(jié)構(gòu),而ＣＰＬＤ更適合于觸發(fā)器有限而乘積項豐富的結(jié)構(gòu)。②ＣＰＬＤ的連續(xù)式布線結(jié)構(gòu)決定了它的時序延遲是均勻的和可預測的,而ＦＰＧＡ的分段式布線結(jié)構(gòu)決定了其延遲的不可預測性。 ③在編程上ＦＰＧＡ比ＣＰＬＤ具有更大的靈活性。ＣＰＬＤ通過修改具有固定內(nèi)連電路的邏輯功能來編程,ＦＰＧＡ主要通過
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