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以FPGA為基礎(chǔ)的SoC驗證平臺自動化電路仿真?zhèn)慑e功

隨著系統(tǒng)芯片(SoC)設(shè)計的體積與復(fù)雜度持續(xù)升高，驗證作業(yè)變成了瓶頸：占了整個SoC研發(fā)過程中70% 的時間。因此，任何能夠降低驗證成本并能更早實現(xiàn)驗證sign-off的方法都是眾人的注目焦點。臺灣工業(yè)技術(shù)研究院 (工研院
關(guān)鍵字： FPGA SoC 基礎(chǔ) 電路仿真

基于FPGA軟核的高速數(shù)據(jù)采集系統(tǒng)設(shè)計

為解決不同性能指標(biāo)數(shù)據(jù)采集系統(tǒng)開發(fā)時間較長的問題，提出了一種將FPGA軟核技術(shù)應(yīng)用于高速數(shù)據(jù)采集系統(tǒng)設(shè)計的方法。系統(tǒng)以Xilinx公司的FPGA為例設(shè)計軟核，使用VHDL語言對軟核進行模塊化設(shè)計。介紹了數(shù)據(jù)采集系統(tǒng)的硬件電路、USB固件程序、USB驅(qū)動程序以及LabVIEW上位機的設(shè)計。該數(shù)據(jù)采集系統(tǒng)結(jié)構(gòu)可移植性強，有利于縮短同類型系統(tǒng)設(shè)計研發(fā)周期。
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基于FPGA的高清視頻采集與顯示系統(tǒng)設(shè)計

高清視頻采集與顯示系統(tǒng)設(shè)計近年來，高清網(wǎng)絡(luò)攝像機席卷視頻監(jiān)控市場，傳統(tǒng)的模擬攝像機也在尋找新的出路提升圖像質(zhì)量，采用非壓縮方案的高清模擬攝像機成為首選。一般來說，非壓縮方案的硬件平臺有DSP或ASIC或FPGA。
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如何在FPGA中實現(xiàn)圖像格式轉(zhuǎn)換

　首先由同步視頻輸入MegaCore 功能來處理SDI 視頻數(shù)據(jù)。該功能將同步視頻格式數(shù)據(jù)（例如， BT656 或者DVI）轉(zhuǎn)換為流控制Avalon 流（Avalon-ST）視頻協(xié)議，實現(xiàn)與數(shù)據(jù)通路后面其他視頻處理功能的鏈接?！　〔捎?/li>
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基于89C55和FPGA的頻率特性測試儀

摘要：為了能夠直接顯示待測網(wǎng)絡(luò)的幅頻相頻特性，設(shè)計了一個以89C55和FPGA構(gòu)成的最小系統(tǒng)為控制核心的頻率特性測試儀。系統(tǒng)基于DDS(直接數(shù)字頻率合成)原理和多周期同步計數(shù)相位測量法，由信號發(fā)生器，被測雙T網(wǎng)絡(luò)，真
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應(yīng)對功耗挑戰(zhàn)：晶體管技術(shù)方案面臨瓶頸

在電費占運營成本 (OPEX) 很大一部分，而運營成本則占總成本約 70% 的情況下，降低功耗對運營商來說已刻不容緩。以前，芯片提供商想辦法通過晶體管和工藝技術(shù)來降低功耗。雖然晶體管是產(chǎn)生功耗的主要原因，但并非唯一因素，而且通過晶體管來降低功耗作用是有限的。
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基于FPGA的外部存儲器設(shè)計

摘要：為了提高雷達海量數(shù)據(jù)的處理速度，采用FPGA設(shè)計了一種高速外部存儲器，通過多次實驗，驗證了設(shè)計方法的可行性。高速外部存儲器可以有效地提高數(shù)據(jù)存儲速度，節(jié)約讀／寫時間，從而滿足信號處理的高速實時的要求
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FPGA為核心的多功能輸液系統(tǒng)的設(shè)計

FPGA為核心的多功能輸液系統(tǒng)的設(shè)計,今朝醫(yī)護人員一般不能全程陪護，會給病人和醫(yī)務(wù)人員帶來良多平安隱患和未便。本文設(shè)計了一種集輸液節(jié)制、顯示、報警、語音通信等多種功能的輸液節(jié)制系統(tǒng)?！　? 系統(tǒng)總體設(shè)計　　輸液監(jiān)控系統(tǒng)原理如圖1所示，包括FP
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在FPGA中實現(xiàn)圖像格式轉(zhuǎn)換的參考設(shè)計

引言服務(wù)器、交換機、前端編碼器以及專用演播顯示器等廣播基礎(chǔ)設(shè)備系統(tǒng)支持各種輸入圖像格式，在存儲、...
關(guān)鍵字： FPGA 圖像格式轉(zhuǎn)換 ASSP

基于DVI和FPGA的視頻疊加器設(shè)計

摘要：利用FPGA作為主控單元，以數(shù)字視頻接口DVI為視頻接口、TI公司的TFP401和TFP410為視頻信號的編解碼芯片...
關(guān)鍵字： FPGA 最小化傳輸差分信號

基于FPGA控制VGA顯示的多通道數(shù)字示波器的設(shè)計

摘要：為了實現(xiàn)對0～1 MHz的信號進行測量以及顯示的目的，制作了基于SOPC技術(shù)的VGA顯示數(shù)字存儲示波器。采用硬件與軟件相配合的設(shè)計方法，主要模塊有基于FPGA的最小系統(tǒng)模塊、信號調(diào)理電路模塊、AD采樣模塊、觸發(fā)電路
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基于FPGA的FIR數(shù)字濾波器的優(yōu)化設(shè)計

摘要：提出采用正則有符號數(shù)字量(CSD)編碼技術(shù)實現(xiàn)FIR濾波器。首先分析了FIR數(shù)字濾波器理論及常用設(shè)計方法的不足，然后介紹了二進制數(shù)的CSD編碼技術(shù)及其特點，給出了其于CSD編碼的定點常系數(shù)FIR濾波器設(shè)計過程，使用
關(guān)鍵字： FPGA FIR 數(shù)字濾波器優(yōu)化設(shè)計

基于FPGA的TCP粘合設(shè)計實現(xiàn)

基于FPGA的TCP粘合設(shè)計實現(xiàn),在應(yīng)用級代理的基礎(chǔ)上，為進一步提高數(shù)據(jù)處理的速度，提出了TCP粘合技術(shù)[1]。該技術(shù)在通信雙方建立通信之初對雙方的握手信號以及通信原語進行分析，獲取必要的信息，決定數(shù)據(jù)的流向，一旦雙方開始通信，該代理就不再
關(guān)鍵字：設(shè)計實現(xiàn) 粘合 TCP FPGA 基于

基于CORDIC算法和FPGA的數(shù)字頻率校正的實現(xiàn)

本文通過對CORDIC算法的工作原理進行分析，給出了基于CORDIC算法和FPGA實現(xiàn)數(shù)字頻率校正的實現(xiàn)方案。仿真結(jié)果證明，該方法可以實現(xiàn)標(biāo)準(zhǔn)的正弦波和余弦波信號，可以直接作為頻偏校正單元來對數(shù)字頻率信號進行校正。
關(guān)鍵字： CORDIC FPGA 算法數(shù)字頻率

基于FPGA-NIOS的多功能留言機設(shè)計

摘要：隨著科技的進步，人們生活中對于聯(lián)絡(luò)的需求越來越高，而傳統(tǒng)基于電話的留言機在沒有手機或電話的情況下具有諸多不便。針對上述需求，設(shè)計了一款應(yīng)用于家庭用戶中的多功能留言機?？紤]到FPGA的諸多特點，采用可
關(guān)鍵字： FPGA-NIOS 多功能留言機

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xilinx fpga介紹

　　Xilinx FPGA 　　Xilinx FPGA主要分為兩大類，一種側(cè)重低成本應(yīng)用，容量中等，性能可以滿足一般的邏輯設(shè)計要求，如Spartan系列；還有一種側(cè)重于高性能應(yīng)用，容量大，性能能滿足各類高端應(yīng)用，如Virtex系列，用戶可以根據(jù)自己實際應(yīng)用要求進行選擇。在性能可以滿足的情況下，優(yōu)先選擇低成本器件。　　Xilinx FPGA可編程邏輯解決方案縮短了電子設(shè)備制造商開發(fā)產(chǎn)品的時間 [ 查看詳細 ]