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京微雅格FPGA的仿真方法

　　京微雅格是世界上除美國硅谷以外唯一自主研發(fā)并成功量產(chǎn)現(xiàn)場可編程邏輯(FPGA)芯片的公司，目前擁有數(shù)百項技術(shù)專利和近百款產(chǎn)品。目前，已經(jīng)有越來越多的用戶都開始使用國產(chǎn)FPGA來做自己的設(shè)計，然而在FPGA的開發(fā)過程中，免不了要對設(shè)計進行仿真。京微雅格的FPGA是支持在modelsim中進行仿真的。　　京微雅格的FPGA需要在Primace軟件中進行開發(fā)，為了便于客戶進行仿真設(shè)計，在Primace5.0及以上版本都支持在工程中直接調(diào)用仿真工具Modelsim。同時，也支持在modelsim中直接進行
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利用Spartan-3 FPGA實現(xiàn)高性能DSP功能

　　Spartan-3 FPGA能以突破性的價位點實現(xiàn)嵌入式DSP功能。本文闡述了Spartan-3 FPGA針對DSP而優(yōu)化的特性，并通過實現(xiàn)示例分析了它們在性能和成本上的優(yōu)勢。　　所有低成本的FPGA都以頗具吸引力的價格提供基本的邏輯性能，并能滿足廣泛的多用途設(shè)計需求。然而，當考慮在FPGA構(gòu)造中嵌入DSP功能時，必須選擇高端FPGA以獲得諸如嵌入式乘法器和分布式存儲器等平臺特性。　　Spartan-3 FPGA的面世改變了嵌入式DSP的應(yīng)用前景。雖然Spartan-3系列器件的價位可能較低，
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意法半導體(ST)與米蘭理工大學通過PFGA合作開發(fā)FASTER 3D圖形應(yīng)用系統(tǒng)

　　橫跨多重電子應(yīng)用領(lǐng)域、全球領(lǐng)先的半導體供應(yīng)商意法半導體(STMicroelectronics，簡稱ST)宣布對基于射線跟蹤 (ray-tracing) 技術(shù)的實驗性3D圖形應(yīng)用系統(tǒng)進行測試驗證。該解決方案采用一顆與現(xiàn)場可編程門陣列 (FPGA, Field-Programmable Gate Array) 相連、基于ARM®處理器的測試芯片。FASTER 研發(fā)項目以“簡化分析合成技術(shù)，實現(xiàn)有效配置”為目標，是意法半導體與米蘭理工大學 (Politecnico di Mi
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【從零開始走進FPGA】創(chuàng)造平臺——Quartus II 11.0 套件安裝指南

　　一、Altera Quartus II 11.0套件介紹　　所謂巧婦難為無米之炊，再強的軟硬件功底，再多的思維創(chuàng)造力，沒有軟件的平臺，也只是徒勞。因此，一切創(chuàng)造的平臺——Quartus II 軟件安裝，由零開啟的世界，便從此開始。　　自從Bingo 2009年開始接觸FPGA，Quartus II 版本的軟件從n年前的5.1版本到今天的最新發(fā)布的11.0，都使用過;當然對于軟件核心構(gòu)架而言，萬變不離其宗。雖然多多少少有點bug，但這10多個版本發(fā)展到了現(xiàn)在，能看到Alt
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零基礎(chǔ)學FPGA（七）淺談狀態(tài)機

　　今天我們來寫狀態(tài)機。　　關(guān)于狀態(tài)機呢，想必大家應(yīng)該都接觸過，通俗的講就是數(shù)電里我們學的狀態(tài)轉(zhuǎn)換圖。狀態(tài)機分為兩中類型，一種叫Mealy型，一種叫Moore型。前者就是說時序邏輯的輸出不僅取決于當前的狀態(tài)，還取決于輸入，而后者就是時序邏輯的輸出僅僅取決于當前的狀態(tài)。下面兩個圖分別表示兩種不同的狀態(tài)機。　　 ? 　　 ? 　　下面我們就通過代碼來寫一下狀態(tài)機，以下面的狀態(tài)轉(zhuǎn)換圖為例　　 ? 　　首先，是一種典型的狀態(tài)機寫法，這種寫法我們稱為
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零基礎(chǔ)學FPGA（六）今天講習題

　　習題呢，來自夏雨聞老師的那本教材，就挑幾個感覺自己做著有點難度的寫寫吧　　 ? 　　這個題呢剛開始我是沒看明白，記得書上只講了我們習慣上的用法，這種用法我是沒見過，問了下別人才知道，Verilog中一般是左高右低。第一個沒問題，第二個，input [0:2] IP,習慣上我們這樣寫 input [2:0] IP，這里兩個是等價的，即表示第0 .1 .2 三位。第三個，wire [16:23] A,也是，左高右低，表示第16.17.....22. 23位，左高右低就這樣記就好了。
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基于MicroBlaze軟核的FPGA片上系統(tǒng)設(shè)計

　　Xilinx公司的MicroBlaze 32位軟處理器核是支持CoreConnect總線的標準外設(shè)集合。MicroBlaze處理器運行在150MHz時鐘下，可提供125 D-MIPS的性能，非常適合設(shè)計針對網(wǎng)絡(luò)、電信、數(shù)據(jù)通信和消費市場的復雜嵌入式系統(tǒng)。　　1 MicroBlaze的體系結(jié)構(gòu) 　　MicroBlaze 是基于Xilinx公司FPGA的微處理器IP核，和其它外設(shè)IP核一起，可以完成可編程系統(tǒng)芯片(SOPC)的設(shè)計。MicroBlaze 處理器采用RISC架構(gòu)和哈佛結(jié)構(gòu)的32位指令和
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基于MicroBlaze嵌入式Web服務(wù)器設(shè)計

　　1 引言　　由于Internet技術(shù)的滲透，嵌入式系統(tǒng)正變得越來越智能化并具有越來越多的網(wǎng)絡(luò)友好特性。Web技術(shù)的飛速發(fā)展，給嵌入式系統(tǒng)進入Internet提供絕佳的途徑。在現(xiàn)場儀表和企業(yè)設(shè)備層應(yīng)用嵌入式技術(shù)是企業(yè)監(jiān)控系統(tǒng)的發(fā)展趨勢。與現(xiàn)場總線技術(shù)相比，嵌入式技術(shù)不僅為開發(fā)者提供了大量的工具和函數(shù)庫，而且減少了傳統(tǒng)的客戶端，減少了二次開發(fā)的工作量;而把嵌入式技術(shù)和Internet技術(shù)結(jié)合起來，使得整個工控網(wǎng)絡(luò)易于和Internet實現(xiàn)無縫連接;現(xiàn)在多數(shù)企業(yè)控制網(wǎng)絡(luò)是通過專用線路進行數(shù)據(jù)通信，其通信
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基于MicroBlaze軟核的液晶驅(qū)動程序設(shè)計

　　1 MicroBlaze的體系結(jié)構(gòu) 　　MicroBlaze采用功能強大的32位流水線結(jié)構(gòu)，包含32個32位通用寄存器和1個可選的32位移位器，時鐘頻率可達150 MHz;在Virrex一4 FPGA上運行速率高達120 DMIPS，僅占用Virtex—II Pro FPGA中的950個邏輯單元。MicroBlaze軟核的結(jié)構(gòu)框圖如圖1所示。它具有以下基本特征：　　①32個32位通用寄存器和2個專用寄存器(程序計數(shù)器和狀態(tài)標志寄存器)。　　②32位指令系統(tǒng)，支持3個操作數(shù)和2種尋
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Microblaze在RFID閱讀器的軟硬件設(shè)計中的應(yīng)用

　　引言　　RFID 技術(shù)是從 20 世紀 80 年代走向成熟的一項自動識別技術(shù)，近年來發(fā)展十分迅速。目前，在全世界，基于 RFID 技術(shù)的電子標簽，使用已經(jīng) 非常廣泛了，這主要取決于它的特性，RFID 標簽可以使用在幾乎所有的物理對象上。RFID 技術(shù)在工業(yè)自動化，物體跟蹤，交通運輸控制管理，防偽校園卡，電子錢包，行李標簽，收費系統(tǒng)，醫(yī)用裝置，電子物品的監(jiān)控和軍事用途等方面已經(jīng)得到了廣泛的應(yīng)用。例如第二代居民身份證，使用基于 ISO/IEC4443-B 標準的 13.56 MHz 電子標簽，
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基于SOPC的通用型JTAG調(diào)試器的設(shè)計

　　SOPC技術(shù)的發(fā)展，給仿真器指出了新的發(fā)展方向。所謂SOPC技術(shù)，就是指用可編程技術(shù)將整個系統(tǒng)放在一塊硅片上。在傳統(tǒng)設(shè)計中電路級相互獨立的各個系統(tǒng)被集成到一塊FPGA芯片中。　　SOPC的可重用性是一種先進的設(shè)計思想。為了降低用戶的負擔，避免重復勞動，將一些在數(shù)字電路中常用但比較復雜的功能模塊，比如SDRAM控制器等，設(shè)計成可修改參數(shù)的模塊，用戶在設(shè)計系統(tǒng)時可以直接調(diào)用這些模塊。這些特定的功能模塊被稱為IPcore(知識產(chǎn)權(quán)核)。由于IPcore通常是很成熟的，因此降低了開發(fā)風險。　　本文利用
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基于Flash和JTAG接口的FPGA多配置系統(tǒng)

　　引言　　針對需要切換多個FPGA配置碼流的場合， Xilinx公司提出了一種名為System ACE的解決方案，它利用CF(Compact Flash)存儲卡來替代配置用PROM，用專門的ACE控制芯片完成CF卡的讀寫，上位機軟件生成專用的ACE文件并下載到CF存儲卡中，上電后通過ACE控制芯片實現(xiàn)不同配置碼流間的切換[1]。　　System ACE的解決方案需要購買CF存儲卡和專用的ACE控制芯片，增加了系統(tǒng)搭建成本和耗費了更多空間，而且該方案只能實現(xiàn)最多8個配置文件的切換，在面對更多個配置
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【從零開始走進FPGA】前言：哪些人適合做FPGA開發(fā)?

　　“FPGA目前非?；穑鱾€高校也開了FPGA的課程，但是FPGA并不是每個人都適合，F(xiàn)PGA講究的是一個入道，入什么道，入電子設(shè)計的道，就是說，這個過程，你得從電子設(shè)計開始，然后再學FPGA，而不是先從VHDL/Verilog開始，直接跳過數(shù)電模電。這一點非常重要，這涉及到你以后的發(fā)展高度的問題。我是過來人，我深刻體會到FPGA與數(shù)電模電的基礎(chǔ)的深層次聯(lián)系。對于本科生而言，你可以把FPGA當作業(yè)余興趣，但不要把它當成今后的飯碗，你可以保持這個興趣直到研究生讀完。從我招聘的情況來看，做FPG
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奧迪在量產(chǎn)車中選用Altera SoC FPGA，實現(xiàn)“導航駕駛”功能

　　Altera公司今天宣布，奧迪的高級輔助駕駛系統(tǒng)(ADAS)選用其SoC現(xiàn)場可編程門陣列(FPGA)，實現(xiàn)量產(chǎn)。奧迪是自動駕駛汽車技術(shù)的領(lǐng)先者，奧地利高科技公司TTTech則是奧迪中央輔助駕駛控制單元zFAS的核心開發(fā)合作伙伴，他們選擇了Altera® Cyclone® V SoC FPGA幫助提高其系統(tǒng)性能，突出奧迪在導航駕駛和駐車方面的優(yōu)勢，而這些是專用標準產(chǎn)品(ASSP)解決方案無法實現(xiàn)的。　　Altera的Cyclone V SoC FPGA結(jié)合了可編程邏輯和雙核ARM C
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基于FPGA的FIR濾波器的誤差分析

　　數(shù)字濾波器作為數(shù)字信號處理技術(shù)的重要組成部分之一,已廣泛應(yīng)用于信號分離、恢復、整形等重要場合。在工程實踐中,往往要求對信號處理要有實時性和靈活性,而基于FPGA的FIR濾波器因其嚴格的線性相位和簡單的設(shè)計步驟而應(yīng)用廣泛。本文不僅對基于FPGA設(shè)計的FIR濾波器進行了簡單的誤差分析,包括絕對誤差與相對誤差分析;而且還做出了該濾波器的頻譜,通過與MATLAB中仿真出的頻譜進行比較分析,驗證了該濾波器在工程應(yīng)用中是適應(yīng)的,滿足了設(shè)計的要求。　　基于FPGA的FIR濾波器的誤差分析.pdf
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