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EEPW首頁 >> 主題列表 >> 現(xiàn)場可編程門陣列(fpga)

基于FPGA的信道化接收機(jī)

  • 針對(duì)寬帶陣列偵收系統(tǒng)，設(shè)計(jì)一種基于FPGA的信道化接收機(jī)實(shí)現(xiàn)方案，并對(duì)各模塊具體的實(shí)現(xiàn)進(jìn)行了分析、設(shè)計(jì)，特別是基于FPGA的信道化模塊。整個(gè)系統(tǒng)具有子信道頻帶窄、利于對(duì)信號(hào)進(jìn)行精細(xì)化處理、功耗低、體積小、成本低、操作靈活以及易于擴(kuò)展等特點(diǎn)。硬件系統(tǒng)測試結(jié)果驗(yàn)證了系統(tǒng)設(shè)計(jì)的有效性和可行性。
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在FPGA中實(shí)施4G無線球形檢測器的方案

  • WiMAX對(duì)寬帶互聯(lián)網(wǎng)接入如同手機(jī)對(duì)語音通信一樣意義非凡。它可以取代DSL和有線服務(wù)，為您隨時(shí)隨地提供...
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MCS-51單片機(jī)與FPGA

  • 1 單片機(jī)與FPGA的接口方式單片機(jī)與FPGA的接口方式一般有兩種，即總線方式與獨(dú)立方式。MCS-51單片機(jī)具有很強(qiáng)的外部總線擴(kuò)展能力，利用片外三總線結(jié)構(gòu)很容易實(shí)現(xiàn)單片機(jī)與FPGA的總線接口，而且單片機(jī)以總線方式與FPGA進(jìn)
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基于FPGA的三相函數(shù)信號(hào)發(fā)生器設(shè)計(jì)

  • 摘要：基于FPGA的三相函數(shù)信號(hào)發(fā)生器以DDS為核心，在Altera公司CycloneⅡ系列EP2C8T144C8上實(shí)現(xiàn)正弦波、方波、三角波和鋸齒波信號(hào)的產(chǎn)生，利用單片機(jī)PICl8F4550控制波形的頻率及相位差。同時(shí)單片機(jī)通過DAC0832控制波
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基于DSP Builder的回波抵消器設(shè)計(jì)與實(shí)現(xiàn)

  • 基于DSP Builder的回波抵消器設(shè)計(jì)與實(shí)現(xiàn),摘要：針對(duì)通信中的回波問題，基于自適應(yīng)濾波的LMS算法，設(shè)計(jì)了自適應(yīng)回波抵消器。并基于利用FPGA芯片，在DSP Builder平臺(tái)上，有效結(jié)合MatLab／Simulink和Quanus II設(shè)計(jì)工具，根據(jù)模塊化設(shè)計(jì)思想實(shí)現(xiàn)了LMS算法自適應(yīng)
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實(shí)時(shí)嵌入式產(chǎn)品的測試系統(tǒng)設(shè)計(jì)

  • 實(shí)時(shí)嵌入式產(chǎn)品的測試系統(tǒng)設(shè)計(jì),摘要：主要介紹針對(duì)高實(shí)時(shí)性的嵌入式產(chǎn)品而開發(fā)的測試系統(tǒng)的設(shè)計(jì)，簡單介紹了被測試系統(tǒng)的特性，從整個(gè)測試系統(tǒng)的設(shè)計(jì)思想、設(shè)計(jì)原理，包括軟件和硬件等方面，給出詳細(xì)的介紹。另外，比較了不同方案設(shè)計(jì)的優(yōu)缺點(diǎn)，為
  • 關(guān)鍵字： 嵌入式  測試系統(tǒng)  RTX  FPGA  通信  

基于FPGA的寬帶數(shù)字接收機(jī)變帶寬數(shù)字下變頻器

  • 變帶寬數(shù)字下變頻器（VB-DDC）可以對(duì)多種帶寬的輸入信號(hào)進(jìn)行處理，因此在雷達(dá)、通信、電子偵察等領(lǐng)域有廣泛應(yīng)...
  • 關(guān)鍵字： FPGA  帶寬可變  VB-DDC  StratixII  

基于FPGA的65nm芯片的設(shè)計(jì)方案

  • 基于FPGA的65nm芯片的設(shè)計(jì)方案,　　隨著工藝技術(shù)向65nm以及更小尺寸的邁進(jìn)，出現(xiàn)了兩類關(guān)鍵的開發(fā)問題：待機(jī)功耗和開發(fā)成本。這兩個(gè)問題在每一新的工藝節(jié)點(diǎn)上都非常突出，現(xiàn)在已經(jīng)成為設(shè)計(jì)團(tuán)隊(duì)面臨的主要問題。在設(shè)計(jì)方法上從專用集成電路(ASIC)和
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FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案

  • FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案,　　本文將介紹FPGA的功耗、流行的低功耗功能件以及影響功耗的用戶選擇方案，并探討近期的低功耗研究，以洞察高功率效率FPGA的未來趨勢?！　」牡慕M成部分　　FPGA的功耗由兩部分組成：動(dòng)態(tài)功耗和靜態(tài)功耗。信號(hào)給
  • 關(guān)鍵字： 功耗  選擇  方案  用戶  影響  架構(gòu)  FPGA  

基于VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真

  • 基于VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真,　　針對(duì)目前國內(nèi)SDH系統(tǒng)中還沒有一個(gè)專門的E1分接復(fù)用芯征，本文介紹一種用高級(jí)硬件描述語言VHDL及狀態(tài)轉(zhuǎn)移圖完成該發(fā)接復(fù)用器的設(shè)計(jì)的新型設(shè)計(jì)方法及其FPGA實(shí)現(xiàn)。并給出了用Xilinx FoundaTIon tools EDA軟件設(shè)計(jì)的
  • 關(guān)鍵字： 設(shè)計(jì)  FPGA  仿真  系統(tǒng)  SDH  VHDL  復(fù)用器  基于  

用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能

  • 用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能,　　引言　　HDLC的ASIC芯片使用簡易，功能針對(duì)性強(qiáng)，性能可靠，適合應(yīng)用于特定用途的大批量產(chǎn)品中。但由于HDLC標(biāo)準(zhǔn)的文本較多，ASIC芯片出于專用性的目的難以通用于不同版本，缺乏應(yīng)用靈活性。有的芯片公司還有自己
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基于FPGA的圖像調(diào)焦系統(tǒng)研究

  • 摘要：采用基于圖像技術(shù)的自動(dòng)調(diào)焦方法，根據(jù)圖像分析出圖形的質(zhì)量，完成圖像預(yù)處理、清晰度判別，獲得當(dāng)前的成像狀況。通過控制電機(jī)，完成調(diào)焦操作。其中核心技術(shù)是分析圖像質(zhì)量評(píng)價(jià)函數(shù)。針對(duì)調(diào)焦算法計(jì)算量大、計(jì)
  • 關(guān)鍵字： FPGA  圖像調(diào)焦  系統(tǒng)研究    

基于FPGA實(shí)現(xiàn)的SCI接口電路IP核的設(shè)計(jì)

  • 隨著超大規(guī)模集成電路(VeryLargeScaleIntegrationVLSI)工藝技術(shù)的發(fā)展，芯片的規(guī)模越來越大，集成規(guī)模...
  • 關(guān)鍵字： FPGA  IP核  SCI接口電路  VLSI  

基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)

  • 基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù),LatticeXP2器件包括基于查找表（LUT）的 FPGA以及非易失閃存單元（flexiFLASH）。LatticeXP2系列器件的LUT從5K到40K，分布是RAM從10K到83Kb，EBR SRAM從166Kb到885Kb，EBR SRAM區(qū)塊從9到48個(gè)，sysDSP從3個(gè)到8個(gè)，18x
  • 關(guān)鍵字： 評(píng)估  技術(shù)  標(biāo)準(zhǔn)  FPGA  LatticeXP2  設(shè)計(jì)  基于  
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現(xiàn)場可編程門陣列(fpga)介紹

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